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RISC—cpu

  • 資源大?。?/b>120 K
  • 上傳時間: 2015-12-11
  • 上傳用戶:yepeng139
  • 資源積分:2 下載積分
  • 標(biāo)      簽: cpu Verilog modelsim

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通過modelsim軟件編寫源代碼并且仿真實現(xiàn) 精簡的CPU設(shè)計

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