?? q7230.fit.rpt
字號:
; G ; 33 ; -- ; 2 ; 3 ; 0 ; no ; LVTTL ; Fitter ;
; NAB ; 34 ; -- ; 2 ; 2 ; 0 ; no ; LVTTL ; Fitter ;
; OE ; 5 ; -- ; 1 ; 9 ; 0 ; no ; LVTTL ; Fitter ;
; clr ; 44 ; -- ; -- ; 11 ; 0 ; no ; LVTTL ; Fitter ;
; reset ; 11 ; -- ; 1 ; 18 ; 0 ; no ; LVTTL ; Fitter ;
+--------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
; CK ; 6 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; Fitter ;
; DQ ; 12 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; Fitter ;
; NAA ; 16 ; -- ; 1 ; no ; no ; no ; no ; LVTTL ; Fitter ;
; NDQ ; 41 ; -- ; 2 ; no ; no ; no ; no ; LVTTL ; Fitter ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 0 ; -- ; GND+ ; ; ; ; ;
; 2 ; 1 ; -- ; GND+ ; ; ; ; ;
; 3 ; 2 ; -- ; VCCINT ; power ; ; 3.3V ; ;
; 4 ; 3 ; -- ; RESERVED ; ; ; ; ;
; 5 ; 4 ; -- ; OE ; input ; LVTTL ; ; N ;
; 6 ; 5 ; -- ; CK ; output ; LVTTL ; ; N ;
; 7 ; 6 ; -- ; +TDI ; input ; LVTTL ; ; N ;
; 8 ; 7 ; -- ; RESERVED ; ; ; ; ;
; 9 ; 8 ; -- ; Din[0] ; input ; LVTTL ; ; N ;
; 10 ; 9 ; -- ; GND ; gnd ; ; ; ;
; 11 ; 10 ; -- ; reset ; input ; LVTTL ; ; N ;
; 12 ; 11 ; -- ; DQ ; output ; LVTTL ; ; N ;
; 13 ; 12 ; -- ; +TMS ; input ; LVTTL ; ; N ;
; 14 ; 13 ; -- ; RESERVED ; ; ; ; ;
; 15 ; 14 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 16 ; 15 ; -- ; NAA ; output ; LVTTL ; ; N ;
; 17 ; 16 ; -- ; GND ; gnd ; ; ; ;
; 18 ; 17 ; -- ; Din[7] ; input ; LVTTL ; ; N ;
; 19 ; 18 ; -- ; Din[2] ; input ; LVTTL ; ; N ;
; 20 ; 19 ; -- ; Din[3] ; input ; LVTTL ; ; N ;
; 21 ; 20 ; -- ; D ; input ; LVTTL ; ; N ;
; 22 ; 21 ; -- ; GND ; gnd ; ; ; ;
; 23 ; 22 ; -- ; VCCINT ; power ; ; 3.3V ; ;
; 24 ; 23 ; -- ; Din[4] ; input ; LVTTL ; ; N ;
; 25 ; 24 ; -- ; Din[6] ; input ; LVTTL ; ; N ;
; 26 ; 25 ; -- ; RESERVED ; ; ; ; ;
; 27 ; 26 ; -- ; RESERVED ; ; ; ; ;
; 28 ; 27 ; -- ; RESERVED ; ; ; ; ;
; 29 ; 28 ; -- ; RESERVED ; ; ; ; ;
; 30 ; 29 ; -- ; GND ; gnd ; ; ; ;
; 31 ; 30 ; -- ; RESERVED ; ; ; ; ;
; 32 ; 31 ; -- ; +TCK ; input ; LVTTL ; ; N ;
; 33 ; 32 ; -- ; G ; input ; LVTTL ; ; N ;
; 34 ; 33 ; -- ; NAB ; input ; LVTTL ; ; N ;
; 35 ; 34 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 36 ; 35 ; -- ; GND ; gnd ; ; ; ;
; 37 ; 36 ; -- ; RESERVED ; ; ; ; ;
; 38 ; 37 ; -- ; *TDO ; output ; LVTTL ; ; N ;
; 39 ; 38 ; -- ; Din[5] ; input ; LVTTL ; ; N ;
; 40 ; 39 ; -- ; Din[1] ; input ; LVTTL ; ; N ;
; 41 ; 40 ; -- ; NDQ ; output ; LVTTL ; ; N ;
; 42 ; 41 ; -- ; GND ; gnd ; ; ; ;
; 43 ; 42 ; -- ; CLK ; input ; LVTTL ; ; N ;
; 44 ; 43 ; -- ; clr ; input ; LVTTL ; ; N ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
+--------------------------------------------------------------------------------------------------+
; I/O Standard ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; I/O Standard ; Input Vref ; Dedicated Input Pins ; Pins in I/O Bank1 ; Pins in I/O Bank2 ; Total ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; LVTTL ; - ; 2 ; 0 ; 0 ; 2 ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
+--------------------------------------------------------------------+
; Dedicated Inputs I/O ;
+------+-------+-------+-------+--------------+------------+---------+
; Name ; Pin # ; Type ; VCCIO ; I/O Standard ; Input Vref ; Current ;
+------+-------+-------+-------+--------------+------------+---------+
; CLK ; 43 ; Input ; -- ; LVTTL ; - ; 0 mA ;
; clr ; 44 ; Input ; -- ; LVTTL ; - ; 0 mA ;
+------+-------+-------+-------+--------------+------------+---------+
+-----------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+--------------+-------+------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+--------------+-------+------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; 2.5 V ; 10 pF ; Not Available ;
+--------------+-------+------------------------+
+----------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+------------+------+---------------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ;
+----------------------------+------------+------+---------------------+
; |TOP ; 28 ; 23 ; |TOP ;
+----------------------------+------------+------+---------------------+
+------------------------------------------------------------------------------------------------------+
; Control Signals ;
+---------------+----------+---------+--------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+---------------+----------+---------+--------------+--------+----------------------+------------------+
; CK~20 ; SEXP5 ; 1 ; Clock ; no ; -- ; -- ;
; CLK ; PIN_43 ; 9 ; Clock ; yes ; On ; -- ;
; clr ; PIN_44 ; 11 ; Clock enable ; no ; -- ; -- ;
; reduce_nor~25 ; LC21 ; 5 ; Clock enable ; no ; -- ; -- ;
; reduce_nor~33 ; LC24 ; 6 ; Clock enable ; no ; -- ; -- ;
; reset ; PIN_11 ; 18 ; Async. clear ; no ; -- ; -- ;
; rtl~566 ; SEXP3 ; 7 ; Clock enable ; no ; -- ; -- ;
+---------------+----------+---------+--------------+--------+----------------------+------------------+
+---------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
; CLK ; PIN_43 ; 9 ; On ; -- ;
+------+----------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+-------------------+-------------+
; Name ; Fan-Out ;
+-------------------+-------------+
; count[0] ; 19 ;
; reset ; 18 ;
; count[1] ; 18 ;
; count[3] ; 15 ;
; count[2] ; 15 ;
; clr ; 11 ;
; count[4] ; 11 ;
; Q[3]~227 ; 11 ;
; OE ; 9 ;
; Q[0]$en_or~41sexp ; 8 ;
; count[5] ; 8 ;
; Q[2]~223 ; 8 ;
; Q[4]~219 ; 8 ;
; Q[1]~215 ; 7 ;
; rtl~566 ; 7 ;
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