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?? ——一種多接口模式、超高速ad轉換芯片Aad9430.htm

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          <TD align=middle height=15>文章作者:高麗紅 王正垠 <BR>文章類型:設計應用 
            文章加入時間:2003年12月24日17:54</TD></TR>
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          <TD align=right><FONT color=#cc0000>文章出處:國外電子元器件</FONT> </TD></TR>
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            <DIV id=Content><FONT face=宋體>&nbsp;&nbsp; 
            <B>摘要:</B></FONT>AD9430是AD公司推出的12位模數轉換器,它采用3.3V單電源,可提供CMOS和LVDS兩種接口模式。文章介紹了AD9430的主要性能,給出了其LVDS和 
            CMOS兩種輸出模式的應用電路。 
            <P class=MsoNormal><SPAN 
            style="FONT-FAMILY: 宋體; mso-ascii-font-family: 'Times New Roman'; mso-hansi-font-family: 'Times New Roman'">&nbsp;&nbsp;&nbsp; 
            <B>關鍵詞:AD</B></SPAN>轉換器;雙數據口輸出; LVDS AD9430</P>
            <P style="TEXT-INDENT: 0px"><B>1 概述</B></P>
            <P 
            style="TEXT-INDENT: 30px">AD9430是AD公司推出的一種12位高速、低功耗A/D轉換器。它采用3.3V單電源供電,因而簡化了系統電源設計。AD9430片內自帶的參考電壓源和采樣保持器使其在系統設計中更易于使用。<BR><IMG 
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            width=482 vspace=10 border=0><BR><FONT size=3>&nbsp;&nbsp;&nbsp; 
            </FONT><SPAN class=main1>該器件提供有兩種數據輸出接口模式,即雙端口3.3V 
            CMOS輸出和LVDS輸出。在CMOS模式下,每個通道的數據通過率為105 
            MSPS,且有交替數據輸出和并行數據輸出兩種方式;在LVDS模式下,數據通過率為210 
            MSPS,可與帶有LVDS接收器的FP-GA芯片進行直接接口。輸出數據編碼格式有二進制補碼和偏移二進制碼兩種格式可供選擇。其中的LVDS接口(即低壓差分信號Low 
            Voltage Differential 
            Signaling)是一種低擺幅的電流型差分信號,它可使信號在差分PCB線對或平衡電纜上以幾百Mbps的速率傳輸,而其低壓幅和低電流驅動輸出則可實現低噪聲和低功耗。AD9430的主要特性如下:</P>
            <P style="TEXT-INDENT: 30px">●采用3.3V單電源供電;</P>
            <P 
            style="TEXT-INDENT: 30px">●模擬輸入頻率為65MHz、采樣率為210MSPS時,信噪比高達65dB;</P>
            <P style="TEXT-INDENT: 30px">●采樣率為210MSPS時,功耗僅1.3W;</P>
            <P style="TEXT-INDENT: 30px">●可提供數據同步輸入和數據時鐘輸出;</P>
            <P style="TEXT-INDENT: 30px">●自帶時鐘占空比穩定器;</P>
            <P style="TEXT-INDENT: 30px">●具有極好的線性特性: DNL=±0.3LSB</P>
            <P style="TEXT-INDENT: 30px">INL=±0.5LSB<BR><IMG height=573 
            hspace=10 src="——一種多接口模式、超高速AD轉換芯片AAD9430.files/20b.gif" width=549 
            vspace=10 border=0><BR><B>2 內部結構與管腳說明</B></P>
            <P 
            style="TEXT-INDENT: 30px">圖1、圖2分別為AD9430采用CMOS模式和LVDS模式的管腳分布圖。其主要管腳說明如下:</P>
            <P 
            style="TEXT-INDENT: 30px">S5:滿量程調節腳,接高電平時,輸入差分信號峰峰值為0.768VP-P;接低電平時,輸入差分信號峰峰值為1.536VP-P。</P>
            <P 
            style="TEXT-INDENT: 30px">S4:在CMOS模式下使用,接高時為交替數據輸出方式,接低時為并行數據輸出;該腳在LVDS模式時接地。</P>
            <P 

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