?? lcd1602.tan.rpt
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; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[6] ; lpm_counter:Count_rtl_0|dffs[9] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[7] ; lpm_counter:Count_rtl_0|dffs[9] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[8] ; lpm_counter:Count_rtl_0|dffs[9] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[0] ; lpm_counter:Count_rtl_0|dffs[8] ; Clk ; Clk ; None ; None ; 5.800 ns ;
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; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[3] ; lpm_counter:Count_rtl_0|dffs[4] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[0] ; lpm_counter:Count_rtl_0|dffs[3] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[1] ; lpm_counter:Count_rtl_0|dffs[3] ; Clk ; Clk ; None ; None ; 5.800 ns ;
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; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[0] ; lpm_counter:Count_rtl_0|dffs[2] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; lpm_counter:Count_rtl_0|dffs[1] ; lpm_counter:Count_rtl_0|dffs[2] ; Clk ; Clk ; None ; None ; 5.800 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+----------------------------------+----------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+-------------------------------------------------------------------------+
; tsu ;
+-------+--------------+------------+-------+------------------+----------+
; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ;
+-------+--------------+------------+-------+------------------+----------+
; N/A ; None ; 5.000 ns ; Reset ; Clk_Out ; Clk ;
; N/A ; None ; 4.100 ns ; Reset ; LCD_Data[3]~reg0 ; Clk ;
; N/A ; None ; 4.100 ns ; Reset ; LCD_Data[6]~reg0 ; Clk ;
; N/A ; None ; 4.100 ns ; Reset ; LCD_Data[0]~reg0 ; Clk ;
; N/A ; None ; 1.200 ns ; Reset ; LCD_Data[4]~reg0 ; Clk ;
; N/A ; None ; 1.200 ns ; Reset ; LCD_Data[5]~reg0 ; Clk ;
; N/A ; None ; 1.200 ns ; Reset ; LCD_Data[2]~reg0 ; Clk ;
; N/A ; None ; 1.200 ns ; Reset ; LCD_Data[1]~reg0 ; Clk ;
; N/A ; None ; 0.300 ns ; Reset ; LCD_Data[7]~reg0 ; Clk ;
+-------+--------------+------------+-------+------------------+----------+
+---------------------------------------------------------------------------------+
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