?? 基于cpld控制的dds數字頻率合成器設計.htm

?? dds信號發生器程序設計
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<HTML><HEAD><TITLE>基于CPLD控制的DDS數字頻率合成器設計</TITLE>
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content=基于CPLD控制的DDS數字頻率合成器設計/摘要：介紹了ADI公司新一代DDS芯片AD9952和XILINX公司新一代CPLD產品XC2C128的主要性能，提出了用XC2C128作控制電路，由AD9952構成寬帶、低相噪、低功耗數字合成頻率源的/基于CPLD控制的DDS數字頻率合成器設計電子問題有問必答,綜合電子論壇歡迎您！ 
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                  size=4><STRONG>基于CPLD控制的DDS數字頻率合成器設計</STRONG></FONT></DIV><BR><BR><B>摘要：</B>介紹了ADI公司新一代DDS芯片AD9952和XILINX公司新一代CPLD產品XC2C128的主要性能，提出了用XC2C128作控制電路，由AD9952構成寬帶、低相噪、低功耗數字合成頻率源的設計方案，同時對如何提高DDS頻譜純度進行了探討，給出了超寬帶應用電路解決方案。 

                  <DIV>&nbsp;&nbsp; 
                  <B>關鍵詞：</B>AD9952；XC2C128；頻率源；頻譜改善；諧波；CPLD</DIV>
                  <DIV>ＤＤＳ是直接數字合成（Ｄｉｒｅｃｔ Ｄｉｇｉｔａｌ 
                  Ｓｙｎｔｈｅｓｉｓ）技術的簡稱，是近年來隨著數字集成電路和計算機的迅猛發展而出現的一種新的頻率合成技術。該技術從相位概念出發來對頻率進行合成。它采用數字取樣技術,將參考信號的頻率、相位、幅度等參數轉變成一組取樣函數，然后直接運算出所需要的頻率信號。由于是全數字結構，其輸出信號中含有大量雜散譜線。另外，其超寬頻帶信號也將遇到諧波電平高，從而難以抑制諧波等問題。這些問題嚴重影響了ＤＤＳ輸出信號的頻譜純度，也成為限制其應用的主要因素。本文提出了一種解決此問題的電路方案，并對如何改善信號源的頻譜質量進行了討論。<BR><BR><B>１ 
                  ＡＤ９９５２芯片介紹</B></DIV>
                  <DIV>１．１ ＡＤ９９５２的主要特點</DIV>
                  <DIV>ＡＤ９９５２是ＡＤＩ公司２００３年推出的新產品。該芯片能以早期ＤＤＳ芯片十分之一的功耗提供速度高達４００ＭＨｚ的內部時鐘，可合成高達１６０ 
                  ＭＨｚ的頻率。ＡＤ９９５２的主要性能如下：</DIV>
                  <DIV>●具有高達４００ＭＨｚ的內部時鐘，可單端或雙端差分輸入，并附有ＰＬＬ參考時鐘和可編程乘法器（４倍～２０倍）。<BR><BR><B><A 
                  href="http://www.avrw.com/article/pic/2006729164854734.gif">圖1</A></B><BR><BR><FONT 
                  size=3>&nbsp;&nbsp;&nbsp; </FONT>●超低功耗，１.８Ｖ時的功耗小于２５０ｍＷ。</DIV>
                  <DIV>●內部集成有１４位ＤＡＣ和超高速比較器，可產生高穩定度的方波輸出。</DIV>
                  <DIV>●內含３２位相位累加器和１９位正弦查詢表ＲＯＭ。</DIV>
                  <DIV>●含有可編程的相位／幅度抖動電路；可以減小由于相位截斷和ＤＡＣ量化誤差帶來的雜散。</DIV>
                  <DIV>●ＤＡＣ輸出相位噪聲小于－１２５ｄＢｃ／Ｈｚ／１ｋＨｚ；動態性能為：８０ｄＢ 
                  ＳＦＤＲ＠１３０ＭＨｚ（偏移±１００ｋＨｚ）。</DIV>
                  <DIV>●采用２線或３線串口控制，４８腳ＥＰＡＤ－ＴＱＦＰ封裝形式。</DIV>
                  <DIV>１．２ ＡＤ９９５２的結構原理</DIV>
                  <DIV>ＡＤ９９５２的內部功能框圖如圖１所示。</DIV>
                  <DIV>ＡＤ９９５２共有６種時鐘輸入模式，通過ＣｌｋＭｏｄｅ-Ｓｅｌｅｃｔ管腳、ＣＦＲ２＜０＞和ＣＦＲ２＜７
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