?? clock_d2.v
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//name:clock_d2.v 二分頻模塊 2006-5-2 version:1.0 作者:田世坤
//:
module clock_d2(clk,clk2);
input clk;
output clk2;
reg clk2;
always @ (posedge clk)
begin
clk2 = ~clk2;
end
endmodule
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