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?? dsk_appcfg.cmd

?? 一個基于DSP的軟件無線電的c語言設計實例。
?? CMD
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It was    *//*   generated by the Configuration Tool; any  *//*   changes risk being overwritten.                *//* INPUT dsk_app.cdb *//* MODULE PARAMETERS */GBL_USERINITFXN = _GBL_setPLLto225MHz;MEM_SEGZERO = MEM_NULL;MEM_MALLOCSEG = MEM_NULL;CLK_TIMEFXN = CLK_F_getshtime;CLK_HOOKFXN = HWI_F_dispatch;PRD_THOOKFXN = FXN_F_nop;RTDX_DATAMEMSEG = IRAM;HST_DSMBUFSEG = IRAM;SWI_EHOOKFXN = GBL_NULL;SWI_IHOOKFXN = GBL_NULL;SWI_EXECFXN = SWI_F_iexec;SWI_RUNFXN = SWI_F_run;TSK_STACKSEG = MEM_NULL;TSK_VCREATEFXN = _FXN_F_nop;TSK_VDELETEFXN = _FXN_F_nop;TSK_VEXITFXN = _FXN_F_nop;IDL_CALIBRFXN = IDL_F_calibrate;SYS_ABORTFXN = _UTL_doAbort;SYS_ERRORFXN = _UTL_doError;SYS_EXITFXN = _UTL_halt;SYS_PUTCFXN = _UTL_doPutc;GIO_CREATEFXN = _FXN_F_nop;GIO_DELETEFXN = _FXN_F_nop;GIO_PENDFXN = _FXN_F_nop;GIO_POSTFXN = _FXN_F_nop;/* OBJECT ALIASES */_IRAM = IRAM;_CACHE_L2 = CACHE_L2;_SDRAM = SDRAM;_PRD_clock = PRD_clock;_PRD_blinkLED = PRD_blinkLED;_PRD_load = PRD_load;_RTA_fromHost = RTA_fromHost;_RTA_toHost = RTA_toHost;_HWI_RESET = HWI_RESET;_HWI_NMI = HWI_NMI;_HWI_RESERVED0 = HWI_RESERVED0;_HWI_RESERVED1 = HWI_RESERVED1;_HWI_INT4 = HWI_INT4;_HWI_INT5 = HWI_INT5;_HWI_INT6 = HWI_INT6;_HWI_INT7 = HWI_INT7;_HWI_INT8 = HWI_INT8;_HWI_INT9 = HWI_INT9;_HWI_INT10 = HWI_INT10;_HWI_INT11 = HWI_INT11;_HWI_INT12 = HWI_INT12;_HWI_INT13 = HWI_INT13;_HWI_INT14 = HWI_INT14;_HWI_INT15 = HWI_INT15;_PRD_swi = PRD_swi;_processBufferSwi = processBufferSwi;_LNK_dataPump = LNK_dataPump;_RTA_dispatcher = RTA_dispatcher;_IDL_cpuLoad = IDL_cpuLoad;_LOG_system = LOG_system;_IDL_busyObj = IDL_busyObj;/* MODULE GBL */SECTIONS {   .vers (COPY): {} /* version information */}-priority-llnkrtdx.a62-ldrivers.a67          /* device drivers support */-lsioboth.a62          /* supports both SIO models */-lbiosi.a62            /* DSP/BIOS support */-lrtdx.lib             /* RTDX support */-lcsl6713.lib-lrts6700.lib          /* C and C++ run-time library support */_GBL_CACHE = GBL_CACHE;/* MODULE MEM */-stack 0x400MEMORY {   IRAM        : origin = 0x0,         len = 0x30000   CACHE_L2    : origin = 0x30000,     len = 0x10000   SDRAM       : origin = 0x80000000,  len = 0x800000}/* MODULE CLK */SECTIONS {   .clk: {        _CLK_start = _CLK_start6x; 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