?? at91sam7se512_sdrc.html
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<meta charset="iso-8859-1" content="Arm / ATMEL/ AT91 library / AT91SAM7SE512" http-equiv="Content-Type">
<title>Hardware API Selector: AT91SAM7SE512 Definitions</title>
</head>
<h1>SDRAM Controller Interface Peripheral</h1>
<null><a name="SDRC"></a><b>SDRC</b> <i><font size="-1">(<a href="AT91SAM7SE512_h.html#AT91S_SDRC">AT91S_SDRC</a>)</font></i><b> 0xFFFFFFB0 </b><i><font size="-1">(<a href="AT91SAM7SE512_h.html#AT91C_BASE_SDRC">AT91C_BASE_SDRC</a>)</font></i>
<br></null><a name="SDRC"></a><h2>SDRC Software API <i><font size="-1">(<a href="AT91SAM7SE512_h.html#AT91S_SDRC">AT91S_SDRC</a>)</font></i></h2>
<a name="SDRC"></a><null><table border=1 cellpadding=0 cellspacing=0 width="100%"><null><th bgcolor="#FFFFCC"><font size="-1"><b>Offset</b></font></th><th bgcolor="#FFFFCC"><font size="-1"><b>Field</b></font></th><th bgcolor="#FFFFCC"><font size="-1"><b>Description</b></font></th>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x0</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_MR">SDRC_MR</a></font></td><td><font size="-1">SDRAM Controller Mode Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x4</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_TR">SDRC_TR</a></font></td><td><font size="-1">SDRAM Controller Refresh Timer Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x8</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_CR">SDRC_CR</a></font></td><td><font size="-1">SDRAM Controller Configuration Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0xC</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_SRR">SDRC_SRR</a></font></td><td><font size="-1">SDRAM Controller Self Refresh Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x10</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_LPR">SDRC_LPR</a></font></td><td><font size="-1">SDRAM Controller Low Power Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x14</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_IER">SDRC_IER</a></font></td><td><font size="-1">SDRAM Controller Interrupt Enable Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x18</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_IDR">SDRC_IDR</a></font></td><td><font size="-1">SDRAM Controller Interrupt Disable Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x1C</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_IMR">SDRC_IMR</a></font></td><td><font size="-1">SDRAM Controller Interrupt Mask Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x20</b></font></td><td><font size="-1"><a href="AT91SAM7SE512_SDRC.html#SDRC_ISR">SDRC_ISR</a></font></td><td><font size="-1">SDRAM Controller Interrupt Mask Register</font></td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC"><font size="-1"><b>0x24</b></font></td><td><font size="-1">SDRC_VER (<a href="AT91SAM7SE512_SDRC.html#IPB_VER">IPB_VER</a>)</font></td><td><font size="-1">SDRAM Controller Version Register</font></td></tr>
</null></table><br></null><h2>SDRC Register Description</h2>
<null><a name="SDRC_MR"></a><h4><a href="#SDRC">SDRC</a>: <i><a href="AT91SAM7SE512_h.html#AT91_REG">AT91_REG</a></i> SDRC_MR <i>SDRAM Controller Mode Register</i></h4><ul><null><font size="-2"><li><b>SDRC</b> <i><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MR">AT91C_SDRC_MR</a></i> 0xFFFFFFB0</font></null></ul><table border=1 cellpadding=0 cellspacing=0 width="100%"><null><th bgcolor="#FFFFCC"><b>Offset</b></th><th bgcolor="#FFFFCC"><b>Name</b></th><th bgcolor="#FFFFCC"><b>Description</b></th><tr><td align="CENTER" bgcolor="#FFFFCC">3..0</td><td align="CENTER"><a name="SDRC_MODE"></a><b>SDRC_MODE</b><font size="-2"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MODE">AT91C_SDRC_MODE</a></font></td><td><b>Mode</b><br>0: Normal Mode.<br>1: Issue a NOP Command at every access.<br>2: Issue a All Banks Precharge Command at every access.<br><br> 3: Issue a Load Mode Register at every access.<br>4: Issue a Refresh<font size="-1"><table bgcolor="#E3F2FF" border=1 cellpadding=0 cellspacing=0 width="100%"><null><th><b>Value</b></th><th><b>Label</b></th><th><b>Description</b></th><tr><td align="CENTER">0</td><td align="CENTER"><a name="SDRC_MODE_NORMAL_CMD"></a><b>SDRC_MODE_NORMAL_CMD</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MODE_NORMAL_CMD">AT91C_SDRC_MODE_NORMAL_CMD</a></font></td><td><br>Normal Mode</td></tr>
<tr><td align="CENTER">1</td><td align="CENTER"><a name="SDRC_MODE_NOP_CMD"></a><b>SDRC_MODE_NOP_CMD</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MODE_NOP_CMD">AT91C_SDRC_MODE_NOP_CMD</a></font></td><td><br>NOP Command</td></tr>
<tr><td align="CENTER">2</td><td align="CENTER"><a name="SDRC_MODE_PRCGALL_CMD"></a><b>SDRC_MODE_PRCGALL_CMD</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MODE_PRCGALL_CMD">AT91C_SDRC_MODE_PRCGALL_CMD</a></font></td><td><br>All Banks Precharge Command</td></tr>
<tr><td align="CENTER">3</td><td align="CENTER"><a name="SDRC_MODE_LMR_CMD"></a><b>SDRC_MODE_LMR_CMD</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MODE_LMR_CMD">AT91C_SDRC_MODE_LMR_CMD</a></font></td><td><br>Load Mode Register Command</td></tr>
<tr><td align="CENTER">4</td><td align="CENTER"><a name="SDRC_MODE_RFSH_CMD"></a><b>SDRC_MODE_RFSH_CMD</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_MODE_RFSH_CMD">AT91C_SDRC_MODE_RFSH_CMD</a></font></td><td><br>Refresh Command</td></tr>
</null></table></font>
</td></tr>
<tr><td align="CENTER" bgcolor="#FFFFCC">4</td><td align="CENTER"><a name="SDRC_DBW"></a><b>SDRC_DBW</b><font size="-2"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_DBW">AT91C_SDRC_DBW</a></font></td><td><b>Data Bus Width</b><br>0: 32 bits.<br>1: 16bits.<font size="-1"><table bgcolor="#E3F2FF" border=1 cellpadding=0 cellspacing=0 width="100%"><null><th><b>Value</b></th><th><b>Label</b></th><th><b>Description</b></th><tr><td align="CENTER">0</td><td align="CENTER"><a name="SDRC_DBW_32_BITS"></a><b>SDRC_DBW_32_BITS</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_DBW_32_BITS">AT91C_SDRC_DBW_32_BITS</a></font></td><td><br>32 Bits datas bus</td></tr>
<tr><td align="CENTER">1</td><td align="CENTER"><a name="SDRC_DBW_16_BITS"></a><b>SDRC_DBW_16_BITS</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_DBW_16_BITS">AT91C_SDRC_DBW_16_BITS</a></font></td><td><br>16 Bits datas bus</td></tr>
</null></table></font>
</td></tr>
</null></table>
<a name="SDRC_TR"></a><h4><a href="#SDRC">SDRC</a>: <i><a href="AT91SAM7SE512_h.html#AT91_REG">AT91_REG</a></i> SDRC_TR <i>SDRAM Controller Refresh Timer Register</i></h4><ul><null><font size="-2"><li><b>SDRC</b> <i><a href="AT91SAM7SE512_h.html#AT91C_SDRC_TR">AT91C_SDRC_TR</a></i> 0xFFFFFFB4</font></null></ul><table border=1 cellpadding=0 cellspacing=0 width="100%"><null><th bgcolor="#FFFFCC"><b>Offset</b></th><th bgcolor="#FFFFCC"><b>Name</b></th><th bgcolor="#FFFFCC"><b>Description</b></th><tr><td align="CENTER" bgcolor="#FFFFCC">11..0</td><td align="CENTER"><a name="SDRC_COUNT"></a><b>SDRC_COUNT</b><font size="-2"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_COUNT">AT91C_SDRC_COUNT</a></font></td><td><b>Refresh Counter</b></td></tr>
</null></table>
<a name="SDRC_CR"></a><h4><a href="#SDRC">SDRC</a>: <i><a href="AT91SAM7SE512_h.html#AT91_REG">AT91_REG</a></i> SDRC_CR <i>SDRAM Controller Configuration Register</i></h4><ul><null><font size="-2"><li><b>SDRC</b> <i><a href="AT91SAM7SE512_h.html#AT91C_SDRC_CR">AT91C_SDRC_CR</a></i> 0xFFFFFFB8</font></null></ul><table border=1 cellpadding=0 cellspacing=0 width="100%"><null><th bgcolor="#FFFFCC"><b>Offset</b></th><th bgcolor="#FFFFCC"><b>Name</b></th><th bgcolor="#FFFFCC"><b>Description</b></th><tr><td align="CENTER" bgcolor="#FFFFCC">1..0</td><td align="CENTER"><a name="SDRC_NC"></a><b>SDRC_NC</b><font size="-2"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_NC">AT91C_SDRC_NC</a></font></td><td><b>Number of Column Bits</b><br>0: 8.<br>1: 9.<br>3: 10.<br>3: 11.<font size="-1"><table bgcolor="#E3F2FF" border=1 cellpadding=0 cellspacing=0 width="100%"><null><th><b>Value</b></th><th><b>Label</b></th><th><b>Description</b></th><tr><td align="CENTER">0</td><td align="CENTER"><a name="SDRC_NC_8"></a><b>SDRC_NC_8</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_NC_8">AT91C_SDRC_NC_8</a></font></td><td><br>8 Bits</td></tr>
<tr><td align="CENTER">1</td><td align="CENTER"><a name="SDRC_NC_9"></a><b>SDRC_NC_9</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_NC_9">AT91C_SDRC_NC_9</a></font></td><td><br>9 Bits</td></tr>
<tr><td align="CENTER">2</td><td align="CENTER"><a name="SDRC_NC_10"></a><b>SDRC_NC_10</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_NC_10">AT91C_SDRC_NC_10</a></font></td><td><br>10 Bits</td></tr>
<tr><td align="CENTER">3</td><td align="CENTER"><a name="SDRC_NC_11"></a><b>SDRC_NC_11</b><font size="-1"><br><a href="AT91SAM7SE512_h.html#AT91C_SDRC_NC_11">AT91C_SDRC_NC_11</a></font></td><td><br>11 Bits</td></tr>
</null></table></font>
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