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?? ledwater.flow.rpt

?? FPGA下的DDS程序的編寫,VHDL語言,
?? RPT
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Flow report for ledwater
Tue Aug 28 20:40:56 2007
Quartus II Version 7.0 Build 33 02/05/2007 SJ Full Version


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; Table of Contents ;
---------------------
  1. Legal Notice
  2. Flow Summary
  3. Flow Settings
  4. Flow Non-Default Global Settings
  5. Flow Elapsed Time
  6. Flow Log



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; Legal Notice ;
----------------
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+-------------------------------------------------------------------+
; Flow Summary                                                      ;
+-------------------------+-----------------------------------------+
; Flow Status             ; Successful - Tue Aug 28 20:40:56 2007   ;
; Quartus II Version      ; 7.0 Build 33 02/05/2007 SJ Full Version ;
; Revision Name           ; ledwater                                ;
; Top-level Entity Name   ; ledwater                                ;
; Family                  ; Cyclone                                 ;
; Device                  ; EP1C3T144C8                             ;
; Timing Models           ; Final                                   ;
; Met timing requirements ; Yes                                     ;
; Total logic elements    ; 114 / 2,910 ( 4 % )                     ;
; Total pins              ; 14 / 104 ( 13 % )                       ;
; Total virtual pins      ; 0                                       ;
; Total memory bits       ; 0 / 59,904 ( 0 % )                      ;
; Total PLLs              ; 1 / 1 ( 100 % )                         ;
+-------------------------+-----------------------------------------+


+-----------------------------------------+
; Flow Settings                           ;
+-------------------+---------------------+
; Option            ; Setting             ;
+-------------------+---------------------+
; Start date & time ; 08/28/2007 20:39:58 ;
; Main task         ; Compilation         ;
; Revision Name     ; ledwater            ;
+-------------------+---------------------+


+------------------------------------------------------------------------------+
; Flow Non-Default Global Settings                                             ;
+------------------------+----------+---------------+-------------+------------+
; Assignment Name        ; Value    ; Default Value ; Entity Name ; Section Id ;
+------------------------+----------+---------------+-------------+------------+
; ENABLE_SIGNALTAP       ; On       ; --            ; --          ; --         ;
; PARTITION_NETLIST_TYPE ; SOURCE   ; --            ; --          ; Top        ;
; USE_SIGNALTAP_FILE     ; stp1.stp ; --            ; --          ; --         ;
+------------------------+----------+---------------+-------------+------------+


+----------------------------------------+
; Flow Elapsed Time                      ;
+-------------------------+--------------+
; Module Name             ; Elapsed Time ;
+-------------------------+--------------+
; Analysis & Synthesis    ; 00:00:14     ;
; Partition Merge         ; 00:00:01     ;
; Fitter                  ; 00:00:13     ;
; Assembler               ; 00:00:11     ;
; Classic Timing Analyzer ; 00:00:01     ;
; Total                   ; 00:00:40     ;
+-------------------------+--------------+


------------
; Flow Log ;
------------
quartus_map --read_settings_files=on --write_settings_files=off ledwater -c ledwater
quartus_cdb --read_settings_files=off --write_settings_files=off ledwater -c ledwater --merge=on
quartus_fit --read_settings_files=off --write_settings_files=off ledwater -c ledwater
quartus_asm --read_settings_files=off --write_settings_files=off ledwater -c ledwater
quartus_tan --read_settings_files=off --write_settings_files=off ledwater -c ledwater --timing_analysis_only



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