亚洲欧美第一页_禁久久精品乱码_粉嫩av一区二区三区免费野_久草精品视频

? 歡迎來(lái)到蟲(chóng)蟲(chóng)下載站! | ?? 資源下載 ?? 資源專(zhuān)輯 ?? 關(guān)于我們
? 蟲(chóng)蟲(chóng)下載站

?? bono_memory_map_defines.h

?? 飛思卡爾imx27 wince5.0 bootloader源代碼
?? H
?? 第 1 頁(yè) / 共 5 頁(yè)
字號(hào):
#define GPIOC_ICONFB2            (GPIOC_BASE_ADDR+0x18)     // 32bit gpio ptc input config B2 reg#define GPIOC_DR                 (GPIOC_BASE_ADDR+0x1C)     // 32bit gpio ptc data reg#define GPIOC_GIUS               (GPIOC_BASE_ADDR+0x20)     // 32bit gpio ptc in use reg#define GPIOC_SSR                (GPIOC_BASE_ADDR+0x24)     // 32bit gpio ptc sample status reg#define GPIOC_ICR1               (GPIOC_BASE_ADDR+0x28)     // 32bit gpio ptc interrupt ctrl 1 reg#define GPIOC_ICR2               (GPIOC_BASE_ADDR+0x2C)     // 32bit gpio ptc interrupt ctrl 2 reg#define GPIOC_IMR                (GPIOC_BASE_ADDR+0x30)     // 32bit gpio ptc interrupt mask reg#define GPIOC_ISR                (GPIOC_BASE_ADDR+0x34)     // 32bit gpio ptc interrupt status reg#define GPIOC_GPR                (GPIOC_BASE_ADDR+0x38)     // 32bit gpio ptc general purpose reg#define GPIOC_SWR                (GPIOC_BASE_ADDR+0x3C)     // 32bit gpio ptc software reset reg#define GPIOC_PUEN               (GPIOC_BASE_ADDR+0x40)     // 32bit gpio ptc pull up enable reg#define GPIOD_BASE_ADDR          0x10015300#define GPIOD_DDIR               (GPIOD_BASE_ADDR+0x00)     // 32bit gpio ptd data direction reg#define GPIOD_OCR1               (GPIOD_BASE_ADDR+0x04)     // 32bit gpio ptd output config 1 reg#define GPIOD_OCR2               (GPIOD_BASE_ADDR+0x08)     // 32bit gpio ptd output config 2 reg#define GPIOD_ICONFA1            (GPIOD_BASE_ADDR+0x0C)     // 32bit gpio ptd input config A1 reg#define GPIOD_ICONFA2            (GPIOD_BASE_ADDR+0x10)     // 32bit gpio ptd input config A2 reg#define GPIOD_ICONFB1            (GPIOD_BASE_ADDR+0x14)     // 32bit gpio ptd input config B1 reg#define GPIOD_ICONFB2            (GPIOD_BASE_ADDR+0x18)     // 32bit gpio ptd input config B2 reg#define GPIOD_DR                 (GPIOD_BASE_ADDR+0x1C)     // 32bit gpio ptd data reg#define GPIOD_GIUS               (GPIOD_BASE_ADDR+0x20)     // 32bit gpio ptd in use reg#define GPIOD_SSR                (GPIOD_BASE_ADDR+0x24)     // 32bit gpio ptd sample status reg#define GPIOD_ICR1               (GPIOD_BASE_ADDR+0x28)     // 32bit gpio ptd interrupt ctrl 1 reg#define GPIOD_ICR2               (GPIOD_BASE_ADDR+0x2C)     // 32bit gpio ptd interrupt ctrl 2 reg#define GPIOD_IMR                (GPIOD_BASE_ADDR+0x30)     // 32bit gpio ptd interrupt mask reg#define GPIOD_ISR                (GPIOD_BASE_ADDR+0x34)     // 32bit gpio ptd interrupt status reg#define GPIOD_GPR                (GPIOD_BASE_ADDR+0x38)     // 32bit gpio ptd general purpose reg#define GPIOD_SWR                (GPIOD_BASE_ADDR+0x3C)     // 32bit gpio ptd software reset reg#define GPIOD_PUEN               (GPIOD_BASE_ADDR+0x40)     // 32bit gpio ptd pull up enable reg#define GPIOE_BASE_ADDR          0x10015400#define GPIOE_DDIR               (GPIOE_BASE_ADDR+0x00)     // 32bit gpio pte data direction reg#define GPIOE_OCR1               (GPIOE_BASE_ADDR+0x04)     // 32bit gpio pte output config 1 reg#define GPIOE_OCR2               (GPIOE_BASE_ADDR+0x08)     // 32bit gpio pte output config 2 reg#define GPIOE_ICONFA1            (GPIOE_BASE_ADDR+0x0C)     // 32bit gpio pte input config A1 reg#define GPIOE_ICONFA2            (GPIOE_BASE_ADDR+0x10)     // 32bit gpio pte input config A2 reg#define GPIOE_ICONFB1            (GPIOE_BASE_ADDR+0x14)     // 32bit gpio pte input config B1 reg#define GPIOE_ICONFB2            (GPIOE_BASE_ADDR+0x18)     // 32bit gpio pte input config B2 reg#define GPIOE_DR                 (GPIOE_BASE_ADDR+0x1C)     // 32bit gpio pte data reg#define GPIOE_GIUS               (GPIOE_BASE_ADDR+0x20)     // 32bit gpio pte in use reg#define GPIOE_SSR                (GPIOE_BASE_ADDR+0x24)     // 32bit gpio pte sample status reg#define GPIOE_ICR1               (GPIOE_BASE_ADDR+0x28)     // 32bit gpio pte interrupt ctrl 1 reg#define GPIOE_ICR2               (GPIOE_BASE_ADDR+0x2C)     // 32bit gpio pte interrupt ctrl 2 reg#define GPIOE_IMR                (GPIOE_BASE_ADDR+0x30)     // 32bit gpio pte interrupt mask reg#define GPIOE_ISR                (GPIOE_BASE_ADDR+0x34)     // 32bit gpio pte interrupt status reg#define GPIOE_GPR                (GPIOE_BASE_ADDR+0x38)     // 32bit gpio pte general purpose reg#define GPIOE_SWR                (GPIOE_BASE_ADDR+0x3C)     // 32bit gpio pte software reset reg#define GPIOE_PUEN               (GPIOE_BASE_ADDR+0x40)     // 32bit gpio pte pull up enable reg#define GPIOF_BASE_ADDR          0x10015500#define GPIOF_DDIR               (GPIOF_BASE_ADDR+0x00)     // 32bit gpio ptf data direction reg#define GPIOF_OCR1               (GPIOF_BASE_ADDR+0x04)     // 32bit gpio ptf output config 1 reg#define GPIOF_OCR2               (GPIOF_BASE_ADDR+0x08)     // 32bit gpio ptf output config 2 reg#define GPIOF_ICONFA1            (GPIOF_BASE_ADDR+0x0C)     // 32bit gpio ptf input config A1 reg#define GPIOF_ICONFA2            (GPIOF_BASE_ADDR+0x10)     // 32bit gpio ptf input config A2 reg#define GPIOF_ICONFB1            (GPIOF_BASE_ADDR+0x14)     // 32bit gpio ptf input config B1 reg#define GPIOF_ICONFB2            (GPIOF_BASE_ADDR+0x18)     // 32bit gpio ptf input config B2 reg#define GPIOF_DR                 (GPIOF_BASE_ADDR+0x1C)     // 32bit gpio ptf data reg#define GPIOF_GIUS               (GPIOF_BASE_ADDR+0x20)     // 32bit gpio ptf in use reg#define GPIOF_SSR                (GPIOF_BASE_ADDR+0x24)     // 32bit gpio ptf sample status reg#define GPIOF_ICR1               (GPIOF_BASE_ADDR+0x28)     // 32bit gpio ptf interrupt ctrl 1 reg#define GPIOF_ICR2               (GPIOF_BASE_ADDR+0x2C)     // 32bit gpio ptf interrupt ctrl 2 reg#define GPIOF_IMR                (GPIOF_BASE_ADDR+0x30)     // 32bit gpio ptf interrupt mask reg#define GPIOF_ISR                (GPIOF_BASE_ADDR+0x34)     // 32bit gpio ptf interrupt status reg#define GPIOF_GPR                (GPIOF_BASE_ADDR+0x38)     // 32bit gpio ptf general purpose reg#define GPIOF_SWR                (GPIOF_BASE_ADDR+0x3C)     // 32bit gpio ptf software reset reg#define GPIOF_PUEN               (GPIOF_BASE_ADDR+0x40)     // 32bit gpio ptf pull up enable reg#define GPIO_REG_BASE            0x10015600#define GPIO_PMASK               (GPIO_REG_BASE+0x00)       // 32bit gpio interrupt mask reg// #########################################// # AUDMUX                                #// # $1001_6000 to $1001_6FFF              #// ##########################################define AUDMUX_BASE_ADDR         0x10016000#define AUDMUX_HPCR1             (AUDMUX_BASE_ADDR+0x00)    // 32bit audmux host config reg 1#define AUDMUX_HPCR2             (AUDMUX_BASE_ADDR+0x04)    // 32bit audmux host config reg 2#define AUDMUX_HPCR3             (AUDMUX_BASE_ADDR+0x08)    // 32bit audmux host config reg 3#define AUDMUX_PPCR1             (AUDMUX_BASE_ADDR+0x10)    // 32bit audmux pripheral config 1#define AUDMUX_PPCR2             (AUDMUX_BASE_ADDR+0x14)    // 32bit audmux pripheral config 2#define AUDMUX_PPCR3             (AUDMUX_BASE_ADDR+0x1C)    // 32bit audmux pripheral config 3// #########################################// # CSPI3                                 #// # $1001_7000 to $1001_7FFF              #// ##########################################define CSPI3_BASE_ADDR          0x10017000#define CSPI3_RXDATAREG1         (CSPI3_BASE_ADDR+0x00)     // 32bit cspi3 receive data reg#define CSPI3_TXDATAREG1         (CSPI3_BASE_ADDR+0x04)     // 32bit cspi3 transmit data reg#define CSPI3_CONTROLREG1        (CSPI3_BASE_ADDR+0x08)     // 32bit cspi3 control reg#define CSPI3_INTREG1            (CSPI3_BASE_ADDR+0x0C)     // 32bit cspi3 interrupt stat/ctr reg#define CSPI3_TESTREG1           (CSPI3_BASE_ADDR+0x10)     // 32bit cspi3 test reg#define CSPI3_PERIODREG1         (CSPI3_BASE_ADDR+0x14)     // 32bit cspi3 sample period ctrl reg#define CSPI3_DMAREG1            (CSPI3_BASE_ADDR+0x18)     // 32bit cspi3 dma ctrl reg#define CSPI3_RESETREG1          (CSPI3_BASE_ADDR+0x1C)     // 32bit cspi3 soft reset reg// #########################################// # MSHC                                  #// # $1001_8000 to $1001_8FFF              #// ##########################################define MSHC_BASE_ADDR           0x10018000#define MSHC_COMMAND_REG         (MSHC_BASE_ADDR+0x00)      // 64bit mshc command reg#define MSHC_DATA_REG            (MSHC_BASE_ADDR+0x08)      // 64bit mshc data reg#define MSHC_STATUS_REG          (MSHC_BASE_ADDR+0x10)      // 64bit mshc status reg#define MSHC_SYSTEM_REG          (MSHC_BASE_ADDR+0x18)      // 64bit mshc system reg// #########################################// # GPT4                                  #// # $1001_9000 to $1001_9FFF              #// ##########################################define GPT4_BASE_ADDR           0x10019000#define GPT4_TCTL4               (GPT4_BASE_ADDR+0x00)      // 32bit timer 4 control reg#define GPT4_TPRER4              (GPT4_BASE_ADDR+0x04)      // 32bit timer 4 prescaler reg#define GPT4_TCMP4               (GPT4_BASE_ADDR+0x08)      // 32bit timer 4 compare reg#define GPT4_TCR4                (GPT4_BASE_ADDR+0x0C)      // 32bit timer 4 capture reg#define GPT4_TCN4                (GPT4_BASE_ADDR+0x10)      // 32bit timer 4 counter reg#define GPT4_TSTAT4              (GPT4_BASE_ADDR+0x14)      // 32bit timer 4 status reg// #########################################// # GPT5                                  #// # $1001_A000 to $1001_AFFF              #// ##########################################define GPT5_BASE_ADDR           0x1001A000#define GPT5_TCTL5               (GPT5_BASE_ADDR+0x00)      // 32bit timer 5 control reg#define GPT5_TPRER5              (GPT5_BASE_ADDR+0x04)      // 32bit timer 5 prescaler reg#define GPT5_TCMP5               (GPT5_BASE_ADDR+0x08)      // 32bit timer 5 compare reg#define GPT5_TCR5                (GPT5_BASE_ADDR+0x0C)      // 32bit timer 5 capture reg#define GPT5_TCN5                (GPT5_BASE_ADDR+0x10)      // 32bit timer 5 counter reg#define GPT5_TSTAT5              (GPT5_BASE_ADDR+0x14)      // 32bit timer 5 status reg// #########################################// # UART5                                 #// # $1001_B000 to $1001_BFFF              #// ##########################################define UART5_BASE_ADDR          0x1001B000#define UART5_URXD_5             (UART5_BASE_ADDR+0x00)     // 32bit uart5 receiver reg#define UART5_UTXD_5             (UART5_BASE_ADDR+0x40)     // 32bit uart5 transmitter reg#define UART5_UCR1_5             (UART5_BASE_ADDR+0x80)     // 32bit uart5 control 1 reg#define UART5_UCR2_5             (UART5_BASE_ADDR+0x84)     // 32bit uart5 control 2 reg#define UART5_UCR3_5             (UART5_BASE_ADDR+0x88)     // 32bit uart5 control 3 reg#define UART5_UCR4_5             (UART5_BASE_ADDR+0x8C)     // 32bit uart5 control 4 reg#define UART5_UFCR_5             (UART5_BASE_ADDR+0x90)     // 32bit uart5 fifo control reg#define UART5_USR1_5             (UART5_BASE_ADDR+0x94)     // 32bit uart5 status 1 reg#define UART5_USR2_5             (UART5_BASE_ADDR+0x98)     // 32bit uart5 status 2 reg#define UART5_UESC_5             (UART5_BASE_ADDR+0x9C)     // 32bit uart5 escape char reg#define UART5_UTIM_5             (UART5_BASE_ADDR+0xA0)     // 32bit uart5 escape timer reg#define UART5_UBIR_5             (UART5_BASE_ADDR+0xA4)     // 32bit uart5 BRM incremental reg#define UART5_UBMR_5             (UART5_BASE_ADDR+0xA8)     // 32bit uart5 BRM modulator reg#define UART5_UBRC_5             (UART5_BASE_ADDR+0xAC)     // 32bit uart5 baud rate count reg#define UART5_ONEMS_5            (UART5_BASE_ADDR+0xB0)     // 32bit uart5 one ms reg#define UART5_UTS_5              (UART5_BASE_ADDR+0xB4)     // 32bit uart5 test reg// #########################################// # UART6                                 #// # $1001_C000 to $1001_CFFF              #// ##########################################define UART6_BASE_ADDR          0x1001C000#define UART6_URXD_6             (UART6_BASE_ADDR+0x00)     // 32bit uart6 receiver reg#define UART6_UTXD_6             (UART6_BASE_ADDR+0x40)     // 32bit uart6 transmitter reg#define UART6_UCR1_6             (UART6_BASE_ADDR+0x80)     // 32bit uart6 control 1 reg#define UART6_UCR2_6             (UART6_BASE_ADDR+0x84)     // 32bit uart6 control 2 reg#define UART6_UCR3_6             (UART6_BASE_ADDR+0x88)     // 32bit uart6 control 3 reg#define UART6_UCR4_6             (UART6_BASE_ADDR+0x8C)     // 32bit uart6 control 4 reg#define UART6_UFCR_6             (UART6_BASE_ADDR+0x90)     // 32bit uart6 fifo control reg#define UART6_USR1_6             (UART6_BASE_ADDR+0x94)     // 32bit uart6 status 1 reg#define UART6_USR2_6             (UART6_BASE_ADDR+0x98)     // 32bit uart6 status 2 reg#define UART6_UESC_6             (UART6_BASE_ADDR+0x9C)     // 32bit uart6 escape char reg#define UART6_UTIM_6             (UART6_BASE_ADDR+0xA0)     // 32bit uart6 escape timer reg#define UART6_UBIR_6             (UART6_BASE_ADDR+0xA4)     // 32bit uart6 BRM incremental reg#define UART6_UBMR_6             (UART6_BASE_ADDR+0xA8)     // 32bit uart6 BRM modulator reg#define UART6_UBRC_6             (UART6_BASE_ADDR+0xAC)     // 32bit uart6 baud rate count reg#define UART6_ONEMS_6            (UART6_BASE_ADDR+0xB0)     // 32bit uart6 one ms reg#define UART6_UTS_6              (UART6_BASE_ADDR+0xB4)     // 32bit uart6 test reg// #########################################// # I2C2                                  #// # $1001_D000 to $1001_DFFF              #// ##########################################define I2C2_BASE_ADDR           0x1001D000#define I2C2_IADR                (I2C2_BASE_ADDR+0x00)      // 16bit i2c address reg#define I2C2_IFDR                (I2C2_BASE_ADDR+0x04)      // 16bit i2c frequency divider reg#define I2C2_I2CR                (I2C2_BASE_ADDR+0x08)      // 16bit i2c control reg#define I2C2_I2SR                (I2C2_BASE_ADDR+0x0C)      // 16bit i2c

?? 快捷鍵說(shuō)明

復(fù)制代碼 Ctrl + C
搜索代碼 Ctrl + F
全屏模式 F11
切換主題 Ctrl + Shift + D
顯示快捷鍵 ?
增大字號(hào) Ctrl + =
減小字號(hào) Ctrl + -
亚洲欧美第一页_禁久久精品乱码_粉嫩av一区二区三区免费野_久草精品视频
欧美丝袜丝nylons| 欧美熟乱第一页| 国产性天天综合网| 激情六月婷婷久久| 欧美三级视频在线| 久久毛片高清国产| 性感美女极品91精品| 99精品欧美一区二区三区小说| 精品国产伦一区二区三区观看方式| 亚洲欧洲另类国产综合| 国产福利不卡视频| 精品福利一区二区三区| 亚洲色图在线播放| 激情欧美日韩一区二区| 欧美日韩电影在线| 天天综合日日夜夜精品| 9191成人精品久久| 日韩黄色免费电影| 欧美成人一级视频| 韩国视频一区二区| 国产精品丝袜久久久久久app| 精品亚洲porn| 国产性色一区二区| 99这里只有久久精品视频| 一区二区中文字幕在线| 在线视频综合导航| 亚洲成人三级小说| 日韩精品一区二区三区中文精品| 精油按摩中文字幕久久| 久久综合五月天婷婷伊人| 成人高清视频在线| 日韩精品1区2区3区| 欧美二区三区的天堂| 亚洲高清一区二区三区| 91精品国产一区二区三区| 久久精品国产在热久久| 欧美激情一区不卡| 一本一道久久a久久精品综合蜜臀| 亚洲自拍偷拍九九九| 欧美在线free| 美腿丝袜亚洲综合| 国产精品久久久久国产精品日日| 懂色av一区二区三区蜜臀| 青青草97国产精品免费观看| 在线日韩国产精品| 久久99精品一区二区三区三区| 日韩av网站在线观看| 精品日产卡一卡二卡麻豆| 粉嫩久久99精品久久久久久夜| 亚洲成av人片一区二区| 国产午夜精品一区二区三区视频 | 国产激情91久久精品导航| 亚洲一二三四在线| 国产日韩欧美激情| 欧美精品日韩精品| 成人免费va视频| 亚洲电影在线免费观看| 国产精品久久久久久户外露出| 日韩一卡二卡三卡国产欧美| 色噜噜狠狠成人网p站| 国产精品1区2区3区| 日本麻豆一区二区三区视频| 一区二区三区在线免费观看| 国产欧美日韩另类一区| 26uuu国产一区二区三区| 欧美性大战xxxxx久久久| www.在线欧美| 成人免费高清在线观看| 国产1区2区3区精品美女| 精品在线视频一区| 久久精品72免费观看| 综合av第一页| 国产精品拍天天在线| 久久久www成人免费无遮挡大片| 日韩视频一区二区在线观看| 4hu四虎永久在线影院成人| 在线影院国内精品| 91成人免费电影| 在线精品视频一区二区三四| 91视频观看免费| av在线不卡免费看| 国产精品综合av一区二区国产馆| 美女网站色91| 美国十次综合导航| 青青草国产精品亚洲专区无| 亚洲成av人片一区二区三区| 一区二区三区四区不卡在线 | 在线精品视频一区二区三四| 色视频一区二区| 91九色02白丝porn| 日韩一区二区免费在线电影| 日韩西西人体444www| 久久久久久影视| 国产亚洲欧美日韩在线一区| 国产精品久久久爽爽爽麻豆色哟哟| 亚洲欧美日韩在线不卡| 日一区二区三区| 高清在线成人网| 精品视频在线免费观看| 2023国产精华国产精品| 一区二区三区中文字幕精品精品 | 中文字幕视频一区| 日韩精品每日更新| 免费精品视频在线| 国产99一区视频免费| 色综合网色综合| 欧美mv日韩mv亚洲| 亚洲一区二区黄色| 99精品国产视频| 国产亚洲一区二区三区在线观看 | 日本成人中文字幕在线视频| 成人精品免费网站| 国产三级精品视频| 美女脱光内衣内裤视频久久影院| 成人久久18免费网站麻豆| 日韩欧美一区中文| 亚洲三级免费观看| 性感美女极品91精品| 成人一区在线观看| 精品国产3级a| 丝袜国产日韩另类美女| 国产精品资源在线| 日韩三级视频中文字幕| 亚洲欧美一区二区不卡| 国产精品亚洲一区二区三区妖精| 一本大道久久a久久精二百| 国产精品全国免费观看高清| 日韩精品视频网站| 欧美日韩国产一级| 亚洲国产日日夜夜| 欧美在线999| 亚洲一区免费视频| 成人av免费网站| 亚洲欧洲99久久| av中文字幕不卡| 亚洲色欲色欲www| 91女厕偷拍女厕偷拍高清| 亚洲视频免费观看| 欧美日韩一卡二卡| 热久久一区二区| 国产亚洲综合色| 日本韩国欧美一区| 亚洲第一二三四区| 日韩欧美一区中文| www.在线欧美| 日韩精彩视频在线观看| 久久久久9999亚洲精品| 不卡高清视频专区| 亚洲超丰满肉感bbw| 久久综合久色欧美综合狠狠| 成人免费视频免费观看| 亚洲国产精品嫩草影院| 欧美videos大乳护士334| 捆绑变态av一区二区三区| 国产色91在线| 欧美吻胸吃奶大尺度电影| 毛片一区二区三区| 亚洲欧洲国产专区| 欧美人与z0zoxxxx视频| 国产麻豆精品theporn| 亚洲欧洲精品一区二区精品久久久 | 亚洲视频免费在线| 精品国产乱码久久| 日本高清不卡视频| 国产精品911| 奇米影视7777精品一区二区| 中文字幕一区二区三区不卡在线 | 久久视频一区二区| 色综合久久中文字幕综合网| 视频一区二区不卡| 日本一区二区三区国色天香| 91麻豆精品国产91久久久| 91蜜桃视频在线| 成人18视频日本| 国产很黄免费观看久久| 麻豆精品一区二区综合av| 亚洲成人午夜影院| 亚洲激情网站免费观看| 国产无一区二区| 亚洲精品一区二区三区影院| 欧美色图激情小说| 欧美在线视频日韩| 欧美一级欧美三级在线观看| 国产mv日韩mv欧美| 美女看a上一区| 日韩av电影天堂| 亚洲va韩国va欧美va| 亚洲图片欧美视频| 亚洲一区二区三区激情| 亚洲线精品一区二区三区八戒| 1区2区3区精品视频| 亚洲婷婷在线视频| 亚洲精品视频免费观看| 一区av在线播放| 午夜视频在线观看一区二区| 亚洲va欧美va国产va天堂影院| 亚洲国产欧美一区二区三区丁香婷| 亚洲午夜久久久| 日本午夜精品一区二区三区电影 | 成人av在线观|