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 XLXI_3_XLXI_219_I_36_31 : AND4    port map (      I0 => XLXI_3_XLXN_12,      I1 => XLXI_3_XLXN_11,      I2 => XLXI_3_XLXN_10,      I3 => XLXI_3_XLXN_51,      O => XLXI_3_XLXN_4    );  XLXI_3_XLXI_219_I_Q3_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_219_I_Q3_N1    );  XLXI_3_XLXI_219_I_Q3_XST_GND : GND    port map (      G => XLXI_3_XLXI_219_I_Q3_N0    );  XLXI_3_XLXI_219_I_Q3_I_36_32 : XOR2    port map (      I0 => XLXI_3_XLXI_219_T3,      I1 => XLXI_3_XLXN_12,      O => XLXI_3_XLXI_219_I_Q3_TQ    );  XLXI_3_XLXI_219_I_Q3_I_36_35 : FDCE    generic map(      INIT => '0'    )    port map (      C => XLXI_3_CLK,      CE => XLXI_3_XLXN_478,      CLR => XLXI_3_XLXN_260,      D => XLXI_3_XLXI_219_I_Q3_TQ,      Q => XLXI_3_XLXN_12    );  XLXI_3_XLXI_219_I_Q2_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_219_I_Q2_N1    );  XLXI_3_XLXI_219_I_Q2_XST_GND : GND    port map (      G => XLXI_3_XLXI_219_I_Q2_N0    );  XLXI_3_XLXI_219_I_Q2_I_36_32 : XOR2    port map (      I0 => XLXI_3_XLXI_219_T2,      I1 => XLXI_3_XLXN_11,      O => XLXI_3_XLXI_219_I_Q2_TQ    );  XLXI_3_XLXI_219_I_Q2_I_36_35 : FDCE    generic map(      INIT => '0'    )    port map (      C => XLXI_3_CLK,      CE => XLXI_3_XLXN_478,      CLR => XLXI_3_XLXN_260,      D => XLXI_3_XLXI_219_I_Q2_TQ,      Q => XLXI_3_XLXN_11    );  XLXI_3_XLXI_219_I_Q1_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_219_I_Q1_N1    );  XLXI_3_XLXI_219_I_Q1_XST_GND : GND    port map (      G => XLXI_3_XLXI_219_I_Q1_N0    );  XLXI_3_XLXI_219_I_Q1_I_36_32 : XOR2    port map (      I0 => XLXI_3_XLXN_51,      I1 => XLXI_3_XLXN_10,      O => XLXI_3_XLXI_219_I_Q1_TQ    );  XLXI_3_XLXI_219_I_Q1_I_36_35 : FDCE    generic map(      INIT => '0'    )    port map (      C => XLXI_3_CLK,      CE => XLXI_3_XLXN_478,      CLR => XLXI_3_XLXN_260,      D => XLXI_3_XLXI_219_I_Q1_TQ,      Q => XLXI_3_XLXN_10    );  XLXI_3_XLXI_219_I_Q0_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_219_I_Q0_N1    );  XLXI_3_XLXI_219_I_Q0_XST_GND : GND    port map (      G => XLXI_3_XLXI_219_I_Q0_N0    );  XLXI_3_XLXI_219_I_Q0_I_36_32 : XOR2    port map (      I0 => XLXI_3_XLXI_219_XLXN_1,      I1 => XLXI_3_XLXN_51,      O => XLXI_3_XLXI_219_I_Q0_TQ    );  XLXI_3_XLXI_219_I_Q0_I_36_35 : FDCE    generic map(      INIT => '0'    )    port map (      C => XLXI_3_CLK,      CE => XLXI_3_XLXN_478,      CLR => XLXI_3_XLXN_260,      D => XLXI_3_XLXI_219_I_Q0_TQ,      Q => XLXI_3_XLXN_51    );  XLXI_3_XLXI_224_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_224_N0    );  XLXI_3_XLXI_224_I_36_144 : FMAP    port map (      I1 => XLXI_3_XLXI_224_S0,      I2 => XLXI_3_XLXI_224_S1,      I3 => XLXI_3_XLXI_224_dummy,      I4 => XLXI_3_XLXI_224_dummy,      O => XLXI_3_XLXN_466    );  XLXI_3_XLXI_224_I_36_140 : NOR2    port map (      I0 => XLXI_3_XLXI_224_S0,      I1 => XLXI_3_XLXI_224_S1,      O => XLXI_3_XLXN_466    );  XLXI_3_XLXI_224_I_36_138 : FMAP    port map (      I1 => XLXI_3_XLXN_12,      I2 => XLXI_3_XLXN_11,      I3 => XLXI_3_XLXN_10,      I4 => XLXI_3_XLXN_51,      O => XLXI_3_XLXI_224_S1    );  XLXI_3_XLXI_224_I_36_127 : OR4    port map (      I0 => XLXI_3_XLXN_12,      I1 => XLXI_3_XLXN_11,      I2 => XLXI_3_XLXN_10,      I3 => XLXI_3_XLXN_51,      O => XLXI_3_XLXI_224_S1    ); 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 XLXI_3_XLXI_56_I_36_93 : OR3    port map (      I0 => XLXI_3_XLXN_11,      I1 => XLXI_3_XLXN_10,      I2 => XLXI_3_XLXN_51,      O => XLXI_3_XLXI_56_I35    );  XLXI_3_XLXI_56_XST_GND : GND    port map (      G => XLXI_3_XLXI_56_dummy    );  XLXI_3_XLXI_57_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_57_N0    );  XLXI_3_XLXI_57_I_36_107 : FMAP    port map (      I1 => XLXI_3_XLXN_12,      I2 => XLXI_3_XLXN_48,      I3 => XLXI_3_XLXN_39,      I4 => XLXI_3_XLXI_57_dummy,      O => XLXI_3_XLXI_57_I35    );  XLXI_3_XLXI_57_I_36_106 : FMAP    port map (      I1 => XLXI_3_XLXN_51,      I2 => XLXI_3_XLXN_10,      I3 => XLXI_3_XLXN_11,      I4 => XLXI_3_XLXI_57_I35,      O => XLXI_3_XLXN_142    );  XLXI_3_XLXI_57_I_36_100 : NOR4    port map (      I0 => XLXI_3_XLXN_51,      I1 => XLXI_3_XLXN_10,      I2 => XLXI_3_XLXN_11,      I3 => XLXI_3_XLXI_57_I35,      O => XLXI_3_XLXN_142    );  XLXI_3_XLXI_57_I_36_93 : OR3    port map (      I0 => XLXI_3_XLXN_12,      I1 => XLXI_3_XLXN_48,      I2 => XLXI_3_XLXN_39,      O => XLXI_3_XLXI_57_I35    );  XLXI_3_XLXI_57_XST_GND : GND    port map (      G => XLXI_3_XLXI_57_dummy    );  XLXI_3_XLXI_94_XST_VCC : VCC    port map (      P => XLXI_3_XLXI_94_N0    );  XLXI_3_XLXI_94_I_36_107 : FMAP    port map (      I1 => XLXI_3_XLXN_150,      I2 => XLXI_3_XLXN_147,      I3 => XLXI_3_XLXN_22,      I4 => XLXI_3_XLXI_94_dummy,      O => XLXI_3_XLXI_94_I35    );  XLXI_3_XLXI_94_I_36_106 : FMAP    port map (      I1 => XLXI_3_XLXN_154,      I2 => XLXI_3_XLXN_152,      I3 => XLXI_3_XLXN_151,      I4 => XLXI_3_XLXI_94_I35,      O => XLXI_3_XLXN_224    );  XLXI_3_XLXI_94_I_36_100 : NOR4    port map (      I0 => XLXI_3_XLXN_154,      I1 => XLXI_3_XLXN_152,      I2 => XLXI_3_XLXN_151,      I3 => XLXI_3_XLXI_94_I35,      O => XLXI_3_XLXN_224    );  XLXI_3_XLXI_94_I_36_93 : OR3    port map (      I0 => XLXI_3_XLXN_150,      I1 => XLXI_3_XLXN_147,      I2 => XLXI_3_XLXN_22,      O => XLXI_3_XLXI_94_I35    );  XLXI_3_XLXI_94_XST_GND : GND    port map (      G => XLXI_3_XLXI_94_dummy    );end Structure;