?? dds.sim.rpt
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; |DDS|PhaseAcc:inst|PASTEP[6] ; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_5|addcore:adder|a_csnbuffer:result_node|cout[0] ; cout ;
; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_4|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_4|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; data_out0 ;
; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_4|addcore:adder|a_csnbuffer:result_node|cs_buffer[0] ; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_4|addcore:adder|a_csnbuffer:result_node|cout[0] ; cout ;
; |DDS|PhaseAcc:inst|PASTEP[6]~371 ; |DDS|PhaseAcc:inst|PASTEP[6]~371 ; data_out0 ;
; |DDS|PathSel[3] ; |DDS|PathSel[3] ; dataout ;
; |DDS|PathSel[2] ; |DDS|PathSel[2] ; dataout ;
; |DDS|PathSel[0] ; |DDS|PathSel[0] ; dataout ;
; |DDS|PathSel[1] ; |DDS|PathSel[1] ; dataout ;
; |DDS|FreDec ; |DDS|FreDec ; dataout ;
; |DDS|FreInc ; |DDS|FreInc ; dataout ;
; |DDS|toda[7] ; |DDS|toda[7] ; padio ;
; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_4|addcore:adder|a_csnbuffer:result_node|cs_buffer[0]~222 ; |DDS|PhaseAcc:inst|lpm_add_sub:add_rtl_4|addcore:adder|a_csnbuffer:result_node|cs_buffer[0]~222 ; data_out0 ;
+-------------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------------------------+------------------+
The following table displays output ports that do not toggle to 0 during simulation.
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Missing 0-Value Coverage ;
+-------------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+-------------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------------------------+------------------+
; |DDS|PathSel:inst5|lpm_add_sub:add_rtl_2|addcore:adder|unreg_res_node[8] ; |DDS|PathSel:inst5|lpm_add_sub:add_rtl_2|addcore:adder|unreg_res_node[8] ; data_out0 ;
; |DDS|PathSel:inst5|lpm_add_sub:add_rtl_2|addcore:adder|a_csnbuffer:result_node|cs_buffer[7]~86 ; |DDS|PathSel:inst5|lpm_add_sub:add_rtl_2|addcore:adder|a_csnbuffer:result_node|cs_buffer[7]~86 ; data_out0 ;
; |DDS|PathSel:inst5|fangboreg[5] ; |DDS|PathSel:inst5|fangboreg[5] ; data_out0 ;
; |DDS|PathSel:inst5|fangboreg[4] ; |DDS|PathSel:inst5|fangboreg[?? 快捷鍵說明
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