?? io_map.h
字號(hào):
/** ###################################################################
** THIS BEAN MODULE IS GENERATED BY THE TOOL. DO NOT MODIFY IT.
** Filename : IO_Map.H
** Project : vvvf_56F8346
** Processor : 56F8346
** Beantype : IO_Map
** Version : Driver 01.00
** Compiler : Metrowerks DSP C Compiler
** Date/Time : 2008-3-7, 9:38
** Abstract :
** IO_Map.h - implements an IO device's mapping.
** This module contains symbol definitions of all peripheral
** registers and bits.
** Settings :
**
** Contents :
** No public methods
**
** (c) Copyright UNIS, spol. s r.o. 1997-2005
** UNIS, spol. s r.o.
** Jundrovska 33
** 624 00 Brno
** Czech Republic
** http : www.processorexpert.com
** mail : info@processorexpert.com
** ###################################################################*/
#ifndef __IO_Map_H
#define __IO_Map_H
/* Based on CPU DB 56F8346, version 2.87.094 (RegistersPrg V1.097) */
/* DataSheet : MC56F8346/D Rev. 1.0, MC56F8300UM/D - Rev. 1.0 */
#include "PE_Types.h"
/******************************************
*** Peripheral SEMI
*******************************************/
typedef volatile struct {
/*** SEMI_CSBAR_0 - SEMI CS Base Address Register 0; 0x0000F020 ***/
union {
word Word;
} SEMI_CSBAR_0_STR;
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#define SEMI_CSBAR_0_ADR_12_BITNUM 4U
#define SEMI_CSBAR_0 *((volatile word *)0x0000F020)
/*** SEMI_CSBAR_1 - SEMI CS Base Address Register 1; 0x0000F021 ***/
union {
word Word;
} SEMI_CSBAR_1_STR;
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#define SEMI_CSBAR_1_ADR13_MASK 32U
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/*** SEMI_CSBAR_2 - SEMI CS Base Address Register 2; 0x0000F022 ***/
union {
word Word;
} SEMI_CSBAR_2_STR;
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/*** SEMI_CSBAR_3 - SEMI CS Base Address Register 3; 0x0000F023 ***/
union {
word Word;
} SEMI_CSBAR_3_STR;
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#define SEMI_CSBAR_3 *((volatile word *)0x0000F023)
/*** SEMI_CSBAR_4 - SEMI CS Base Address Register 4; 0x0000F024 ***/
union {
word Word;
} SEMI_CSBAR_4_STR;
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/*** SEMI_CSBAR_5 - SEMI CS Base Address Register 5; 0x0000F025 ***/
union {
word Word;
} SEMI_CSBAR_5_STR;
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#define SEMI_CSBAR_5_ADR12_MASK 16U
#define SEMI_CSBAR_5_ADR13_MASK 32U
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#define SEMI_CSBAR_5_ADR15_MASK 128U
#define SEMI_CSBAR_5_ADR16_MASK 256U
#define SEMI_CSBAR_5_ADR17_MASK 512U
#define SEMI_CSBAR_5_ADR18_MASK 1024U
#define SEMI_CSBAR_5_ADR19_MASK 2048U
#define SEMI_CSBAR_5_ADR20_MASK 4096U
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/*** SEMI_CSBAR_6 - SEMI CS Base Address Register 6; 0x0000F026 ***/
union {
word Word;
} SEMI_CSBAR_6_STR;
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/*** SEMI_CSBAR_7 - SEMI CS Base Address Register 7; 0x0000F027 ***/
union {
word Word;
} SEMI_CSBAR_7_STR;
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/*** SEMI_CSOR_0 - SEMI CS Option Register 0; 0x0000F028 ***/
union {
word Word;
} SEMI_CSOR_0_STR;
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#define SEMI_CSOR_0_RWS1_MASK 4096U
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#define SEMI_CSOR_0 *((volatile word *)0x0000F028)
/*** SEMI_CSOR_1 - SEMI CS Option Register 1; 0x0000F029 ***/
union {
word Word;
} SEMI_CSOR_1_STR;
#define SEMI_CSOR_1_WWS0_MASK 1U
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#define SEMI_CSOR_1_WWS3_MASK 8U
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#define SEMI_CSOR_1_PS_DS1_MASK 64U
#define SEMI_CSOR_1_R_W0_MASK 128U
#define SEMI_CSOR_1_R_W1_MASK 256U
#define SEMI_CSOR_1_BYTE_EN0_MASK 512U
#define SEMI_CSOR_1_BYTE_EN1_MASK 1024U
#define SEMI_CSOR_1_RWS0_MASK 2048U
#define SEMI_CSOR_1_RWS1_MASK 4096U
#define SEMI_CSOR_1_RWS2_MASK 8192U
#define SEMI_CSOR_1_RWS3_MASK 16384U
#define SEMI_CSOR_1_RWS4_MASK 32768U
#define SEMI_CSOR_1_WWS_MASK 31U
#define SEMI_CSOR_1_WWS_BITNUM 0U
#define SEMI_CSOR_1_PS_DS_MASK 96U
#define SEMI_CSOR_1_PS_DS_BITNUM 5U
#define SEMI_CSOR_1_R_W_MASK 384U
#define SEMI_CSOR_1_R_W_BITNUM 7U
#define SEMI_CSOR_1_BYTE_EN_MASK 1536U
#define SEMI_CSOR_1_BYTE_EN_BITNUM 9U
#define SEMI_CSOR_1_RWS_MASK 63488U
#define SEMI_CSOR_1_RWS_BITNUM 11U
#define SEMI_CSOR_1 *((volatile word *)0x0000F029)
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