?? gollstt.fit.rpt
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Fitter report for gollstt
Thu Aug 14 22:22:58 2008
Quartus II Version 7.2 Build 151 09/26/2007 SJ Full Version
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; Table of Contents ;
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1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Pin-Out File
5. Fitter Resource Usage Summary
6. Input Pins
7. Output Pins
8. All Package Pins
9. I/O Standard
10. Dedicated Inputs I/O
11. Output Pin Default Load For Reported TCO
12. Fitter Resource Utilization by Entity
13. Control Signals
14. Global & Other Fast Signals
15. Non-Global High Fan-Out Signals
16. Interconnect Usage Summary
17. LAB Macrocells
18. Logic Cell Interconnection
19. Fitter Device Options
20. Fitter Messages
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; Legal Notice ;
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Copyright (C) 1991-2007 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
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without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
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applicable agreement for further details.
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; Fitter Summary ;
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; Fitter Status ; Successful - Thu Aug 14 22:22:58 2008 ;
; Quartus II Version ; 7.2 Build 151 09/26/2007 SJ Full Version ;
; Revision Name ; gollstt ;
; Top-level Entity Name ; gollstt ;
; Family ; MAX3000A ;
; Device ; EPM3032ATC44-4 ;
; Timing Models ; Final ;
; Total macrocells ; 4 / 32 ( 13 % ) ;
; Total pins ; 10 / 34 ( 29 % ) ;
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; Fitter Settings ;
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; Option ; Setting ; Default Value ;
+--------------------------------------------------+----------------+---------------+
; Device ; EPM3032ATC44-4 ; ;
; Fitter Effort ; Standard Fit ; Auto Fit ;
; Use smart compilation ; Off ; Off ;
; Use TimeQuest Timing Analyzer ; Off ; Off ;
; Equivalent RAM and MLAB Paused Read Capabilities ; Care ; Care ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
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; Pin-Out File ;
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The pin-out file can be found in E:/FPGA/FPGA加密/gollstt/gollstt.pin.
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; Fitter Resource Usage Summary ;
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; Resource ; Usage ;
+-----------------------------------+--------------------+
; Logic cells ; 4 / 32 ( 13 % ) ;
; Registers ; 2 / 32 ( 6 % ) ;
; Number of pterms used ; 7 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 10 / 34 ( 29 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; -- Dedicated input pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 2 ;
; Shareable expanders ; 0 / 32 ( 0 % ) ;
; Parallel expanders ; 0 / 30 ( 0 % ) ;
; Cells using turbo bit ; 4 / 32 ( 13 % ) ;
; Maximum fan-out node ; pres_s.state_bit_1 ;
; Maximum fan-out ; 4 ;
; Highest non-global fan-out signal ; pres_s.state_bit_1 ;
; Highest non-global fan-out ; 4 ;
; Total fan-out ; 18 ;
; Average fan-out ; 1.29 ;
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+----------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; I/O Standard ; Location assigned by ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
; clk ; 37 ; -- ; -- ; 2 ; 0 ; yes ; 3.3-V LVTTL ; Fitter ;
; done1 ; 18 ; -- ; 2 ; 2 ; 0 ; no ; 3.3-V LVTTL ; Fitter ;
; done2 ; 15 ; -- ; 1 ; 2 ; 0 ; no ; 3.3-V LVTTL ; Fitter ;
; reset ; 39 ; -- ; -- ; 2 ; 0 ; yes ; 3.3-V LVTTL ; Fitter ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+--------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load ;
+---------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
; cmp_ena ; 43 ; -- ; 1 ; no ; no ; no ; no ; 3.3-V LVTTL ; Fitter ; 10 pF ;
; ena ; 42 ; -- ; 1 ; no ; no ; no ; no ; 3.3-V LVTTL ; Fitter ; 10 pF ;
+---------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 6 ; -- ; TDI ; input ; 3.3-V LVTTL ; ; N ;
; 2 ; 7 ; -- ; RESERVED ; ; ; ; ;
; 3 ; 8 ; -- ; RESERVED ; ; ; ; ;
; 4 ; 9 ; -- ; GND ; gnd ; ; ; ;
; 5 ; 10 ; -- ; RESERVED ; ; ; ; ;
; 6 ; 11 ; -- ; RESERVED ; ; ; ; ;
; 7 ; 12 ; -- ; TMS ; input ; 3.3-V LVTTL ; ; N ;
; 8 ; 13 ; -- ; RESERVED ; ; ; ; ;
; 9 ; 14 ; -- ; VCCIO ; power ; ; 3.3V ; ;
; 10 ; 15 ; -- ; RESERVED ; ; ; ; ;
; 11 ; 16 ; -- ; GND ; gnd ; ; ; ;
; 12 ; 17 ; -- ; RESERVED ; ; ; ; ;
; 13 ; 18 ; -- ; RESERVED ; ; ; ; ;
; 14 ; 19 ; -- ; RESERVED ; ; ; ; ;
; 15 ; 20 ; -- ; done2 ; input ; 3.3-V LVTTL ; ; N ;
; 16 ; 21 ; -- ; GND ; gnd ; ; ; ;
; 17 ; 22 ; -- ; VCCINT ; power ; ; 3.3V ; ;
; 18 ; 23 ; -- ; done1 ; input ; 3.3-V LVTTL ; ; N ;
; 19 ; 24 ; -- ; RESERVED ; ; ; ; ;
; 20 ; 25 ; -- ; RESERVED ; ; ; ; ;
; 21 ; 26 ; -- ; RESERVED ; ; ; ; ;
; 22 ; 27 ; -- ; RESERVED ; ; ; ; ;
; 23 ; 28 ; -- ; RESERVED ; ; ; ; ;
; 24 ; 29 ; -- ; GND ; gnd ; ; ; ;
; 25 ; 30 ; -- ; RESERVED ; ; ; ; ;
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