?? add_4.v
字號:
`timescale 1ns / 1ps
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// Company:
// Engineer:
//
// Create Date: 18:02:53 10/08/2007
// Design Name:
// Module Name: adder_4
// Project Name:
// Target Devices:
// Tool versions:
// Description:
//
// Dependencies:
//
// Revision:
// Revision 0.01 - File Created
// Additional Comments:
//
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module add_4 (x, y, sum, C);
input [3:0] x, y;
output [3:0] sum;
output C;
assign {C, Sum} = x + y;
endmodule
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