/*目的:使一個複數可顯數出來,可做+-/*,還要可以做>>跟<<的功能 題目:定義一個複數的class叫Complex,a(實部)與b(虛部)為double的型態,i表示根號-1, 1.必須包含一個建構子有兩個參數(double型態),能被用來設定物件中的變數為任意值 2.包含一個建構子只有一個參數(double型態),呼叫參數的實部且定義為"實部+0i" 3.包含一個預建構子可把物件初始化為0+0i 4.overload以下的operator以致於可以正確的執行:+ - * / << >> */
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上傳時間: 2013-12-27
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· 第一章:XML快速入門 · 一. 什么是XML? · 二. XML是新概念嗎? · 三. 使用XML有什么好處? · 四. XML很難學嗎? · 五. XML和HTML的區別 · 六. XML的嚴格格式 · 七. 關于XML的更多 · 第二章:XML概念 · 一. 擴展性 · 二. 標識 · 三. 語言 · 四. 結構化 · 五. Meta數據 · 六. 顯示 · 七. DOM · 第三章:XML的術語 · 導言 · 一.XML文檔的有關術語 · 二.DTD的有關術語 · 第四章:XML的語法 · 一.XML語法規則 · 二.元素的語法 · 三.注釋的語法 · 四.CDATA的語法 · 五.Namespaces的語法 · 六.entity的語法 · 七.DTD的語法 · 第五章:XML實例解釋 · 一.定義新標識 · 二.建立XML文檔 · 三.建立相應的HTML文件 · 第六章:XML相關資源
標簽: XML HTML 快速入門
上傳時間: 2014-08-21
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基于Struts+hibernate+spring三種框架多層架構開發的,對于學習這三種架構的集合很適合
標簽: hibernate Struts spring 多層
上傳時間: 2013-12-30
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產生頻率選擇性衰落的雷利通道,參數由天線結構、OFDM系統的結構與功率延時結構來決定。
上傳時間: 2014-12-20
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IF-ELSE條件語句的翻譯程序設計(簡單優先法、輸出三地址表示) 要求完成的主要任務: (包括課程設計工作量及其技術要求,以及說明書撰寫等具體要求) (1) 寫出符合給定的語法分析方法的文法及屬性文法。 (2) 完成題目要求的中間代碼三地址表示的描述。 (3) 寫出給定的語法分析方法的思想,完成語法分析和語義分析程序設計。
標簽: IF-ELSE 翻譯 程序設計 地址
上傳時間: 2016-06-23
上傳用戶:ardager
用51單片機做的簡單頻率計,KEIL C環境,帶工程文件,可直接編譯運行.主要演示如何在內存很少,無法啟用RTOS的單片機(例如2051)中使用狀態機和時間片來完成實時多任務并行處理.例子中對鍵盤,信號采集和LED數碼管的顯示三部分進行了并行處理,而采用的單片機是僅有256字節內存2K ROM的89C2051.
標簽: 2051 KEIL RTOS 51單片機
上傳時間: 2016-07-20
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這是一個控制電機的小項目,功能:通過五個按鍵控制PWM的輸出,同時在四位數碼管的后三位上顯示占空比。
標簽: 控制 電機 項目
上傳時間: 2014-01-09
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開發板測試程序 本程序為實驗板的總體測試程序,用戶可不用測試。 1.8個流水燈先會從上到下流動一遍,同時蜂鳴器發聲。 2.接著DAC電流指示燈由暗變亮 3.接著前三位數碼管顯示溫度 4.接著AD數值顯示在數碼管的前三位 5.接著等待矩陣鍵盤的按下,按下后相應的數碼顯示在數碼管的后三位上,
標簽: 測試程序 開發板 實驗板 程序
上傳時間: 2014-12-08
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:針對三容水箱是較為典型的非線性、時延對象,具有很強的代表性這一特點, 通過機理建模方法建立了三容水箱的一般數學模型。分析了線性和非線性阻力板的流量特性, 并通過實驗測定了阻力板流量系數。最后給出了三容水箱的線性化模型。由仿真實驗可知,非線性模型的階躍響應和實驗測得的響應曲線相吻合,
標簽: 水箱 典型 時延 對象
上傳時間: 2013-12-24
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一個用VHDL編程基于CPLD的EDA實驗板開發可以實現順計時和倒計時的秒表。要求計時的范圍為00.0S~99.9S,用三位數碼管顯示。 (1) 倒計時:通過小鍵盤可以實現設定計時時間(以秒為單位,最大計時時間為99.9秒)。通過鍵盤實現計時開始、計時結束。當所設定的倒計時間到達00.0S后,自動停止倒計時,同時響鈴。 (2) 順計時:初始值為00.0S,通過鍵盤實現開始計時和結束計時功能。計時結束后,顯示記錄的時間。 (3) 用三個發光二極管正確顯示以下狀態:倒計時狀態、順計時狀態、待機狀態。 (4) 每當接收到有效按鍵時,蜂鳴器發出提示聲。 順計時在一次計時中可以記錄三個不同的結束時間,并能通過按鍵顯示三次所記錄的時間。
標簽: VHDL CPLD 00.0 99.9
上傳時間: 2013-12-01
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