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利用IP

  • 基于FPGA的GPIB控制器的IP核設計

    當前,片上系統(SOC)已成為系統實現的主流技術。流片風險與費用增加、上市時間壓力加大、產品功能愈加復雜等因素使得SOC產業逐漸劃分為IP提供者、SOC設計服務者和芯片集成者三個層次。SOC設計已走向基于IP集成的平臺設計階段,經過嚴格驗證質量可靠的IP核成為SOC產業中的重要一環。 GPIB控制器芯片是組建自動測試系統的核心,在測試領域應用廣泛。本人通過查閱大量的技術資料,分析了集成電路在國內外發展的最新動態,提出了基于FPGA的自主知識產權的GPIB控制器IP核的設計和實現。 本文首先討論了基于FPGA的GPIB控制器的背景意義,接著對FPGA開發所具備的基本知識作了簡要介紹。文中對GPIB總線進行了簡單的描述,根據芯片設計的主要思想,重點在于論述怎樣用FPGA來實現IEEE-488.2協議,并詳細闡述了GPIB控制器的十種接口功能及其狀態機的IP核實現。同時,對數據通路也進行了較為細致的說明。在設計的時候采用基于模塊化設計思想,用VerilogHDL語言完成各模塊功能描述,通過Synplifv軟件的綜合,用Modelsim對設計進行了前、后仿真。最后利用生成的模塊符號采取類似畫電路圖的方法完成整個系統芯片的lP軟核設計,并用EDA工具下載到了FPGA上。 為了更好地驗證設計思想,借助EDA工具對GPIB控制器的工作狀態進行了軟件仿真,給出仿真結果,仿真波形驗證了GPIB控制器的工作符合預想。最后,本文對基于FPGA的GPIB控制器的IP核設計過程進行了總結,展望了當前GPIB控制器設計的發展趨勢,指出了開展進一步研究需要做的工作。

    標簽: FPGA GPIB 控制器 IP核

    上傳時間: 2013-04-24

    上傳用戶:rockjablew

  • IP核實現與單片機和ARM的串口通信(FPGA的51)

    利用FPGA的51 ,IP核實現與單片機和ARM的串口通信

    標簽: FPGA ARM 51 IP核

    上傳時間: 2013-08-05

    上傳用戶:lalaruby

  • 利用FPGA實現DDS經過編譯沒有錯誤。編譯環境為QuartusII7.2

    利用FPGA實現DDS經過編譯沒有錯誤。編譯環境為QuartusII7.2,該環境集成了IP核,可以提高開發效率。

    標簽: QuartusII FPGA DDS 7.2

    上傳時間: 2013-08-10

    上傳用戶:zhuyibin

  • 基于EDA技術的單片機IP核設計

    本文介紹了利用EDA技術設計出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經過驗證獲得了滿意的效果。

    標簽: EDA 單片機 IP核

    上傳時間: 2013-10-28

    上傳用戶:標點符號

  • 基于EDA技術的單片機IP核設計

    本文介紹了利用EDA技術設計出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經過驗證獲得了滿意的效果。

    標簽: EDA 單片機 IP核

    上傳時間: 2013-11-14

    上傳用戶:qq1604324866

  • 使用LabVIEW FPGA模塊設計IP核

    對于利用LabVIEW FPGA實現RIO目標平臺上的定制硬件的工程師與開發人員,他們可以很容易地利用所推薦的組件設計構建適合其應用的、可復用且可擴展的代碼模塊?;谝呀涷炞C的設計進行代碼模塊開發,將使現有IP在未來應用中得到更好的復用,也可以使在不同開發人員和內部組織之間進行共享和交換的代碼更好服用

    標簽: LabVIEW FPGA IP核 模塊設計

    上傳時間: 2013-11-20

    上傳用戶:lnnn30

  • 基于Quartus II免費IP核的雙端口RAM設計實例

      QuartusII中利用免費IP核的設計   作者:雷達室   以設計雙端口RAM為例說明。   Step1:打開QuartusII,選擇File—New Project Wizard,創建新工程,出現圖示對話框,點擊Next;

    標簽: Quartus RAM IP核 雙端口

    上傳時間: 2014-12-28

    上傳用戶:fghygef

  • 基于FPGA的DDS IP核設計方案

    以Altera公司的Quartus Ⅱ 7.2作為開發工具,研究了基于FPGA的DDS IP核設計,并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件,結合32位嵌入式CPU軟核Nios II,構成可編程片上系統(SOPC),利用極少的硬件資源實現了可重構信號源。該系統基本功能都在FPGA芯片內完成,利用 SOPC技術,在一片 FPGA 芯片上實現了整個信號源的硬件開發平臺,達到既簡化電路設計、又提高系統穩定性和可靠性的目的。

    標簽: FPGA DDS IP核 設計方案

    上傳時間: 2013-11-06

    上傳用戶:songkun

  • VS1003 網絡IP電話方案

    隨著多媒體時代的深入,各種令人眼花繚亂的視頻顯示技術迅猛發展,與此同時,層出不窮的新興應用也對產品音頻性能提出了更高的要求,比如用電腦直接撥打IP電話、進行視頻會議、儀器操作語音控制等場合都需要高質量的語音效果。在市場推動下,不僅傳統模擬與混合信號器件供應商繼續深耕不懈,一些新進入該領域的公司也推出多種創新性方案應對市場需求。本文提出了利用ARM7微控制器,uC/OS-II實時操作系統和DSP處理內核的音頻處理芯片的音頻處理方案。該方案能有效改善音質,提供清晰、自然的語音。 音頻方面LPC2214+VS1003

    標簽: 1003 VS IP電話 網絡

    上傳時間: 2013-10-14

    上傳用戶:1318695663

  • 通信IP網BFD應用的研究

    通信IP網作為實時業務傳輸載體,要求能夠對相鄰系統之間通信故障進行快速檢測,在出現故障時可以快速切換到備份鏈路,以保證實時數據不間斷傳輸。在研究BFD協議原理的基礎上,根據通信IP網運行中出現的問題,應用BFD雙向快速檢測功能,實現了VRRP的Master/Backup狀態毫秒級切換,并利用BFD會話檢測靜態路由所在鏈路的狀態,實現一跳和多跳的靜態路由自動切換,提高了通信IP網的可靠性。

    標簽: BFD 通信IP網

    上傳時間: 2013-11-09

    上傳用戶:wivai

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