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如何利用

MPEG-2傳送流特殊信息處理的FPGA實(shí)現(xiàn)研究

　　本文介紹了如何利用FPGA(FieldProgrammableGateArray)技術(shù)來實(shí)現(xiàn)傳送流特殊信息的處理，其主要內(nèi)容如下：1.介紹了MPEG-2傳送流系統(tǒng)層的語法規(guī)范；2.描述了傳送流特殊信息之間的結(jié)構(gòu)關(guān)系；3.簡要介紹了傳送流復(fù)用的原理和實(shí)現(xiàn)方法；4.詳細(xì)討論了如何用FPGA技術(shù)來實(shí)現(xiàn)對特殊信息的處理；整個(gè)項(xiàng)目的設(shè)計(jì)采用VHDL作為程序設(shè)計(jì)語言，都是以Xilinx的FPGA芯片及其ISE5.2i作為開發(fā)系統(tǒng)進(jìn)行的。

標(biāo)簽： MPEG FPGA 傳送信息處理

上傳時(shí)間： 2013-06-11

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基于ARM系統(tǒng)的表面粗糙度測量儀的設(shè)計(jì).pdf

表面粗糙度是機(jī)械加工中描述工件表面微觀形狀重要的參數(shù)。在機(jī)械零件切削的過程中，刀具或砂輪遺留的刀痕，切屑分離時(shí)的塑性變形和機(jī)床振動等因素，會使零件的表面形成微小的蜂谷。這些微小峰谷的高低程度和間距狀況就叫做表面粗糙度，也稱為微觀不平度。表面粗糙度的測量是幾何測量中的一個(gè)重要部分，它對于現(xiàn)代制造業(yè)的發(fā)展起了重要的推動作用。世界各國競相進(jìn)行粗糙度測量儀的研制，隨著科學(xué)技術(shù)的發(fā)展，各種各樣的粗糙度測量系統(tǒng)也競相問世。對于粗糙度的測量，隨著技術(shù)的更新，國家標(biāo)準(zhǔn)也一直在變更。最新執(zhí)行的國家標(biāo)準(zhǔn)(GB/T6062-2002)，規(guī)定了粗糙度測量的參數(shù)，以及制定了觸針式測量粗糙度的儀器標(biāo)準(zhǔn)[1]。隨著新國家標(biāo)準(zhǔn)的執(zhí)行，許多陳舊的粗糙度測量儀已經(jīng)無法符合新標(biāo)準(zhǔn)的要求。而且生產(chǎn)工藝的提高使得原有方案的采集精度和采集速度，滿足不了現(xiàn)代測量技術(shù)的需要。目前，各高校公差實(shí)驗(yàn)室及大多數(shù)企業(yè)的計(jì)量部門所使用的計(jì)量儀器(如光切顯微鏡、表面粗糙度檢查儀等)只能測量單項(xiàng)參數(shù)，而能進(jìn)行多參數(shù)測量的光電儀器價(jià)格較貴，一般實(shí)驗(yàn)室和計(jì)量室難以購置。因此如何利用現(xiàn)有的技術(shù)，結(jié)含現(xiàn)代測控技術(shù)的發(fā)展，職制出性能可靠的粗糙度測量儀，能有效地降低實(shí)驗(yàn)室測量儀器的成本，具有很好的實(shí)用價(jià)值和研究意義。基于上述現(xiàn)狀，本文在參考舊的觸針式表面粗糙度測量儀技術(shù)方案的基礎(chǔ)上，提出了一種基于ARM嵌入式系統(tǒng)的粗糙度測量儀的設(shè)計(jì)。這種測量儀采用了先進(jìn)的傳感器技術(shù)，保證了測量的范圍和精度；采用了集成的信號調(diào)理電路，降低了信號在調(diào)制、檢波、和放大的過程中的失真；采用了ARM處理器，快速的采集和控制測量儀系統(tǒng)；采用了強(qiáng)大的PC機(jī)人機(jī)交互功能，快速的計(jì)算粗糙度的相關(guān)參數(shù)和直觀的顯示粗糙度的特性曲線。論文主要做了如下工作：首先，論文分析了觸針式粗糙度測量儀的發(fā)展以及現(xiàn)狀；然后，詳細(xì)敘述了系統(tǒng)的硬件構(gòu)成和設(shè)計(jì)，包括傳感器的原理和結(jié)構(gòu)分析、信號調(diào)理電路的設(shè)計(jì)、A/D轉(zhuǎn)換電路的設(shè)計(jì)、微處理器系統(tǒng)電路以及與上位機(jī)接口電路的設(shè)計(jì)。同時(shí)，還對系統(tǒng)的數(shù)據(jù)采集進(jìn)行了研究，開發(fā)了相應(yīng)的固件程序及接口程序，完成數(shù)據(jù)采集軟件的編寫，并且對表面粗糙度參數(shù)的算法進(jìn)行程序的實(shí)現(xiàn)。編寫了控制應(yīng)用程序，完成控制界面的設(shè)計(jì)。最終設(shè)計(jì)出一套多功能、多參數(shù)、高性能、高可靠、操作方便的表面粗糙度測量系統(tǒng)。

標(biāo)簽： ARM 測量

上傳時(shí)間： 2013-04-24

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基于ARMWindowsCE的嵌入式數(shù)控系統(tǒng)的研究

當(dāng)今嵌入式技術(shù)的發(fā)展突飛猛進(jìn)，嵌入式系統(tǒng)在很多產(chǎn)業(yè)中得到廣泛應(yīng)用并逐步改變著這些產(chǎn)業(yè)。嵌入式技術(shù)的發(fā)展同樣也影響到了數(shù)控技術(shù)的發(fā)展。論文綜述了當(dāng)前開放式數(shù)控系統(tǒng)國內(nèi)外發(fā)展現(xiàn)狀，并分析了幾種主流開放式數(shù)控系統(tǒng)體系結(jié)構(gòu)的優(yōu)缺點(diǎn)，進(jìn)而提出了利用ARM處理器和Windows CE操作系統(tǒng)開發(fā)一個(gè)基于ARM-WinCE嵌入式數(shù)控系統(tǒng)的原型系統(tǒng)的想法。論文論述了如何構(gòu)建ARM-WinCE數(shù)控系統(tǒng)基于S3C2410開發(fā)板的硬件平Z口-x和基于Windows CE．Net的軟件平臺；在ARM微處理器上構(gòu)建了基于Windows CE的數(shù)控操作系統(tǒng)內(nèi)核，并利用VIVI Boot Loader把定制的映像加載到S3C2410開發(fā)板中去。本文重點(diǎn)針對ARM處理器芯片，利用流接口驅(qū)動程序結(jié)構(gòu)實(shí)現(xiàn)了藍(lán)牙串口驅(qū)動程序的開發(fā)，實(shí)現(xiàn)了ARM-WinCE數(shù)控系統(tǒng)中機(jī)床控制器和移動控制器的藍(lán)牙通信；研究了如何利用S3C2410處理器的PWM定時(shí)器和Windows CE的中斷機(jī)制進(jìn)行數(shù)控系統(tǒng)的實(shí)時(shí)控制。

標(biāo)簽： ARMWindowsCE 嵌入式數(shù)控系統(tǒng)

上傳時(shí)間： 2013-04-24

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基于ARM的LCD顯示驅(qū)動的設(shè)計(jì)與實(shí)現(xiàn)

在當(dāng)前的數(shù)字信息技術(shù)和網(wǎng)絡(luò)技術(shù)高速發(fā)展的后PC時(shí)代，嵌入式系統(tǒng)技術(shù)已經(jīng)廣泛地滲透到人們生活的各個(gè)方面。由于嵌入式系統(tǒng)的交互性比較強(qiáng)，液晶屏做為輸出設(shè)備對漢字顯示又尤為重要，但很多關(guān)于嵌入式系統(tǒng)開發(fā)、應(yīng)用的教材中，對于液晶屏的程序設(shè)計(jì)也只是初始化和測試的編程，沒有進(jìn)一步的應(yīng)用開發(fā)。所以選擇了該畢業(yè)設(shè)計(jì)題目，以完善液晶屏的漢字顯示功能。在選定了畢業(yè)設(shè)計(jì)題目之后，隨著開發(fā)研究的不斷深入，主要完成了以下工作：首先，對三種常用的嵌入式操作系統(tǒng)進(jìn)行了分析比較，對項(xiàng)目開發(fā)是否選用操作系統(tǒng)提出了自己的見解，結(jié)合本次畢業(yè)設(shè)計(jì)的實(shí)際應(yīng)用，選擇了不使用操作系統(tǒng)而是利用Bootloader引導(dǎo)的方法。其次，選定硬件開發(fā)系統(tǒng)后，把單片機(jī)的傳統(tǒng)調(diào)試方法與ARM的邊界掃描技術(shù)進(jìn)行了分析比較，并在實(shí)際應(yīng)用開發(fā)中采用了邊界掃描技術(shù)。再次，由于在C語言程序運(yùn)行前需要加入一些必要的初始化代碼，于是又完成了對44binit.s初始化程序的分析與設(shè)計(jì)。最后，在編寫漢字顯示程序時(shí)，采用了讀取字庫法顯示漢字方案和讀取字模數(shù)據(jù)輸出漢字方案分別實(shí)現(xiàn)了液晶屏的漢字顯示，并取得了良好的效果。本文不但說明了如何利用ARM處理器實(shí)現(xiàn)液晶屏的漢字顯示，還講述了開發(fā)ARM處理器應(yīng)用程序的一個(gè)完整的過程。隨著嵌入式技術(shù)的不斷普及，對ARM處理器的學(xué)習(xí)、應(yīng)用、開發(fā)都有一定的幫助作用。

標(biāo)簽： ARM LCD 顯示驅(qū)動

上傳時(shí)間： 2013-04-24

上傳用戶：cuiqiang
基于FPGA的數(shù)字調(diào)頻發(fā)射機(jī)技術(shù)研究

遙測系統(tǒng)由發(fā)射機(jī)、發(fā)射天線、接收天線、接收機(jī)組成.就遙測發(fā)射系統(tǒng)而言,傳統(tǒng)的模擬調(diào)制已經(jīng)很成熟,模擬發(fā)射機(jī)是利用調(diào)制信號的變化來控制變?nèi)荻O管的結(jié)電容容值的變化,從而改變壓控振蕩器的震蕩頻率來實(shí)現(xiàn)調(diào)頻;模擬調(diào)制碼速率、調(diào)制頻偏都受變?nèi)荻O管特性的限制,模擬調(diào)制功能單一、調(diào)制方式不可重組、單個(gè)系統(tǒng)調(diào)制頻率不可改變,無法滿足頻率多變的需求;隨著高速器件和軟件無線電技術(shù)的發(fā)展,數(shù)字調(diào)制發(fā)射機(jī)具有調(diào)制中心頻率可調(diào)、頻偏可編程、調(diào)制方式可重組、調(diào)制碼速率高、可實(shí)現(xiàn)較高的頻響、可以與編碼器合并擴(kuò)展功能很強(qiáng)等優(yōu)點(diǎn),成為今后發(fā)射機(jī)的發(fā)展主流.本論文討論了如何利用現(xiàn)場可編程器件FPGA結(jié)合Max+plusⅡ及VHDL語言,在遙測系統(tǒng)中實(shí)現(xiàn)了DDS+PLL+SSB模式的數(shù)字調(diào)制發(fā)射機(jī).數(shù)字發(fā)射機(jī)設(shè)計(jì)主要包括方案選擇、系統(tǒng)設(shè)計(jì)、硬件電路實(shí)現(xiàn)及VHDL設(shè)計(jì)四個(gè)部分.論文中首先分析了目前遙測系統(tǒng)中使用的模擬調(diào)制發(fā)射機(jī)的不足及數(shù)字調(diào)制發(fā)射機(jī)的優(yōu)點(diǎn),確定了發(fā)射機(jī)的設(shè)計(jì)方案;第二章介紹了電子設(shè)計(jì)自動化工具及數(shù)字電路設(shè)計(jì)方法;第三章詳細(xì)討論了組成發(fā)射機(jī)的各個(gè)部分的原理設(shè)計(jì);第四章著重討論了各個(gè)部分的硬件電路實(shí)現(xiàn)、VHDL實(shí)現(xiàn)部分及設(shè)計(jì)的測試結(jié)果;最后總結(jié)了設(shè)計(jì)中需要進(jìn)一步研究的問題.

標(biāo)簽： FPGA 數(shù)字調(diào)頻發(fā)射機(jī) 技術(shù)研究

上傳時(shí)間： 2013-04-24

上傳用戶：程嬰sky
基于ARM與FPGA的機(jī)械手自動控制系統(tǒng)的研究

機(jī)械手是自動裝配生產(chǎn)線上必不可少的設(shè)備，它可以模擬人手臂的部分動作，按預(yù)定的程序、軌跡和要求，實(shí)現(xiàn)抓取、搬運(yùn)和裝配等工作。在減輕人的勞動強(qiáng)度、提高裝配質(zhì)量和提高裝配效率等方面，起到了積極的作用。本文基于ARM和FPGA嵌入式系統(tǒng)，開展了機(jī)械手控制系統(tǒng)的研發(fā)工作，實(shí)現(xiàn)了機(jī)械手的自動控制。嵌入式ARM處理器，具有運(yùn)行速度快、功耗低、程序設(shè)計(jì)靈活、外圍硬件資源豐富等優(yōu)點(diǎn)，但其普通輸入輸出口的高低電平變化周期最快只能到1微妙左右，不適合高速輸入輸出；FPGA芯片高速輸入輸出數(shù)據(jù)，時(shí)間可縮短至幾十納秒。通過ARM處理器和FPGA技術(shù)的有機(jī)結(jié)合，發(fā)揮各自的優(yōu)勢，使系統(tǒng)具有程序設(shè)計(jì)靈活、以太網(wǎng)通信、大容量存儲、高速數(shù)據(jù)輸山、低成本等特點(diǎn)，滿足高速機(jī)械手自動控制的要求。本文分析了ARM和FPGA系統(tǒng)，以及機(jī)械手控制系統(tǒng)的功能要求；設(shè)計(jì)硬件模塊、接口電路；闡述了系統(tǒng)軟件的設(shè)計(jì)過程，包括啟動代碼U—BOOT、操作系統(tǒng)μCLinux的移植；并介紹了如何利用便件描述語言VHDL來實(shí)現(xiàn)機(jī)械手邏輯控制。

標(biāo)簽： FPGA ARM 機(jī)械手自動控制系統(tǒng)

上傳時(shí)間： 2013-04-24

上傳用戶：luyanping
基于ARM嵌入式系統(tǒng)的GUI的開發(fā)與設(shè)計(jì)

嵌入式系統(tǒng)的開發(fā)已成為新的行業(yè)熱點(diǎn)，將嵌入式應(yīng)用于工業(yè)控制類產(chǎn)品中，并開發(fā)出優(yōu)秀的人機(jī)交互界面，是嵌入式發(fā)展的趨勢，擁有廣闊的市場前景。近年來的市場需求顯示越來越多的嵌入式系統(tǒng)包括PDA、機(jī)頂盒、DVD/VCD播放機(jī)、WAP手機(jī)等均要求提供一個(gè)方便簡潔的可視化操作界面，而這些都要求有一個(gè)高性能穩(wěn)定可靠的GUI(GraphicalUser Interface)來提供支持。友好的圖形人機(jī)界面為嵌入式系統(tǒng)的人機(jī)交互提供豐富的圖形圖像信息、直觀的表達(dá)方式。嵌入式GUI作為人機(jī)界面的軟件系統(tǒng)，具有簡潔、美觀、方便好用且更具人性化的特點(diǎn)，采用嵌入式GUI進(jìn)行人機(jī)界面設(shè)計(jì)能夠提高設(shè)備開發(fā)效率、節(jié)省維護(hù)成本、豐富人機(jī)交互信息，因而，已經(jīng)被越來越多的領(lǐng)域所采用。本文研究設(shè)計(jì)了一種基于ARM微處理器和嵌入式實(shí)時(shí)操作系統(tǒng)的嵌入式GUI應(yīng)用平臺的方案。以SmartARM2200開發(fā)板為硬件平臺(基于PHILIP公司的微處理LPC2210)，在ADS1.2集成開發(fā)環(huán)境下，首先對嵌入式實(shí)時(shí)操作系統(tǒng)μ/OS-Ⅱ的特點(diǎn)、移植條件、性能等方面進(jìn)行應(yīng)用研究，重點(diǎn)分析了μ/OS-Ⅱ的移植過程，給出了移植的思路，總結(jié)了移植過程中應(yīng)注意的問題，提出了簡潔高效的移植方法；其次詳細(xì)講述了如何利用圖形用戶界面開發(fā)工具M(jìn)iniGUI進(jìn)行圖形用戶界面的開發(fā)，包括鼠標(biāo)、鍵盤、菜單、繪圖等功能的實(shí)現(xiàn)。該嵌入式GUI應(yīng)用平臺既可以滿足用戶對應(yīng)用系統(tǒng)實(shí)時(shí)性和快速處理的要求，又能夠給用戶提供生動、直觀的圖形人機(jī)交互界面，具有廣泛的應(yīng)用前景。

標(biāo)簽： ARM GUI 嵌入式系統(tǒng)

上傳時(shí)間： 2013-07-06

上傳用戶：zlf19911217
隨機(jī)讀寫I2C串行總線接口電路設(shè)計(jì)

I2C(Inter Integrated Circuits)是Philips公司開發(fā)的用于芯片之間連接的串行總線，以其嚴(yán)格的規(guī)范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應(yīng)用并受到普遍的歡迎。現(xiàn)場可編程門陣列(FPGA)設(shè)計(jì)靈活、速度快，在數(shù)字專用集成電路的設(shè)計(jì)中得到了廣泛的應(yīng)用。本論文主要討論了如何利用Verilog/FPGA來實(shí)現(xiàn)一個(gè)隨機(jī)讀/寫的I2C接口電路，實(shí)現(xiàn)與外圍I2C接口器件E2PROM進(jìn)行數(shù)據(jù)通信，實(shí)現(xiàn)讀、寫等功能，傳輸速率實(shí)現(xiàn)為100KBps。在Modelsim6.0仿真軟件環(huán)境中進(jìn)行仿真，在Xilinx公司的ISE9.li開發(fā)平臺上進(jìn)行了下載，搭建外圍電路，用Agilem邏輯分析儀進(jìn)行數(shù)據(jù)采集，分析測試結(jié)果。首先，介紹了微電子設(shè)計(jì)的發(fā)展概況以及設(shè)計(jì)流程，重點(diǎn)介紹了HDL/FPGA的設(shè)計(jì)流程。其次，對I2C串行總線進(jìn)行了介紹，重點(diǎn)說明了總線上的數(shù)據(jù)傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀／寫時(shí)序作了介紹。第三，基于Verilog _HDL設(shè)計(jì)了隨機(jī)讀/寫的I2C接口電路、測試模塊和顯示電路；接口電路由同步有限狀態(tài)機(jī)(FSM)來實(shí)現(xiàn)；測試模塊首先將數(shù)據(jù)寫入到AT24C02的指定地址，接著將寫入的數(shù)據(jù)讀出，并將兩個(gè)數(shù)據(jù)顯示在外圍LED數(shù)碼管和發(fā)光二極管上，從而直觀地比較寫入和輸出的數(shù)據(jù)的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四，用Agilent邏輯分析儀進(jìn)行傳輸數(shù)據(jù)的采集，分析數(shù)據(jù)傳輸?shù)臅r(shí)序，從而驗(yàn)證電路設(shè)計(jì)的正確性。最后，論文對所取得的研究成果進(jìn)行了總結(jié)，并展望了下一步的工作。

標(biāo)簽： I2C 隨機(jī) 讀寫串行總線接口

上傳時(shí)間： 2013-06-08

上傳用戶：再見大盤雞
基于FPGA的DDS信號源的設(shè)計(jì)

頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域，目前，常用的頻率合成技術(shù)有直接頻率合成、鎖相頻率合成和直接數(shù)字頻率合成(DDS)等。其中DDS是一種新的頻率合成方法，是頻率合成的一次革命。全數(shù)字化的DDS技術(shù)由于具有頻率分辨率高、頻率切換速度快、相位噪聲低和頻率穩(wěn)定度高等優(yōu)點(diǎn)而成為現(xiàn)代頻率合成技術(shù)中的佼佼者。隨著數(shù)字集成電路、微電子技術(shù)和EDA技術(shù)的深入研究，DDS技術(shù)得到了飛速的發(fā)展。 DDS是把一系列數(shù)字量化形式的信號通過D/A轉(zhuǎn)換形成模擬量形式的信號的合成技術(shù)。主要是利用高速存儲器作查尋表，然后通過高速D/A轉(zhuǎn)換產(chǎn)生已經(jīng)用數(shù)字形式存入的正弦波(或其它任意波形)。一個(gè)典型的DDS系統(tǒng)應(yīng)包括以下三個(gè)部分：相位累加器可以時(shí)鐘的控制下完成相位的累加；相位一幅度碼轉(zhuǎn)換電路一般由ROM實(shí)現(xiàn)；D/A轉(zhuǎn)換電路，將數(shù)字形式的幅度碼轉(zhuǎn)換成模擬信號。現(xiàn)場可編程門陣列(FPGA)設(shè)計(jì)靈活、速度快，在數(shù)字專用集成電路的設(shè)計(jì)中得到了廣泛的應(yīng)用。本論文主要討論了如何利用FPGA來實(shí)現(xiàn)一個(gè)DDS系統(tǒng)，該DDS系統(tǒng)的硬件結(jié)構(gòu)是以FPGA為核心實(shí)現(xiàn)的，使用Altera公司的Cyclone系列FPGA。文章首先介紹了頻率合成器的發(fā)展，闡述了基于FPGA實(shí)現(xiàn)DDS技術(shù)的意義；然后介紹了DDS的基本理論；接著介紹了FPGA的基礎(chǔ)知識如結(jié)構(gòu)特點(diǎn)、開發(fā)流程、使用工具等；隨后介紹了利用FPGA實(shí)現(xiàn)直接數(shù)字頻率合成(DDS)的原理、電路結(jié)構(gòu)、優(yōu)化方法等。重點(diǎn)介紹DDS技術(shù)在FPGA中的實(shí)現(xiàn)方法，給出了部分VHDL源程序。采用該方法設(shè)計(jì)的DDS系統(tǒng)可以很容易地嵌入到其他系統(tǒng)中而不用外接專用DDS芯片，具有高性能、高性價(jià)比，電路結(jié)構(gòu)簡單等特點(diǎn)；接著對輸出信號頻譜進(jìn)行了分析，特別是對信號的相位截?cái)嗾`差和幅度量化誤差進(jìn)行了詳細(xì)的討論，由此得出了改善系統(tǒng)性能的幾種方法；最后給出硬件實(shí)物照片和測試結(jié)果，并對此作了一定的分析。

標(biāo)簽： FPGA DDS 信號源

上傳時(shí)間： 2013-04-24

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基于FPGA的FFT信號處理器的設(shè)計(jì)與實(shí)現(xiàn)

現(xiàn)場可編程門陣列(FPGA)是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,它結(jié)合了微電子技術(shù)、電路技術(shù)和EDA(Electronics Design Automation)技術(shù)。隨著它的廣泛應(yīng)用和快速發(fā)展,使設(shè)計(jì)電路的規(guī)模和集成度不斷提高,同時(shí)也帶來了電子系統(tǒng)設(shè)計(jì)方法和設(shè)計(jì)思想的不斷推陳出新。隨著數(shù)字電子技術(shù)的發(fā)展,數(shù)字信號處理的理論和技術(shù)廣泛的應(yīng)用于通訊、語音處理、計(jì)算機(jī)和多媒體等領(lǐng)域。離散傅立葉變換(DFT)作為數(shù)字信號處理中的基本運(yùn)算,發(fā)揮著重要作用。而快速傅里葉變換(FFT)算法的提出,使離散傅里葉變換的運(yùn)算量減小了幾個(gè)數(shù)量級,使得數(shù)字信號處理的實(shí)現(xiàn)變得更加容易。FFT已經(jīng)成為現(xiàn)代數(shù)字信號處理的核心技術(shù)之一,因此對FFT算法及其實(shí)現(xiàn)方法的研究具有很強(qiáng)的理論和現(xiàn)實(shí)意義。本文主要研究如何利用FPGA實(shí)現(xiàn)FFT算法,研制具有自主知識產(chǎn)權(quán)的FFT信號處理器。該設(shè)計(jì)采用高效基-16算法實(shí)現(xiàn)了一種4096點(diǎn)FFT復(fù)數(shù)浮點(diǎn)運(yùn)算處理器,其蝶形處理單元的基-16運(yùn)算核采用兩級改進(jìn)的基-4算法級聯(lián)實(shí)現(xiàn),僅用8個(gè)實(shí)數(shù)乘法器就可實(shí)現(xiàn)基-16蝶形單元所需的8次復(fù)數(shù)乘法運(yùn)算,在保持處理速度的優(yōu)勢下,比傳統(tǒng)的基-16算法節(jié)省了75％的乘法器邏輯資源。在重點(diǎn)研究處理器蝶形單元設(shè)計(jì)的基礎(chǔ)上,本文完成了整個(gè)FFT處理器電路的FPGA設(shè)計(jì)。首先基于對處理器功能和特點(diǎn)的分析,研究了FFT算法的選取和優(yōu)化,并完成了處理器體系結(jié)構(gòu)的設(shè)計(jì)；在此基礎(chǔ)上,以提高處理器處理速度和減小硬件資源消耗為重點(diǎn)研究了具體的實(shí)現(xiàn)方案,完成了1.2萬行RTL代碼編程,并在XILINX公司提供的ISE 9.1i集成開發(fā)環(huán)境中實(shí)現(xiàn)了處理器各個(gè)模塊的RTL設(shè)計(jì)：隨后,以XILINX Spartan-3系列FPGA芯片xc3S1000為硬件平臺,完成了整個(gè)FFT處理器的電路設(shè)計(jì)實(shí)現(xiàn)。經(jīng)過仿真驗(yàn)證,本文所設(shè)計(jì)的FFT處理器芯片運(yùn)行速度達(dá)到了100MHz,占用的FPGA門數(shù)為552806,電路的信噪比可以達(dá)到50dB以上,達(dá)到了高速高性能的設(shè)計(jì)要求。

標(biāo)簽： FPGA FFT 信號處理器

上傳時(shí)間： 2013-04-24

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