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工業(yè)自動化儀表

  • 參數化Viterbi譯碼器的FPGA實現

    本文以某型號接收機的應用為背景,主要論述了如何實現基于FPGA的參數化的Viterbi譯碼器的知識產權(IP)核。文中詳細論述了譯碼器的內部結構、VerilogHDL(硬件描述語言)實現、仿真測試等。這些可變的參數包括:碼型、ACS(加比選)單元的數目、軟判決比特數、回溯深度等。用戶可以根據自己的需要設置不同的參數由開發工具生成不同的譯碼器用于不同的系統。  本文的創新之處在于,針對FPGA的內部結構提出了一種新的累加度量RAM的組織形式,大大節省了嵌入式RAM塊;提出了一種新的累加度量值的歸一化辦法;此外還給出了用Matlab建模得到軟判決信息輔助仿真工具進行電路仿真的方法,大大提高了仿真的速度。  所設計的(2,1,7)連續型5比特軟判決譯碼器已經應用于某型號接收機,經受了實際應用的考驗產生了巨大的經濟效益。

    標簽: Viterbi FPGA 參數 譯碼器

    上傳時間: 2013-04-24

    上傳用戶:waizhang

  • 基于“單片機CPLDFPGA體系結構”的程控交換機系統集成化設計

    有線通信方式由于具有保密性高、抗干擾能力強在軍事通信中倍受青睞,因此,對軍用有線通信設備的研究和設計具有十分重要的戰略意義.TBJ-204型野戰20線程控交換機是一種小型背負式模擬空分程控用戶交換機,用于裝備全軍各兵種的作戰、演習和緊急搶險等行動.該項目以該交換機為研究對象,在詳細分析原設備的系統結構和功能實現方式的基礎上,指出該機型在使用過程中存在技術相對陳舊、分立元件過多、可靠性和保密性不夠、體積大、重量大、維修困難等問題,同時結合系統的低功耗需求和優化人機接口設計,本文提出基于"單片機+CPLD/FPGA體系結構"的集成化設計方案:①在CPLD中實現信號音分頻和計時頻率生成電路、20路用戶LED狀態控制電路;②CPLD與單片機以總線接口方式實現譯碼、數據和控制信號鎖存功能的VHDL設計;③基于低功耗設計的器件選型方案和單片機待機模式設計;④人機接口的LCD菜單操作方式.該文詳細介紹了改型設備的研制過程,包括CPLD片內功能設計實現、主控制板和用戶板各功能模塊工作原理和設計實現、各硬件模塊功能測試等,最后給出了局內呼叫處理功能和話務員服務功能的軟件實現流程.文章結尾介紹了改型設備的系統性能,它將實現更高的可靠性、保密性和抗干擾能力,同時具備低功耗和小型化的優點.最后,該文總結了項目設計中使用的關鍵技術,指出了設計的創新意義和將來的工作.

    標簽: CPLDFPGA 單片機 程控交換機

    上傳時間: 2013-04-24

    上傳用戶:啊颯颯大師的

  • 基于ARM的嵌入式無線工業供水測控系統

    隨著科學技術的不斷發展,嵌入式系統得到了廣泛的應用。在當今的工業控制領域,控制邏輯和功能變得越來越復雜,簡單的嵌入式系統己經不能滿足工業生產需求,而帶有高性能處理器以及完整操作系統的嵌入式系統的引入將逐漸成為工業控制自動化發展的方向。 本文對用于工業供水設備測控的工業供水測控系統展開研究。首先,在ARM嵌入式最小系統的基礎上建立通用的硬件平臺,對平臺的硬件結構進行設計,特別是對于關鍵的接口電路進行了比較深入的研究,針對供水設備測控的不同要求,集成了多種接口電路。其次,在實現嵌入式實時多任務操作系統μC/OS-Ⅱ在ARM上可移植的基礎上,建立了測控系統的軟件平臺,對接口電路驅動程序進行模塊化設計。最后,在研制出的測控平臺上,加入了電力參數與傳感器數據監測電路以及開關量輸入/輸出電路,特別是對工頻交流信號有效值的測量進行了較深入的硬件設計以及軟件算法研究,并對測控系統的無線通訊部分進行了設計。 在上述工作的基礎上,開發出嵌入式無線工業供水測控系統樣機。工業現場近半年來試運行的結果表明:該基于ARM的嵌入式無線工業供水測控系統設計合理,性能穩定可靠,達到了設計的要求。

    標簽: ARM 嵌入式無線 工業 測控系統

    上傳時間: 2013-06-23

    上傳用戶:giser

  • 利用Cadence ALlegro進行PCB級的信號完整性仿真

    隨著信息寬帶化和高速化的發展,以前的低速PCB已完全不能滿足日益增長信息化發展的需要,而高速PCB的出現將對硬件人員提出更高的要求,僅僅依靠自

    標簽: Cadence ALlegro PCB 信號完整性

    上傳時間: 2013-05-22

    上傳用戶:julin2009

  • spwm表生成工具

    生成spwm正弦表的程序,直接運行輸入相應的參數就可以了。

    標簽: spwm 生成工具

    上傳時間: 2013-04-24

    上傳用戶:buffer

  • GPS接收機天線陣列抗干擾算法研究及其FPGA實現

    GPS技術在導航、定位及精確打擊等方面產生了重要影響,已經廣泛地應用在各種武器平臺上。但是,在干擾環境下也顯現出許多問題。由于其到達地球表面的信號極其微弱(-160dBW),在現在復雜的電磁環境中容易受到干擾,尤其是C/A碼信號更易受到干擾,并且隨著導航戰的發展對GPS的抗干擾已成為爭取導航資源的有效措施。因此,研究干擾環境下的GPS接收機設計具有重要意義。 本文首先簡要介紹了GPS信號的結構及構成,通過對GPS信號特征以及接收機抗干擾能力的分析,結合干擾對接收機的作用方式及效果,確定GPS最易受的干擾類型為阻塞式干擾,然后針對這種干擾類型提出了一種有效的抗干擾技術-----自適應調零天線技術。接下來,著重研究了GPS接收機在此抗干擾技術前提下的若干抗干擾方法,并對其進行了詳細的分析和討論。 研究過程中,通過對最佳化準則和空域自適應濾波的理解,首先對不同天線陣列結構進行了性能仿真和比較分析,然后在對稱圓形天線陣列的基礎上對空域自適應算法進行了仿真分析,針對其自由度有限的問題接著對空時濾波方法做了詳細討論,在7元對稱圓形陣列的基礎上仿真說明了二者各自的優缺點。考慮到實際的干擾環境和本課題研究的初期階段,因此選用了適合本課題干擾環境的空域濾波方法,并對其自適應算法進行了適當的改進,使得其抗干擾性能獲得了一定程度的改善。 最后,詳細說明了該接收機抗干擾模塊的FPGA實現原理。詳細給出了頂層及各子模塊的設計流程與RTL視圖,實驗結果驗證了該算法的有效性。

    標簽: FPGA GPS 接收機 天線陣列

    上傳時間: 2013-06-03

    上傳用戶:xfbs821

  • H264AVC的CAVLC編碼算法研究及FPGA實現

    H.264/AVC是國際電信聯盟與國際標準化組織/國際電工委員會聯合推出的活動圖像編碼標準,簡稱H.264。作為最新的國際視頻編碼標準,H.264/AVC與MPEG-4、H.263等視頻編碼標準相比,性能有了很大的提高,并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用。 本論文的研究課題是基于H.264/AVC視頻編碼標準的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應可變長編碼)編碼算法研究及FPGA實現。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應算術編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標準不同,它所有的編碼都是基于上下文進行。這種方法比傳統的查單一表的方法提高了編碼效率,但也增加了設計上的困難。 作者在全面學習H.264/AVC協議和深入研究CAVLC編碼算法的基礎上,確定了并行編碼的CAVLC編碼器結構框圖,并總結出了影響CAVLC編碼器實現的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進行了優化設計,這些優化設計包括多參考塊的表格預測法、快速查找表法、算術消除法等。最后,用Verilog硬件描述語言對所設計的CAVLC編碼器進行了描述,用EDA軟件對其主要功能模塊進行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求,為整個CAVLC編碼器的實時通信提供了良好的基礎。

    標簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-04

    上傳用戶:libenshu01

  • 基于FPGA的32位RISC處理器設計與實現

    隨著SOC技術、IP技術以及集成電路技術的發展,RISC軟核處理器的研究與開發設計開始受到了人們的重視。基于FPGA的RISC軟核處理器在各個行業開始得到了廣泛的應用,特別是在一些基于FPGA的嵌入式系統中有著越來越廣泛的應用前景。 該論文在研究了大量國內外技術文獻的基礎上,總結了RISC處理器發展的現狀與水平。認真分析了RISC處理器的基本結構,包括總線結構,流水線處理的原理,以及流水線數據通路和流水線控制的原理;并詳細分析了該設計采用的指令集——MIPS指令集的內在結構。設計出了一個32位RISC軟核處理器,這個軟核處理器采用五級流水線結構,能完成加法、減法、邏輯與、邏輯或、左移右移等算術邏輯操作,以及它們的組合操作。通過軟件仿真和在Altera的FPGA開發板上進行驗證,證明了所設計的32位RISC處理器能準確的執行所選用的MIPS指令集,運行速度能達到30MHz,功能良好。 通過對所設計對象特點及其可行性的研究,選用了Altera公司QuartusⅡ軟件作為設計與仿真驗證的環境。在設計方法上,該課題采用了自頂向下的設計方法。在設計過程中采用了邊設計邊驗證這種設計與驗證相結合的設計流程,大大提高了設計的可靠性。該課題在設計過程中還提出了兩個有效的設計思路:第一是在32位寄存器的設計中利用FPGA的內部RAM資源來設計,減少了傳輸延時,提高了運行速度,并大大減少了對FPGA內部資源的占用;第二是在系統架構上采用了柔性化的設計方法,使得設計可以根據實際的需求適當的增減相應的部件,以達到需求與性能的統一。這兩個方法都有效地解決了設計中出現的問題,提高了處理器的性能。

    標簽: FPGA RISC 處理器

    上傳時間: 2013-07-21

    上傳用戶:caozhizhi

  • ARM體系的嵌入式工控一體機

    隨著嵌入式控制在工業領域的不斷滲入,進入21世紀之后,基于ARM體系Linux操作系統的嵌入式一體化工業控制系統成為了工業控制的主要發展方向,ARM芯片不僅體積小,功耗低,而且功能強;Linux由于其開源,穩定以及成本低的優點,在嵌入式系統中得到了廣泛的應用。 本文研究的主要內容是基于Linux操作系統ARM體系的嵌入式工控一體機設計與實現。該嵌入式工控一體機是基于Motorola公司研發的ARM9嵌入式系統和Linux操作系統的設備,整個系統體積小,結構精簡,并有很高的執行效率。它根據特定的工業控制對象定制特定的模型與控制算法。另外,該設備自身還具備各種數字PID控制算法,實現PID閉環控制。可以應用于工業控制領域中的各類被控設備,以及為高校自動化控制實驗和工業應用研究提供解決方案。它的軟件編程由Qt集成開發環境實現,Qt是基于C++的針對構造圖形用戶界面(程序)所使用的GUI工具包,它速度塊,易于使用,并具有很好的可移植性。 本文首先對嵌入式系統進行選型,然后提出了系統的軟硬件整體架構和系統的啟動流程。接著介紹了系統開發環境的搭建,包括啟動加載器的設計和實現,Linux內核的移植,設備驅動程序的編寫以及圖形用戶界面的實現。最后,詳細介紹了一個具有創新性的案例作為該嵌入式Linux工控一體機作為通訊和控制終端的典型應用。 該嵌入式Linux工控一體機具有極好的實用性和應用前景,并且其設計和實現過程對于其它嵌入式平臺也具有很好的參考價值。

    標簽: ARM 嵌入式 工控

    上傳時間: 2013-07-27

    上傳用戶:zhaiyanzhong

  • 無線數據傳輸網絡遠程抄表系統

    隨著計算機和網絡技術應用的擴展,電能的遠程自動監測、計算與收費的方案逐步被采用,能源計量儀表的數據自動抄收及遠傳系統的建設成為智能化住宅的基本配置之一。 本文針對校園的學生宿舍的電表收費進行了探討,到目前為止、按照收費方式電子式電能表可以分為:接觸式和非接觸式的IC卡預付費電表、復費率電表、和分時預付費的復費率電表。針對這幾種電表的抄表方式也各不相同,預付費電表主要是應用IC卡充值的方法付費、而復費率的電表主要是采用人工抄表和布線抄表的方法、而分時預付費復費率的電表主要是使用IC卡充值之后,利用實時時鐘在用電峰谷時對存儲在電表能的金額進行扣除。文中設計的自動抄表系統可以實現對上述三種電表的抄錄工作,尤其是針對校園學生宿舍等應用場所具用重要的意義。 文章提出了整體的方案設計,三級網絡分別應用了無線傳輸和網絡傳輸的方案,解決了遠程電能計量計費系統的由集中器和采集器(采集終端)以及通信信道與抄表軟件組成的部分即:集中器到抄表中心的上行信道、集中器至采集器(采集終端)或水電氣表間的下行信道。在整體設計思路介紹之后,文章花主要篇幅分章節介紹了復費率電能計量儀表、基于arm和uclinux的無線收發集中控制器的軟硬件,上位機的主控界面的設計。其中電能表的開發分塊介紹了軟硬件的各個部分,集中控制器由于嵌入了實時操作系統uclinux,著重講述了基于操作系統的應用程序的開發,主站界面介紹了簡單的測試程序。然后通過測試的結果說明了課題設計的系統實現了數據的基本采集和控制的情況,最后本文總結了研究的成果,并提出了改進的方向。

    標簽: 無線數據傳輸 抄表系統 網絡遠程

    上傳時間: 2013-07-04

    上傳用戶:咔樂塢

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