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度量

  • 基于互相關(guān)相似性度量的小波變換分子序列

    該文檔為基于互相關(guān)相似性度量的小波變換分子序列簡(jiǎn)介資料,講解的還不錯(cuò),感興趣的可以下載看看…………………………

    標(biāo)簽: 小波變換

    上傳時(shí)間: 2021-10-20

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  • 并聯(lián)三相三線制有源電力濾波器的仿真與設(shè)計(jì).rar

    隨著電力電子技術(shù)的飛速發(fā)展,越來(lái)越多的電力電子裝置被應(yīng)用到各個(gè)領(lǐng)域,給電網(wǎng)注入了不可忽視的無(wú)功以及諧波電流。 本文首先介紹了諧波的概念和諧波的危害,闡述了諧波問(wèn)題研究的必要性和緊迫性,并對(duì)諧波抑制的方法作了簡(jiǎn)單的介紹。并在此基礎(chǔ)上,通過(guò)對(duì)有源濾波器和無(wú)源濾波器各自的優(yōu)缺點(diǎn)以及有源濾波器裝置的結(jié)構(gòu)、原理的分析,提出了基于DSP控制器的三相三線制并聯(lián)型有源電力濾波器裝置的設(shè)計(jì)方案。 并聯(lián)有源電力濾波器主電路設(shè)計(jì)是核心環(huán)節(jié)之一。本文在三相三線并聯(lián)型有源電力濾波器數(shù)學(xué)模型的基礎(chǔ)上,通過(guò)對(duì)采用空間矢量調(diào)制的有源電力濾波器的工作過(guò)程的研究和分析,揭示了主電路各參數(shù)之間的相互關(guān)系。根據(jù)瞬態(tài)電流跟蹤指標(biāo)的要求推導(dǎo)出并聯(lián)APF輸出電感的估算公式。基于對(duì)電流跟蹤誤差矢量的度量,推導(dǎo)出直流側(cè)電容電壓臨界值表達(dá)式。詳細(xì)介紹了輸出濾波器參數(shù)的設(shè)計(jì)方法。 實(shí)時(shí)、高精度的諧波檢測(cè)是有源電力濾波器的重要部分。本文詳細(xì)地介紹了瞬時(shí)無(wú)功功率理論,選擇檢測(cè)負(fù)載電流的方式以提取諧波。提出了用滑窗迭代作為低通濾波的數(shù)字算法,以快速分離負(fù)載電流中的基波分量得到諧波指令。以全數(shù)字控制為重點(diǎn),對(duì)電流環(huán)的數(shù)字控制方式,包括數(shù)字PI調(diào)節(jié)器的設(shè)計(jì)做出了比較詳細(xì)的分析。 本文用MATLAB/SIMULINK中的電力系統(tǒng)模塊對(duì)有源電力濾波器進(jìn)行了動(dòng)態(tài)仿真研究。仿真結(jié)果表明這種拓?fù)浣Y(jié)構(gòu)的有源電力濾波器對(duì)電力系統(tǒng)中的諧波抑制具有較好的效果。 在理論分析和仿真研究的基礎(chǔ)上,設(shè)計(jì)了基于TMS320LF2407A控制的并聯(lián)型電力有源濾波器,對(duì)其控制系統(tǒng)硬件構(gòu)成進(jìn)行了詳細(xì)的介紹。研制了實(shí)驗(yàn)樣機(jī),對(duì)并聯(lián)型電力有源濾波器進(jìn)行了初步的實(shí)驗(yàn)研究。

    標(biāo)簽: 并聯(lián) 三相 三線制

    上傳時(shí)間: 2013-04-24

    上傳用戶:shiny3333

  • 基于FPGA的Viterbi譯碼器設(shè)計(jì)與實(shí)現(xiàn).rar

    卷積碼是廣泛應(yīng)用于衛(wèi)星通信、無(wú)線通信等多種通信系統(tǒng)的信道編碼方式。Viterbi算法是卷積碼的最大似然譯碼算法,該算法譯碼性能好、速度快,并且硬件實(shí)現(xiàn)結(jié)構(gòu)比較簡(jiǎn)單,是最佳的卷積碼譯碼算法。隨著可編程邏輯技術(shù)的不斷發(fā)展,使用FPGA實(shí)現(xiàn)Viterbi譯碼器的設(shè)計(jì)方法逐漸成為主流。不同通信系統(tǒng)所選用的卷積碼不同,因此設(shè)計(jì)可重配置的Viterbi譯碼器,使其能夠滿足多種通信系統(tǒng)的應(yīng)用需求,具有很重要的現(xiàn)實(shí)意義。 本文設(shè)計(jì)了基于FPGA的高速Viterbi譯碼器。在對(duì)Viterbi譯碼算法深入研究的基礎(chǔ)上,重點(diǎn)研究了Viterbi譯碼器核心組成模塊的電路實(shí)現(xiàn)算法。本設(shè)計(jì)中分支度量計(jì)算模塊采用只計(jì)算可能的分支度量值的方法,節(jié)省了資源;加比選模塊使用全并行結(jié)構(gòu)保證處理速度;幸存路徑管理模塊使用3指針偶算法的流水線結(jié)構(gòu),大大提高了譯碼速度。在Xilinx ISE8.2i環(huán)境下,用VHDL硬件描述語(yǔ)言編寫程序,實(shí)現(xiàn)(2,1,7)卷積碼的Viterbi譯碼器。在(2,1,7)卷積碼譯碼器基礎(chǔ)上,擴(kuò)展了Viterbi譯碼器的通用性,使其能夠?qū)Σ煌木矸e碼譯碼。譯碼器根據(jù)不同的工作模式,可以對(duì)(2,1,7)、(2,1,9)、(3,1,7)和(3,1,9)四種廣泛運(yùn)用的卷積碼譯碼,并且可以修改譯碼深度等改變譯碼器性能的參數(shù)。 本文用Simulink搭建編譯碼系統(tǒng)的通信鏈路,生成測(cè)試Viterbi譯碼器所需的軟判決輸入。使用ModelSim SE6.0對(duì)各種模式的譯碼器進(jìn)行全面仿真驗(yàn)證,Xilinx ISE8.2i時(shí)序分析報(bào)告表明譯碼器布局布線后最高譯碼速度可達(dá)200MHz。在FPGA和DSP組成的硬件平臺(tái)上進(jìn)一步測(cè)試譯碼器,譯碼器運(yùn)行穩(wěn)定可靠。最后,使用Simulink產(chǎn)生的數(shù)據(jù)對(duì)本文設(shè)計(jì)的Viterbi譯碼器的譯碼性能進(jìn)行了分析,仿真結(jié)果表明,在同等條件下,本文設(shè)計(jì)的Viterbi譯碼器與Simulink中的Viterbi譯碼器模塊的譯碼性能相當(dāng)。

    標(biāo)簽: Viterbi FPGA 譯碼器

    上傳時(shí)間: 2013-06-24

    上傳用戶:myworkpost

  • IEEE 802.16a RS-CC編譯碼VLSI算法研究及FPGA實(shí)現(xiàn)

      本論文依據(jù)IEEE802.16a物理層對(duì)RS-CC碼的參數(shù)要求,研究了RS-CC碼的高速編、譯碼的VLSI硬件算法,同時(shí)對(duì)FPGA開發(fā)技術(shù)進(jìn)行了研究,以VerilogHDL為描述語(yǔ)言,在Xilinx公司的FPGA上實(shí)現(xiàn)了高速的RS-CC編、譯碼器。RS譯碼器中,錯(cuò)誤位置多項(xiàng)式和錯(cuò)誤值多項(xiàng)式的求解采用無(wú)求逆單元,并具有規(guī)則數(shù)據(jù)流、易于VLSI實(shí)現(xiàn)的改進(jìn)的歐幾里德算法(MEA);CC譯碼器由采用模歸一化路徑度量的全并行的“加比選(ACS)”模塊和具有脈動(dòng)陣列結(jié)構(gòu)的幸存路徑回溯模塊組成。  在實(shí)現(xiàn)RS-CC譯碼器的過(guò)程中,分別從算法上和根據(jù)FPGA的結(jié)構(gòu)特點(diǎn)上,對(duì)譯碼器做了一些優(yōu)化工作,降低了硬件資源占有率和提高了譯碼速度。  此外,還搭建了以Xilinx公司40萬(wàn)等效門的FPGASpartan-Ⅲ400-4PQ208為主體,以Cypress公司的USB2.0芯片CY7C68013為高速數(shù)據(jù)接口的硬件試驗(yàn)平臺(tái),并在此試驗(yàn)平臺(tái)上實(shí)現(xiàn)了文中的高速RS-CC編譯碼系統(tǒng)。

    標(biāo)簽: 802.16 RS-CC IEEE FPGA

    上傳時(shí)間: 2013-06-03

    上傳用戶:lx9076

  • FPGA軟硬件性能基準(zhǔn)測(cè)試的研究

    現(xiàn)場(chǎng)可編程門陣列FPGA具有性能好、規(guī)模大、可重復(fù)編程、開發(fā)投資小等優(yōu)點(diǎn),在現(xiàn)代電子產(chǎn)品中應(yīng)用得越來(lái)越廣泛。隨著微電子技術(shù)的高速發(fā)展,成本的不斷下降,F(xiàn)PGA正逐漸成為各種電子產(chǎn)品不可或缺的重要部件。 FPGA軟件復(fù)雜的設(shè)置和不同的算法、FPGA硬件多樣的結(jié)構(gòu)和豐富的功能、各個(gè)廠商互不兼容的軟硬件等差異,都不僅使如何挑選合適的軟硬件用于產(chǎn)品設(shè)計(jì)成為FPGA用戶棘手的問(wèn)題,而且使構(gòu)造一個(gè)精確合理的FPGA軟硬件性能的測(cè)試方法變得十分復(fù)雜。 基準(zhǔn)測(cè)試是用一個(gè)基準(zhǔn)設(shè)計(jì)集按照統(tǒng)一的測(cè)試規(guī)范評(píng)估和量化目標(biāo)系統(tǒng)的軟件或硬件性能,是目前計(jì)算機(jī)領(lǐng)域應(yīng)用最廣泛、最主要的性能測(cè)試技術(shù)。 通過(guò)分析影響FPGA軟硬件性能基準(zhǔn)測(cè)試的諸多因素,比如基準(zhǔn)設(shè)計(jì)的挑選、基準(zhǔn)設(shè)計(jì)的優(yōu)化,F(xiàn)PGA軟件的設(shè)置和約等,本文基于設(shè)計(jì)和硬件分類、優(yōu)化策略分類的基準(zhǔn)測(cè)試規(guī)范,提出了一組詳盡的度量指標(biāo)。 基準(zhǔn)測(cè)試的規(guī)范如下,首先根據(jù)測(cè)試目的配置測(cè)試環(huán)境、挑選基準(zhǔn)設(shè)計(jì)和硬件分類,針對(duì)不同的FPGA軟硬件優(yōu)化基準(zhǔn)設(shè)計(jì),然后按照速度優(yōu)先最少優(yōu)化、速度優(yōu)先最大優(yōu)化、資源和功耗優(yōu)先最少優(yōu)化、資源和功耗優(yōu)先最大優(yōu)化四種優(yōu)化策略分別編譯基準(zhǔn)設(shè)計(jì),并收集延時(shí)、成本、功耗和編譯時(shí)間這四種性能數(shù)據(jù),最后使用速度優(yōu)先最少優(yōu)化下的性能集、速度優(yōu)先最少優(yōu)化性能集、資源和功耗優(yōu)先最少優(yōu)化下的性能集、資源和功耗優(yōu)先最大優(yōu)化下的性能集、速度優(yōu)先最少和最大優(yōu)化之間性能集的差、速度優(yōu)先最少優(yōu)化下性能集的比較等十個(gè)度量指標(biāo)量化性能,生成測(cè)試報(bào)告。 最后,本基準(zhǔn)測(cè)試規(guī)范被應(yīng)用于評(píng)估和比較Altera和Xilinx兩廠商軟硬件在低成本領(lǐng)域帶處理器應(yīng)用方面的性能。

    標(biāo)簽: FPGA 軟硬件 性能 基準(zhǔn)測(cè)試

    上傳時(shí)間: 2013-04-24

    上傳用戶:zhangyi99104144

  • 參數(shù)化Viterbi譯碼器的FPGA實(shí)現(xiàn)

    本文以某型號(hào)接收機(jī)的應(yīng)用為背景,主要論述了如何實(shí)現(xiàn)基于FPGA的參數(shù)化的Viterbi譯碼器的知識(shí)產(chǎn)權(quán)(IP)核。文中詳細(xì)論述了譯碼器的內(nèi)部結(jié)構(gòu)、VerilogHDL(硬件描述語(yǔ)言)實(shí)現(xiàn)、仿真測(cè)試等。這些可變的參數(shù)包括:碼型、ACS(加比選)單元的數(shù)目、軟判決比特?cái)?shù)、回溯深度等。用戶可以根據(jù)自己的需要設(shè)置不同的參數(shù)由開發(fā)工具生成不同的譯碼器用于不同的系統(tǒng)。  本文的創(chuàng)新之處在于,針對(duì)FPGA的內(nèi)部結(jié)構(gòu)提出了一種新的累加度量RAM的組織形式,大大節(jié)省了嵌入式RAM塊;提出了一種新的累加度量值的歸一化辦法;此外還給出了用Matlab建模得到軟判決信息輔助仿真工具進(jìn)行電路仿真的方法,大大提高了仿真的速度。  所設(shè)計(jì)的(2,1,7)連續(xù)型5比特軟判決譯碼器已經(jīng)應(yīng)用于某型號(hào)接收機(jī),經(jīng)受了實(shí)際應(yīng)用的考驗(yàn)產(chǎn)生了巨大的經(jīng)濟(jì)效益。

    標(biāo)簽: Viterbi FPGA 參數(shù) 譯碼器

    上傳時(shí)間: 2013-04-24

    上傳用戶:waizhang

  • 電源連接器Brush Wellman...售的是可靠性

    連接器通常被分為兩大類,即信號(hào)類和電源類。兩類之間的主要區(qū)別在于工作電流和電壓。 一般來(lái)說(shuō),信號(hào)連接器觸點(diǎn)傳輸?shù)碾娏魃儆?安培,且在低到中 等電壓下工作。電源類觸點(diǎn)傳輸較高的電流(> 1安培) ,且在中高電壓下工 作。電源連接器可制成不同的級(jí)別,從IC插座到電纜連接系統(tǒng)。用于測(cè)評(píng)連接 器在其使用壽命中的穩(wěn)定性的關(guān)鍵度量是連接器的接觸電阻。接觸電阻是體電阻(Rbulk)、膜電阻(Rf)和緊縮電阻的組合,并存在于電路中使用可分離界面時(shí)。

    標(biāo)簽: Wellman Brush 電源連接器 可靠性

    上傳時(shí)間: 2013-11-02

    上傳用戶:梧桐

  • 設(shè)備電源線上傳導(dǎo)騷擾電壓的測(cè)量方法

    電氣和電子設(shè)備在工作時(shí)所產(chǎn)生的電磁騷擾主要是由于其內(nèi)部的各種電子線路、開關(guān)電源、電動(dòng)機(jī)、機(jī)械開關(guān)和保護(hù)器的動(dòng)作所形成的。騷擾按其傳播途徑,主要有沿電源線、信號(hào)線傳播的傳導(dǎo)騷擾,和向周圍空間發(fā)射的輻射騷擾。前者用騷擾電壓(端子電壓)度量;后者則用騷擾功率和輻射場(chǎng)強(qiáng)度量

    標(biāo)簽: 設(shè)備 電源線 傳導(dǎo) 測(cè)量方法

    上傳時(shí)間: 2013-10-29

    上傳用戶:shizhanincc

  • 單片機(jī)外圍線路設(shè)計(jì)

    當(dāng)拿到一張CASE單時(shí),首先得確定的是能用什么母體才能實(shí)現(xiàn)此功能,然后才能展開對(duì)外圍硬件電路的設(shè)計(jì),因此首先得了解每個(gè)母體的基本功能及特點(diǎn),下面大至的介紹一下本公司常用的IC:?jiǎn)涡酒鉀Q方案• SN8P1900 系列–  高精度 16-Bit  模數(shù)轉(zhuǎn)換器–  可編程運(yùn)算放大器 (PGIA)•  信號(hào)放大低漂移: 2V•  放大倍數(shù)可編程: 1/16/64/128  倍–  升壓- 穩(wěn)壓調(diào)節(jié)器 (Charge-Pump Regulator)•  電源輸入: 2.4V ~ 5V•  穩(wěn)壓輸出: e.g. 3.8V at SN8P1909–  內(nèi)置液晶驅(qū)動(dòng)電路 (LCD Driver)–  單芯片解決方案 •  耳溫槍  SN8P1909 LQFP 80 Pins• 5000 解析度量測(cè)器 SN8P1908 LQFP 64 Pins•  體重計(jì)  SN8P1907 SSOP 48 Pins單芯片解決方案• SN8P1820 系列–  精確的12-Bit  模數(shù)轉(zhuǎn)換器–  可編程運(yùn)算放大器 (PGIA)• Gain Stage One: Low Offset 5V, Gain: 16/32/64/128• Gain Stage One: Low Offset 2mV, Gain: 1.3 ~ 2.5–  升壓- 穩(wěn)壓調(diào)節(jié)器•  電源輸入: 2.4V ~ 5V•  穩(wěn)壓輸出: e.g. 3.8V at SN8P1829–  內(nèi)置可編程運(yùn)算放大電路–  內(nèi)置液晶驅(qū)動(dòng)電路 –  單芯片解決方案 •  電子醫(yī)療器 SN8P1829 LQFP 80 Pins 高速/低功耗/高可靠性微控制器• 最新SN8P2000 系列– SN8P2500/2600/2700 系列– 高度抗交流雜訊能力• 標(biāo)準(zhǔn)瞬間電壓脈沖群測(cè)試 (EFT): IEC 1000-4-4• 雜訊直接灌入芯片電源輸入端• 只需添加1顆 2.2F/50V 旁路電容• 測(cè)試指標(biāo)穩(wěn)超 4000V (歐規(guī))– 高可靠性復(fù)位電路保證系統(tǒng)正常運(yùn)行• 支持外部復(fù)位和內(nèi)部上電復(fù)位• 內(nèi)置1.8V 低電壓偵測(cè)可靠復(fù)位電路• 內(nèi)置看門狗計(jì)時(shí)器保證程序跳飛可靠復(fù)位– 高抗靜電/栓鎖效應(yīng)能力– 芯片工作溫度有所提高: -200C ~ 700C     工規(guī)芯片溫度: -400C ~ 850C 高速/低功耗/高可靠性微控制器• 最新 SN8P2000 系列– SN8P2500/2600/2700 系列– 1T  精簡(jiǎn)指令級(jí)結(jié)構(gòu)• 1T:  一個(gè)外部振蕩周期執(zhí)行一條指令•  工作速度可達(dá)16 MIPS / 16 MHz Crystal–  工作消耗電流 < 2mA at 1-MIPS/5V–  睡眠模式下消耗電流 < 1A / 5V額外功能• 高速脈寬調(diào)制輸出 (PWM)– 8-Bit PWM up to 23 KHz at 12 MHz System Clock– 6-Bit PWM up to 93 KHz  at 12 MHz System Clock– 4-Bit PWM up to 375 KHz  at 12 MHz System Clock• 內(nèi)置高速16 MHz RC振蕩器 (SN8P2501A)• 電壓變化喚醒功能• 可編程控制沿觸發(fā)/中斷功能– 上升沿 / 下降沿 / 雙沿觸發(fā)• 串行編程接口

    標(biāo)簽: 單片機(jī) 線路設(shè)計(jì)

    上傳時(shí)間: 2013-10-21

    上傳用戶:jiahao131

  • 改進(jìn)的Max-Log-Map譯碼算法的DSP實(shí)現(xiàn)

    針對(duì)傳統(tǒng)的Max-Log-Map譯碼算法時(shí)效性差、存儲(chǔ)空間開銷大的特點(diǎn),本文對(duì)傳統(tǒng)的Max-Log-Map譯碼算法進(jìn)行了改進(jìn)。改進(jìn)的算法對(duì)前、后向度量使用了蝶形結(jié)構(gòu)圖,便于DSP實(shí)現(xiàn);將原始幀均分為多個(gè)子塊,設(shè)計(jì)子塊間的并行運(yùn)算以減小系統(tǒng)延遲;子塊內(nèi)采取進(jìn)一步地優(yōu)化措施,以減小數(shù)據(jù)存儲(chǔ)量并提高譯碼速率。在DSP C6416平臺(tái)上的仿真結(jié)果表明了算法的可實(shí)現(xiàn)性與可靠性。

    標(biāo)簽: Max-Log-Map DSP 譯碼算法

    上傳時(shí)間: 2013-11-08

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