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數(shù)字語音

  • 高精度C語音識別(使用雙精度變音算法)

    ·詳細說明:高精度C語音識別。使用雙精度變音算法。系統環境:Access2002+文件列表:   Metaphone.NET   .............\AssemblyInfo.cs   .............\bin   .............\...\Debug   .............\...\Release  

    標簽: 高精度 語音識別 精度 變音

    上傳時間: 2013-04-24

    上傳用戶:蔣清華嗯

  • 音視頻編解碼的H.263協議-C語言編寫

    ·音視頻編解碼的H.263協議-C語言編寫

    標簽: 263 音視頻 編解碼 協議

    上傳時間: 2013-06-16

    上傳用戶:user08x

  • LED數碼管字型生成器

    LED數碼管字型發生器,用了就知道,很好的。

    標簽: LED 數碼管 字型 生成器

    上傳時間: 2013-04-24

    上傳用戶:leesuper

  • fpga功能實現有限字長響應FIR

    fpga功能實現有限字長響應FIR,用verilog編寫

    標簽: fpga FIR 有限字長

    上傳時間: 2013-08-24

    上傳用戶:hz07104032

  • 數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述

    數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述,集成在一個模塊中,提供VHDL源程序供大家學習和討論。\r\n

    標簽: VHDL 寄存器 數控振蕩器 加法器

    上傳時間: 2013-09-04

    上傳用戶:a471778

  • 一種改進的基于時間戳的空間音視頻同步方法

    空間多媒體通信過程中存在的不可預測的分組數據丟失、亂序,可變的鏈路傳輸及處理時延抖動以及收發端時鐘不同步與漂移等問題,這可能導致接收端在對音視頻數據進行顯示播放時產生音視頻不同步現象。為了解決此問題,提出了一種改進的基于時間戳的空間音視頻同步方法,該方法采用一種相對時間戳映射模型,結合接收端同步檢測和緩沖設計,能夠在無需全網時鐘和反饋通道的情況下,實現空間通信中的音視頻同步傳輸,并在接收端進行同步播放顯示。對該方法進行了仿真,結果表明了設計的可行性。同步前的均方根誤差SPD值平均在150 ms左右,最大能達到176.1 ms。文中方法能將SPD值控制在60 ms左右,不僅能實現音視頻同步傳輸,并且開銷很小,可應用在空間多媒體通信中。

    標簽: 音視頻

    上傳時間: 2013-11-21

    上傳用戶:comer1123

  • MT-013 評估高速DAC性能

    ADC需要FFT處理器來評估頻譜純度,DAC則不同,利用傳統的模擬頻譜分析儀就能直接 研究它所產生的模擬輸出。DAC評估的挑戰在于要產生從單音正弦波到復雜寬帶CDMA信 號的各種數字輸入。數字正弦波可以利用直接數字頻率合成技術來產生,但更復雜的數字 信號則需要利用更精密、更昂貴的字發生器來產生。 評估高速DAC時,最重要的交流性能指標包括:建立時間、毛刺脈沖面積、失真、無雜散 動態范圍(SFDR)和信噪比(SNR)。本文首先討論時域指標,然后討論頻域指標。

    標簽: 013 DAC MT 性能

    上傳時間: 2013-10-27

    上傳用戶:Vici

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 準確的電源排序可防止系統受損

    諸如電信設備、存儲模塊、光學繫統、網絡設備、服務器和基站等許多復雜繫統都采用了 FPGA 和其他需要多個電壓軌的數字 IC,這些電壓軌必須以一個特定的順序進行啟動和停機操作,否則 IC 就會遭到損壞。

    標簽: 電源排序 防止

    上傳時間: 2014-12-24

    上傳用戶:packlj

  • 10A高性能負載點DCDC微型模塊

    電路板裝配、PCB 布局和數字 IC 集成的進步造就了新一代的高密度安裝、高性能繫統。

    標簽: DCDC 10A 性能 微型模塊

    上傳時間: 2013-10-17

    上傳用戶:RQB123

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