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SH 的 Diab C源碼。包括啟動(dòng)程序crt0.s

SH 的 Diab C源碼。包括啟動(dòng)程序crt0.s，例子程序bubble.c和swap.s

標(biāo)簽： Diab crt SH 源碼

上傳時(shí)間： 2014-09-05

上傳用戶：ikemada
C++中定義常量以及一些語法規(guī)則,由于C++中規(guī)則較為煩瑣,所以代碼中也加了一定注釋,可以參考一下

C++中定義常量以及一些語法規(guī)則,由于C++中規(guī)則較為煩瑣,所以代碼中也加了一定注釋,可以參考一下

標(biāo)簽： 定義代碼法規(guī)

上傳時(shí)間： 2015-05-12

上傳用戶：362279997
給Linux加logo的主題,Theme-AthlonXP

給Linux加logo的主題,Theme-AthlonXP

標(biāo)簽： Theme-AthlonXP Linux logo

上傳時(shí)間： 2014-12-07

上傳用戶：gmh1314
用2051加熱敏電阻做的溫度計(jì)！有很多不足的地方！請(qǐng)大家修改！

用2051加熱敏電阻做的溫度計(jì)！有很多不足的地方！請(qǐng)大家修改！

標(biāo)簽： 2051 加熱修改敏電阻

上傳時(shí)間： 2015-05-13

上傳用戶：水口鴻勝電器
Ripple Adder: 16-bit 全加,半加及ripple adder的設(shè)計(jì)及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置進(jìn)位加法器的設(shè)計(jì)方

Ripple Adder: 16-bit 全加,半加及ripple adder的設(shè)計(jì)及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置進(jìn)位加法器的設(shè)計(jì)方案及VHDL程序 Carry Select Adder:16 Bits 進(jìn)位選擇加法器的設(shè)計(jì)方案及VHDL程序

標(biāo)簽： Adder Ripple ripple Carry

上傳時(shí)間： 2015-05-13

上傳用戶：我們的船長
vhdl 測試向量含測試向量（Test Bench）和波形產(chǎn)生：VHDL實(shí)例---相應(yīng)加法器的測試向量（test bench).txt

vhdl 測試向量含測試向量（Test Bench）和波形產(chǎn)生：VHDL實(shí)例---相應(yīng)加法器的測試向量（test bench).txt

標(biāo)簽： Bench bench vhdl Test

上傳時(shí)間： 2015-05-13

上傳用戶：天涯
16位高速加法器

16位高速加法器，采用verilog語言編寫，已經(jīng)成功仿真，能夠運(yùn)行

標(biāo)簽： 加法器

上傳時(shí)間： 2013-12-24

上傳用戶：aix008
EXE文件加密碼,ASP壓縮處理.比較實(shí)用,大家拿去

EXE文件加密碼,ASP壓縮處理.比較實(shí)用,大家拿去

標(biāo)簽： EXE ASP 文件加密家

上傳時(shí)間： 2015-05-15

上傳用戶：ainimao
可以對(duì)無限長度的整數(shù)進(jìn)行加、減

可以對(duì)無限長度的整數(shù)進(jìn)行加、減，乘的Basic類

標(biāo)簽： 長度整數(shù) 減

上傳時(shí)間： 2014-01-20

上傳用戶：hjshhyy
利用計(jì)算機(jī)編程實(shí)現(xiàn)加性干擾信號(hào)的維納濾波。將計(jì)算機(jī)模擬實(shí)驗(yàn)結(jié)果與理論分析結(jié)果相比較

利用計(jì)算機(jī)編程實(shí)現(xiàn)加性干擾信號(hào)的維納濾波。將計(jì)算機(jī)模擬實(shí)驗(yàn)結(jié)果與理論分析結(jié)果相比較，分析影響維納濾波效果的各種因素，從而加深對(duì)維納濾波的理解。

標(biāo)簽： 計(jì)算機(jī) 編程實(shí)現(xiàn) 干擾信號(hào) 實(shí)驗(yàn)結(jié)果

上傳時(shí)間： 2014-12-07

上傳用戶：xc216

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