集成運放線性應用電路分析方法的研究 集成運放線性應用電路分析方法的研究
標簽: 集成運放 線性應用 電路分析
上傳時間: 2013-06-06
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基于LabVIEW與單片機串口的信號處理的研究:介紹了一種利用單片機采集數據,LabVIEW作為開發平臺,二者之間通過串口實現數據通信的數據采集系統,利用LabVIEW的圖形環境進行頻譜分析。通
標簽: LabVIEW 單片機串口 信號處理
上傳時間: 2013-06-24
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以AT89C51為核心,采用部分外圍電路,實現對電風扇的智能控制.通過AT89C51對雙向可控硅的控制,可實現風速的無級調速,且可以實現模擬自然風、睡眠風等,通過單片機自身的功能及外接少量電路可實現電
標簽: 89C C51 AT 89
上傳時間: 2013-06-16
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分,5'1Zk硬件和軟件的角度介紹了智能電壓數據采集裝置各部分的原理、功能,給出了串行通訊的程序流程圖及部分程序。經調試證明,該程序簡單、可靠,具有較高的應用價值。
標簽: C2051 2051 89C AT
上傳時間: 2013-07-07
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信息技術在建筑行業的高速發展使得智能住宅和智能小區迅速崛起并成長為巨大的新興產業。文章提出了一個基于$3C2410的高性能、低價格的WLAN智能住宅控制終端的設計方案。該方案依托成熟的無線局域
標簽: S3C2410 WLAN 智能住宅 控制終端
上傳時間: 2013-05-26
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本文研制了一套基于數碼相機的圖像采集系統,用于拍攝作物葉片。該系統采用漫反射式的多光源正面照明設計方案,具有實時、高效、可控的特點。研究通過正交試驗對照明系統參數進行優化,運用matlab 對
標簽: 圖像采集系統
上傳時間: 2013-07-30
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EDA工程建模及其管理方法研究21隨著微電子技術與計算機技術的日益成熟,電子設計自動化(EDA)技術在電子產品與集成電路(IC)芯片特別是單片
標簽: EDA 工程建模 管理方法
上傳時間: 2013-07-18
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摘 要: 在汽車行駛及機車控制系統中對測速裝置的要求是分辨能力強、高精度、盡可能短的檢測時間以及抗干擾能 力強等。該文介紹了一種應用霍爾傳感器A44E 獲得穩定的脈沖信號,從而實現對車速進行智能測量的方案。測試 結果表明,運用該方案實現的系統能很好的達到對車輪測速的要求。 關鍵詞: 霍爾傳感器;速度測量;脈沖檢測 中圖分類號: E911 文獻標識碼: A
標簽: A44E 霍爾傳感器 測速 中的應用
上傳時間: 2013-07-11
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現代雷達系統廣泛采用脈沖壓縮技術,用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達通過發射寬脈沖,保證足夠的最大作用距離,而接收時,采用相應的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時,數字信號處理技術的迅猛發展和廣泛應用,為雷達脈沖壓縮處理的數字化實現提供了可能。 本文主要研究雷達多波形頻域數字脈沖壓縮系統的硬件系統實現。在匹配濾波理論的指導下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數字脈沖壓縮系統。該系統可處理時寬在42μs以內、帶寬在5MHz以下的線性調頻信號(LFM),非線性調頻信號(NLFM)和Taylor四相碼信號,且技術指標完全滿足實用系統的設計要求。 本文完成的主要工作和創新之處有:(1)基于雙通道模數轉換器AD10242設計高精度數據采集電路,為整個脈壓系統的工作提供必要的條件。完成了前端模擬信號輸入電路的優化和差分輸入時鐘的產生,以實現高精度采樣。 (2)根據協議和脈壓系統的工作要求,以基于FPGAEP1K100QC208完成系統控制,使整個脈壓系統正確穩定地工作。同時以該FPGA生成雙口RAM,實現數據暫存,以匹配采樣速率和脈壓系統頻率。 (3)設計基于4片高性能ADSP21160M的緊耦合并行處理系統,以完成多波形頻域數字脈沖壓縮的全部運算工作。4片DSP共享外部總線,且各DSP以鏈路口互連,進行數據通信。各DSP還使用一個鏈路口連接到接口板DSP,將脈壓結果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心,設計輸出板電路,完成數據對齊、求模和數據向下一級的輸出,并產生模擬輸出。 (5)調試并改進處理板和輸出板。
標簽: FPGA DSP 多波形 壓縮系統
上傳時間: 2013-06-11
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自適應濾波器的硬件實現一直是自適應信號處理領域研究的熱點。隨著電子技術的發展,數字系統功能越來越強大,對器件的響應速度也提出更高的要求。 本文針對用通用DSP 芯片實現的自適應濾波器處理速度低和用HDL語言編寫底層代碼用FPGA實現的自適應濾波器開發效率低的缺點,提出了一種基于DSP Builder系統建模的設計方法。以隨機2FSK信號作為研究對象,首先在matlab上編寫了LMS去噪自適應濾波器的點M文件,改變自適應參數,進行了一系列的仿真,對算法迭代步長、濾波器的階數與收斂速度和濾波精度進行了研究,得出了最佳自適應參數,即迭代步長μ=0.0057,濾波器階數m=8,為硬件實現提供了參考。 然后,利用最新DSP Builder工具建立了基于LMS算法的8階2FSK信號去噪自適應濾波器的模型,結合多種EDA工具,在EPFlOKl00EQC208-1器件上設計出了最高數據處理速度為36.63MHz的8階LMS自適應濾波器,其速度是文獻[3]通過編寫底層VHDL代碼設計的8階自適應濾波器數據處理速度7倍多,是文獻[50]采用DSP通用處理器TMS320C54X設計的8階自適應濾波器處理速度25倍多,開發效率和器件性能都得到了大大地提高,這種全新的設計理念與設計方法是EDA技術的前沿與發展方向。 最后,采用異步FIFO技術,設計了高速采樣自適應濾波系統,完成了對雙通道AD器件AD9238與自適應濾波器的高速匹配控制,在QuartusⅡ上進行了仿真,給出了系統硬件實現的原理框圖,并將采樣濾波控制器與異步FIF0集成到同一芯片上,既能有效降低高頻可能引起的干擾又降低了系統的成本。
標簽: FPGA 高速采樣 自適應濾波
上傳時間: 2013-06-01
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