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無(wú)源器件

  • 基于MATLAB的無橋PFC電路仿真

    摘要:文中分析了功率因數(shù)校正的必要性,對(duì)有源功率因數(shù)校正主電路拓?fù)渥隽藢?duì)比分析,確定本文選用無橋拓?fù)洹7治隽藷o橋PFC電路的原理和優(yōu)缺點(diǎn),可以看到無橋電路具有開關(guān)器件少,功耗低,成本小,電路體積小的優(yōu)點(diǎn)。在控制方案選擇單周期控制,并采用Malab Simulink仿真平臺(tái)建立仿真模型,通過仿真表明,單周期控制的無橋PFC達(dá)到功率因數(shù)提高的目的。關(guān)鍵詞:功率因教校正;無橋;單周期;Matlab隨著電力電子技術(shù)的發(fā)展,電網(wǎng)中整流器、開關(guān)電源等非線性負(fù)載不斷增加。這些存在沖擊性的用電設(shè)備,將引起網(wǎng)側(cè)輸人電流發(fā)生嚴(yán)重畸變,產(chǎn)生大量造波污染,導(dǎo)致電網(wǎng)功率因數(shù)過低,所以提高功率因數(shù)勢在必行"早期功率因數(shù)校正采用在整流器后加濾波電感電容實(shí)現(xiàn),功率因數(shù)一般只有0.6左右;在20世紀(jì)90年代,有源功率因數(shù)校正(APFC)產(chǎn)生,是在整流器和負(fù)載之間接入一個(gè)DC/DC開關(guān)變換器,應(yīng)用電流反饋技術(shù),使輸入端電流波形跟蹤交流輸入正弦電壓波形,可以使輸入電流波形接近正弦,功率因數(shù)可提高到0.99以上。由于該方案采用了有源器件,故稱為有源功率因數(shù)校正APFC1有源功率因數(shù)校正主電路拓?fù)?.1 傳統(tǒng)Boost拓?fù)鋫鹘y(tǒng)Boost PFC電路由整流橋和PFC組成,如圖1所示。傳統(tǒng)Boost PFC電路工作時(shí)通過控制開關(guān)管的動(dòng)作,采用反饋來控制電流波形,這樣可以使交流網(wǎng)側(cè)輸入電流跟蹤輸入交流電壓而接近正弦波,來提高功率因數(shù)。但其流通路徑有3個(gè)半導(dǎo)體工作,當(dāng)變換器功率和開關(guān)頻率提高時(shí),系統(tǒng)的系統(tǒng)通態(tài)損耗明顯增加,整體效率低29

    標(biāo)簽: matlab pfc

    上傳時(shí)間: 2022-06-17

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  • 光模塊電路系統(tǒng)的研究

    近年來,隨著通信技術(shù)的迅猛發(fā)展,光纖通信己成為當(dāng)今信息社會(huì)不可或缺的通信系統(tǒng)。光電子器件以及光模塊是光通信系統(tǒng)中將電信號(hào)轉(zhuǎn)換成光信號(hào)或?qū)⒐庑盘?hào)轉(zhuǎn)換成電信號(hào)的關(guān)鍵部件,是光傳輸系統(tǒng)的心臟。本課題研究從有源光器件的工作特性入手,描述了光收發(fā)合一模塊的工作原理、器件結(jié)構(gòu)、耦合封裝、高速數(shù)字信號(hào)布線以及各種光模塊的現(xiàn)狀和發(fā)展。分析了半導(dǎo)體激光驅(qū)動(dòng)器的輸入輸出結(jié)構(gòu)及其高速調(diào)制特性,并對(duì)光模塊中高速電路傳輸線理論進(jìn)行了詳細(xì)的分析。本文在理論上對(duì)光有源器件的特性、光模塊以及光收發(fā)器的工藝問題作了深入的探討。對(duì)傳輸線理論作了深入的研究,并將其應(yīng)用于高速電路的布線上。所研究的光模塊具有性價(jià)比高、實(shí)用性強(qiáng)、接口標(biāo)準(zhǔn)實(shí)用面寬的特點(diǎn),并且構(gòu)成了系列產(chǎn)品,能廣泛應(yīng)用于不同的場合。

    標(biāo)簽: 光模塊 電路系統(tǒng)

    上傳時(shí)間: 2022-07-09

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  • usb的測試源碼 PDIUSBD12 是一款性價(jià)比很高的USB 器件它通常用作微控制器系統(tǒng)中實(shí)現(xiàn)與微控制器進(jìn)行通信的 高速通用并行接口它還支持本地的DMA 傳輸 這種實(shí)現(xiàn)USB 接口的標(biāo)準(zhǔn)組件使得設(shè)計(jì)

    usb的測試源碼 PDIUSBD12 是一款性價(jià)比很高的USB 器件它通常用作微控制器系統(tǒng)中實(shí)現(xiàn)與微控制器進(jìn)行通信的 高速通用并行接口它還支持本地的DMA 傳輸 這種實(shí)現(xiàn)USB 接口的標(biāo)準(zhǔn)組件使得設(shè)計(jì)者可以在各種不同類型微控制器中選擇出最合適的微控制器 這種靈活性減小了開發(fā)的時(shí)間風(fēng)險(xiǎn)以及費(fèi)用通過使用已有的結(jié)構(gòu)和減少固件上的投資從而用最快捷 的方法實(shí)現(xiàn)最經(jīng)濟(jì)的USB 外設(shè)的解決方案

    標(biāo)簽: USB PDIUSBD usb DMA

    上傳時(shí)間: 2015-03-25

    上傳用戶:曹云鵬

  • j2me無線學(xué)習(xí)源碼,一個(gè)無線連接的源碼,很有用的哦

    j2me無線學(xué)習(xí)源碼,一個(gè)無線連接的源碼,很有用的哦

    標(biāo)簽: j2me 無線

    上傳時(shí)間: 2014-01-22

    上傳用戶:cjf0304

  • windows編程加源碼.w indows編程加源碼.windows編程加源碼.

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    標(biāo)簽: windows indows 編程 源碼

    上傳時(shí)間: 2013-12-02

    上傳用戶:wcl168881111111

  • 利用一塊芯片完成除時(shí)鐘源、按鍵、揚(yáng)聲器和顯示器(數(shù)碼管)之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計(jì)具有體積小、設(shè)計(jì)周期短(設(shè)計(jì)過程中即可實(shí)現(xiàn)時(shí)序仿真)、調(diào)試

    利用一塊芯片完成除時(shí)鐘源、按鍵、揚(yáng)聲器和顯示器(數(shù)碼管)之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計(jì)具有體積小、設(shè)計(jì)周期短(設(shè)計(jì)過程中即可實(shí)現(xiàn)時(shí)序仿真)、調(diào)試方便、故障率低、修改升級(jí)容易等特點(diǎn)。 本設(shè)計(jì)采用自頂向下、混合輸入方式(原理圖輸入—頂層文件連接和VHDL語言輸入—各模塊程序設(shè)計(jì))實(shí)現(xiàn)數(shù)字鐘的設(shè)計(jì)、下載和調(diào)試。 一、 功能說明 已完成功能 1. 完成秒/分/時(shí)的依次顯示并正確計(jì)數(shù); 2. 秒/分/時(shí)各段個(gè)位滿10正確進(jìn)位,秒/分能做到滿60向前進(jìn)位; 3. 定時(shí)鬧鐘:實(shí)現(xiàn)整點(diǎn)報(bào)時(shí),又揚(yáng)聲器發(fā)出報(bào)時(shí)聲音; 4. 時(shí)間設(shè)置,也就是手動(dòng)調(diào)時(shí)功能:當(dāng)認(rèn)為時(shí)鐘不準(zhǔn)確時(shí),可以分別對(duì)分/時(shí)鐘進(jìn)行調(diào)整; 5. 利用多余兩位數(shù)碼管完成秒表顯示:A、精度達(dá)10ms;B、可以清零;C、完成暫停 可以隨時(shí)記時(shí)、暫停后記錄數(shù)據(jù)。 待改進(jìn)功能: 1. 鬧鐘只是整點(diǎn)報(bào)時(shí),不能手動(dòng)設(shè)置報(bào)時(shí)時(shí)間,遺憾之一; 2. 秒表不能向秒進(jìn)位,也就是最多只能記時(shí)100ms; 3. 秒表暫停記錄數(shù)據(jù)后不能在原有基礎(chǔ)上繼續(xù)計(jì)時(shí),而是復(fù)位重新開始。 【注意】秒表為后來添加功能,所以有很多功能不成熟!

    標(biāo)簽: CPLD VHDL 芯片 時(shí)鐘源

    上傳時(shí)間: 2014-01-02

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  • 關(guān)于單總線的ds18b20測溫器件的一些資料和源碼(含匯編和c).

    關(guān)于單總線的ds18b20測溫器件的一些資料和源碼(含匯編和c).

    標(biāo)簽: 18b b20 ds 18

    上傳時(shí)間: 2016-04-10

    上傳用戶:sjyy1001

  • CRC校驗(yàn)并行實(shí)現(xiàn),Verilog源碼.8位數(shù)據(jù)輸入,實(shí)現(xiàn)速度快,適用與各種類型的器件.

    CRC校驗(yàn)并行實(shí)現(xiàn),Verilog源碼.8位數(shù)據(jù)輸入,實(shí)現(xiàn)速度快,適用與各種類型的器件.

    標(biāo)簽: Verilog CRC 并行 器件

    上傳時(shí)間: 2016-04-13

    上傳用戶:標(biāo)點(diǎn)符號(hào)

  • 這是個(gè)電子鐘標(biāo)準(zhǔn)版的程序源碼,用8255,8253,8259器件設(shè)計(jì)實(shí)現(xiàn).可以值得一用.

    這是個(gè)電子鐘標(biāo)準(zhǔn)版的程序源碼,用8255,8253,8259器件設(shè)計(jì)實(shí)現(xiàn).可以值得一用.

    標(biāo)簽: 8255 8253 8259 電子鐘

    上傳時(shí)間: 2016-07-23

    上傳用戶:上善若水

  • SDRAM器件mt48lc4m16.v源碼

    SDRAM器件mt48lc4m16.v源碼,是一個(gè)功能的verilog代碼。

    標(biāo)簽: SDRAM 48 16 mt

    上傳時(shí)間: 2016-08-22

    上傳用戶:myworkpost

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