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用戶接口

  • 看過很多MP3播放器的源碼

    看過很多MP3播放器的源碼,用的FLASH基本上都是并口的。這個(gè)是用SPI接口的DATAFLASH來存儲(chǔ)歌曲的,單片機(jī)用的是AVR,帶完整工程文件,編譯就可以使用:)

    標(biāo)簽: MP3 播放器 源碼

    上傳時(shí)間: 2016-06-22

    上傳用戶:nanfeicui

  • 打分器程序

    打分器程序,用485接口。連300臺(tái)分機(jī)。

    標(biāo)簽: 程序

    上傳時(shí)間: 2014-01-27

    上傳用戶:familiarsmile

  • 為了能結(jié)合Java和 Matlab兩者的優(yōu)點(diǎn)

    為了能結(jié)合Java和 Matlab兩者的優(yōu)點(diǎn),構(gòu)造功能更加強(qiáng)大的科學(xué)計(jì)算環(huán)境,對(duì)使用Java語言擴(kuò)展Matlab 主開發(fā)環(huán)境 自身功能的關(guān)鍵技術(shù)進(jìn)行了研究。首先介紹了使用 Java擴(kuò)展 Matlab 的基本方法,在此基礎(chǔ)上結(jié)合項(xiàng)目實(shí)踐中對(duì)復(fù)雜圖形用 戶接口的需要,提出了一種在 Java 對(duì)象中通過 Matlab 接口對(duì)象訪問當(dāng)前Matlab會(huì)話的方法。給出了兩個(gè)短小完整實(shí)例,可 用于進(jìn)一步擴(kuò)展與重用。

    標(biāo)簽: Matlab Java

    上傳時(shí)間: 2013-12-26

    上傳用戶:aappkkee

  • GridSphere 門戶 提供一個(gè)基于 portlet 的高級(jí)開放源代碼門戶。GridSphere 是在歐盟提供基金的 GridLab 項(xiàng)目下開發(fā)的

    GridSphere 門戶 提供一個(gè)基于 portlet 的高級(jí)開放源代碼門戶。GridSphere 是在歐盟提供基金的 GridLab 項(xiàng)目下開發(fā)的,提供了一個(gè)非常復(fù)雜的門戶,該門戶為各種終端用戶提供高度定制的環(huán)境。portlet 模型向用戶提供了一個(gè)靈活易用的接口,并向門戶開發(fā)人員提供了一個(gè)模型,用于創(chuàng)建可插入的和動(dòng)態(tài)的應(yīng)用程序支持。下面簡要列出核心的 GridSphere 特性:

    標(biāo)簽: GridSphere GridLab portlet 門戶

    上傳時(shí)間: 2014-01-21

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  • 臺(tái)達(dá)PLC編程軟件技術(shù)手冊(cè)

    臺(tái)達(dá)的資料,給用的著的同學(xué)們。早期當(dāng)各家 PLC 開發(fā)商紛紛建立自己的編程語言時(shí),其各自不同的編程方式,對(duì)于用戶而言無疑是一個(gè)相當(dāng)大的負(fù)擔(dān);有鑒于此,由國際組織 I.E.C.(International Electro-technical Commission)所制定與推動(dòng)的 IEC 61131-3 標(biāo)準(zhǔn)便由此應(yīng)運(yùn)而生。其主要的特色在于統(tǒng)整各家的編程特點(diǎn),并考慮用戶的背景與習(xí)慣,而規(guī)范了一個(gè)可讓各家廠商與用戶共同依循的標(biāo)準(zhǔn),并可讓符合 IEC61131-3 標(biāo)準(zhǔn)的程序代碼具備相當(dāng)高的可讀性與兼容性。以下是關(guān)于 IEC 61131-3 的簡述。

    標(biāo)簽: plc

    上傳時(shí)間: 2022-02-21

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  • STM32從入門到精通

    STM 32 教學(xué)  (神州I號(hào) 用戶手冊(cè))

    標(biāo)簽: stm32

    上傳時(shí)間: 2022-06-30

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  • 基于FPGA的TS流復(fù)用器及其接口的設(shè)計(jì)與實(shí)現(xiàn).rar

    在數(shù)字電視系統(tǒng)中,MPEG-2編碼復(fù)用器是系統(tǒng)傳輸?shù)暮诵沫h(huán)節(jié),所有的節(jié)目、數(shù)據(jù)以及各種增值服務(wù)都是通過復(fù)用打包成傳輸流傳輸出去。目前,只有少數(shù)公司掌握復(fù)用器的核心算法技術(shù),能夠采用MPEG-2可變碼率統(tǒng)計(jì)復(fù)用方法提高帶寬利用率,保證高質(zhì)量圖像傳輸。由于目前正處廣播電視全面向數(shù)字化過渡期間,市場(chǎng)潛力巨大,因此對(duì)復(fù)用器的研究開發(fā)非常重要。本文針對(duì)復(fù)用器及其接口技術(shù)進(jìn)行研究并設(shè)計(jì)出成形產(chǎn)品。 文中首先對(duì)MPEG-2標(biāo)準(zhǔn)及NIOS Ⅱ軟核進(jìn)行分析。重點(diǎn)研究了復(fù)用器中的部分關(guān)鍵技術(shù):PSI信息提取及重構(gòu)算法、PID映射方法、PCR校正及CRC校驗(yàn)算法,給出了實(shí)現(xiàn)方法,并通過了硬件驗(yàn)證。然后對(duì)復(fù)用器中主要用到的AsI接口和DS3接口進(jìn)行了分析與研究,給出了設(shè)計(jì)方法,并通過了硬件驗(yàn)證。 本文的主要工作如下: ●首先對(duì)復(fù)用器整體功能進(jìn)行詳細(xì)分析,并劃分軟硬件各自需要完成的功能。給出復(fù)用器的整體方案以及ASI接口和DS3接口設(shè)計(jì)方案。 ●在FPGA上采用c語言實(shí)現(xiàn)了PSI信息提取與重構(gòu)算法。 ●給出了實(shí)現(xiàn)快速的PID映射方法,并根據(jù)FPGA特點(diǎn)給出一種新的PID映射方法,減少了邏輯資源的使用,提高了穩(wěn)定性。 ●采用Verilog設(shè)計(jì)了SI信息提取與重構(gòu)的硬件平臺(tái),并用c語言實(shí)現(xiàn)了SDT表的提取與重構(gòu)算法,在FPGA中成功實(shí)現(xiàn)了動(dòng)態(tài)分配內(nèi)存空間。 ●在FPGA上實(shí)現(xiàn)了.ASI接口,主要分析了位同步的實(shí)現(xiàn)過程,實(shí)現(xiàn)了一種新的快速實(shí)現(xiàn)字節(jié)同步的設(shè)計(jì)。 ●在FPGA上實(shí)現(xiàn)了DS3接口,提出并實(shí)現(xiàn)了一種兼容式DS3接口設(shè)計(jì)。并對(duì)幀同步設(shè)計(jì)進(jìn)行改進(jìn)。 ●完成部分PCB版圖設(shè)計(jì),并進(jìn)行調(diào)試監(jiān)測(cè)。 本復(fù)用器設(shè)計(jì)最大特點(diǎn)是將軟件設(shè)計(jì)和硬件設(shè)計(jì)進(jìn)行合理劃分,硬件平臺(tái)及接口采用Verilog語言實(shí)現(xiàn),PSI信息算法主要采用c語言實(shí)現(xiàn)。這種軟硬件的劃分使系統(tǒng)設(shè)計(jì)更加靈活,且軟件設(shè)計(jì)與硬件設(shè)計(jì)可同時(shí)進(jìn)行,極大的提高了工作效率。 整個(gè)項(xiàng)目設(shè)計(jì)采用verilog和c兩種語言完成,采用Altera公司的FPGA芯片EP1C20,在Quartus和NIOS IDE兩種設(shè)計(jì)平臺(tái)下設(shè)計(jì)實(shí)現(xiàn)。根據(jù)此方案已經(jīng)開發(fā)出兩臺(tái)帶有ASI和DS3接口的數(shù)字電視TS流復(fù)用器,經(jīng)測(cè)試達(dá)到了預(yù)期的性能和技術(shù)指標(biāo)。

    標(biāo)簽: FPGA TS流 復(fù)用器

    上傳時(shí)間: 2013-08-03

    上傳用戶:gdgzhym

  • 用Verilog實(shí)現(xiàn)的以太網(wǎng)接口

    用Verilog實(shí)現(xiàn)的以太網(wǎng)接口!!!!!!!!!!!!!!!!!!

    標(biāo)簽: Verilog 以太網(wǎng)接口

    上傳時(shí)間: 2013-07-13

    上傳用戶:LSPSL

  • 用FPGA實(shí)現(xiàn)8051內(nèi)核及外設(shè)I2C接口

    8051處理器自誕生起近30年來,一直都是嵌入式應(yīng)用的主流處理器,不同規(guī)模的805l處理器涵蓋了從低成本到高性能、從低密度到高密度的產(chǎn)品。該處理器極具靈活性,可讓開發(fā)者自行定義部分指令,量身訂制所需的功能模塊和外設(shè)接口,而且有標(biāo)準(zhǔn)版和經(jīng)濟(jì)版等多種版本可供選擇,可讓設(shè)計(jì)人員各取所需,實(shí)現(xiàn)更高性價(jià)比的結(jié)構(gòu)。如此多的優(yōu)越性使得8051處理器牢固地占據(jù)著龐大的應(yīng)用市場(chǎng),因此研究和發(fā)展8051及與其兼容的接口具有極大的應(yīng)用前景。在眾多8051的外設(shè)接口中,I2C總線接口扮演著重要的角色。通用的12C接口器件,如帶12C總線的RAM,ROM,AD/DA,LCD驅(qū)動(dòng)器等,越來越多地應(yīng)用于計(jì)算機(jī)及自動(dòng)控制系統(tǒng)中。因此,本論文的根本目的就是針對(duì)如何在8051內(nèi)核上擴(kuò)展I2C外設(shè)接口進(jìn)行較深入的研究。 本課題項(xiàng)目采用可編程技術(shù)來開發(fā)805l核以及12C接口。由于8051內(nèi)核指令集相容,我們能借助在現(xiàn)有架構(gòu)方面的經(jīng)驗(yàn),發(fā)揮現(xiàn)有的大量代碼和工具的優(yōu)勢(shì),較快地完成設(shè)計(jì)。在8051核模塊里,我們主要實(shí)現(xiàn)中央處理器、程序存儲(chǔ)器、數(shù)據(jù)存儲(chǔ)器、定時(shí)/計(jì)數(shù)器、并行接口、串行接口和中斷系統(tǒng)等七大單元及數(shù)據(jù)總線、地址總線和控制總線等三大總線,這些都是標(biāo)準(zhǔn)8051核所具有的模塊。在其之上我們?cè)偾度?2C的串行通信模塊,采用自下而上的方法,逐次實(shí)現(xiàn)一位的收發(fā)、一個(gè)字節(jié)的收發(fā)、一個(gè)命令的收發(fā),直至實(shí)現(xiàn)I2C的整個(gè)通信協(xié)議。 8051核及I2C總線的研究通過可編程邏輯器件和一塊外圍I2C從設(shè)備TMPl01來驗(yàn)證。本課題的最終目的是可編程邏輯器件實(shí)現(xiàn)的8051核成功并高效地控制擴(kuò)展的12C接口與從設(shè)備TMPl01通信。 用EP2C35F672C6芯片開發(fā)的12C接口,數(shù)據(jù)的傳輸速率由該芯片嵌入8051微處理的時(shí)鐘頻率決定。經(jīng)測(cè)試其傳輸速率可達(dá)普通速率和快速速率。 目前集成了該12C接口的8051核已經(jīng)在工作中投入使用,主要用于POS設(shè)備的用戶數(shù)據(jù)加密及對(duì)設(shè)備溫度的實(shí)時(shí)控制。雖然該設(shè)備尚未大批量投產(chǎn),但它已成功通過PCI(PaymentCardIndustry)協(xié)會(huì)認(rèn)證。

    標(biāo)簽: FPGA 8051 I2C 內(nèi)核

    上傳時(shí)間: 2013-06-18

    上傳用戶:731140412

  • TS流復(fù)用器及其接口

    在數(shù)字電視系統(tǒng)中,MPEG-2編碼復(fù)用器是系統(tǒng)傳輸?shù)暮诵沫h(huán)節(jié),所有的節(jié)目、數(shù)據(jù)以及各種增值服務(wù)都是通過復(fù)用打包成傳輸流傳輸出去。目前,只有少數(shù)公司掌握復(fù)用器的核心算法技術(shù),能夠采用MPEG-2可變碼率統(tǒng)計(jì)復(fù)用方法提高帶寬利用率,保證高質(zhì)量圖像傳輸。由于目前正處廣播電視全面向數(shù)字化過渡期間,市場(chǎng)潛力巨大,因此對(duì)復(fù)用器的研究開發(fā)非常重要。本文針對(duì)復(fù)用器及其接口技術(shù)進(jìn)行研究并設(shè)計(jì)出成形產(chǎn)品。 文中首先對(duì)MPEG-2標(biāo)準(zhǔn)及NIOS Ⅱ軟核進(jìn)行分析。重點(diǎn)研究了復(fù)用器中的部分關(guān)鍵技術(shù):PSI信息提取及重構(gòu)算法、PID映射方法、PCR校正及CRC校驗(yàn)算法,給出了實(shí)現(xiàn)方法,并通過了硬件驗(yàn)證。然后對(duì)復(fù)用器中主要用到的AsI接口和DS3接口進(jìn)行了分析與研究,給出了設(shè)計(jì)方法,并通過了硬件驗(yàn)證。 本文的主要工作如下: ●首先對(duì)復(fù)用器整體功能進(jìn)行詳細(xì)分析,并劃分軟硬件各自需要完成的功能。給出復(fù)用器的整體方案以及ASI接口和DS3接口設(shè)計(jì)方案。 ●在FPGA上采用c語言實(shí)現(xiàn)了PSI信息提取與重構(gòu)算法。 ●給出了實(shí)現(xiàn)快速的PID映射方法,并根據(jù)FPGA特點(diǎn)給出一種新的PID映射方法,減少了邏輯資源的使用,提高了穩(wěn)定性。 ●采用Verilog設(shè)計(jì)了SI信息提取與重構(gòu)的硬件平臺(tái),并用c語言實(shí)現(xiàn)了SDT表的提取與重構(gòu)算法,在FPGA中成功實(shí)現(xiàn)了動(dòng)態(tài)分配內(nèi)存空間。 ●在FPGA上實(shí)現(xiàn)了.ASI接口,主要分析了位同步的實(shí)現(xiàn)過程,實(shí)現(xiàn)了一種新的快速實(shí)現(xiàn)字節(jié)同步的設(shè)計(jì)。 ●在FPGA上實(shí)現(xiàn)了DS3接口,提出并實(shí)現(xiàn)了一種兼容式DS3接口設(shè)計(jì)。并對(duì)幀同步設(shè)計(jì)進(jìn)行改進(jìn)。 ●完成部分PCB版圖設(shè)計(jì),并進(jìn)行調(diào)試監(jiān)測(cè)。 本復(fù)用器設(shè)計(jì)最大特點(diǎn)是將軟件設(shè)計(jì)和硬件設(shè)計(jì)進(jìn)行合理劃分,硬件平臺(tái)及接口采用Verilog語言實(shí)現(xiàn),PSI信息算法主要采用c語言實(shí)現(xiàn)。這種軟硬件的劃分使系統(tǒng)設(shè)計(jì)更加靈活,且軟件設(shè)計(jì)與硬件設(shè)計(jì)可同時(shí)進(jìn)行,極大的提高了工作效率。 整個(gè)項(xiàng)目設(shè)計(jì)采用verilog和c兩種語言完成,采用Altera公司的FPGA芯片EP1C20,在Quartus和NIOS IDE兩種設(shè)計(jì)平臺(tái)下設(shè)計(jì)實(shí)現(xiàn)。根據(jù)此方案已經(jīng)開發(fā)出兩臺(tái)帶有ASI和DS3接口的數(shù)字電視TS流復(fù)用器,經(jīng)測(cè)試達(dá)到了預(yù)期的性能和技術(shù)指標(biāo)。

    標(biāo)簽: TS流 復(fù)用器 接口

    上傳時(shí)間: 2013-06-10

    上傳用戶:01010101

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