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發(fā)現(xiàn)

資料壓縮技術(shù)與應用-變動長度編碼壓縮及解壓縮(Run Length Encoding) 整數(shù)採用固定長度一個位元組表示法對於只出現(xiàn)一次的位元組S亦用iS取代

資料壓縮技術(shù)與應用-變動長度編碼壓縮及解壓縮(Run Length Encoding) 整數(shù)採用固定長度一個位元組表示法對於只出現(xiàn)一次的位元組S亦用iS取代

標簽： Encoding Length Run 表示法

上傳時間： 2016-08-15

上傳用戶：GavinNeko
資料壓縮技術(shù)與應用-變動長度編碼壓縮(Run Length Encoding)~ 整數(shù)採用固定長度一個位元組表示法~ 對於只出現(xiàn)一次的位元組S亦用iS取代~

資料壓縮技術(shù)與應用-變動長度編碼壓縮(Run Length Encoding)~ 整數(shù)採用固定長度一個位元組表示法~ 對於只出現(xiàn)一次的位元組S亦用iS取代~

標簽： Encoding Length Run 表示法

上傳時間： 2016-08-15

上傳用戶：asdfasdfd
鍵盤掃描ｖｅｒｉｌｏｇ硬體驗證可以將開發(fā)版鍵盤功能使用

鍵盤掃描ｖｅｒｉｌｏｇ硬體驗證可以將開發(fā)版鍵盤功能使用

標簽： 鍵盤

上傳時間： 2013-12-24

上傳用戶：
ｖｅｒｉｌｏｇ實現(xiàn)算術(shù)運算後利用7段顯示器將結(jié)果輸出

ｖｅｒｉｌｏｇ實現(xiàn)算術(shù)運算後利用7段顯示器將結(jié)果輸出

標簽：

上傳時間： 2014-01-05

上傳用戶：牛布牛
自行開發(fā)的簡單FLASH動畫

自行開發(fā)的簡單FLASH動畫，透過簡單的音樂及畫面可以了解到藝術(shù)的氣息，且容易修改

標簽： FLASH

上傳時間： 2013-12-23

上傳用戶：小儒尼尼奧
使用Verilog HDL 實現(xiàn)AES硬體加解密

使用Verilog HDL 實現(xiàn)AES硬體加解密

標簽： Verilog HDL AES 加解密

上傳時間： 2016-08-25

上傳用戶：gdgzhym
使用windows csp 簽發(fā)2048 bits 憑證

使用windows csp 簽發(fā)2048 bits 憑證

標簽： windows 2048 bits csp

上傳時間： 2013-12-24

上傳用戶：yimoney
實現(xiàn)一套網(wǎng)路TCP/IP的嵌入式系統(tǒng)測試程式...希望可以在多平臺下運行

實現(xiàn)一套網(wǎng)路TCP/IP的嵌入式系統(tǒng)測試程式...希望可以在多平臺下運行

標簽： TCP IP 嵌入式系統(tǒng)

上傳時間： 2016-09-23

上傳用戶：xsnjzljj
嵌入式系統(tǒng)的上課講義...使用三星的開發(fā)版...主要是吃ARM的指令集

嵌入式系統(tǒng)的上課講義...使用三星的開發(fā)版...主要是吃ARM的指令集

標簽： ARM 嵌入式三星系統(tǒng)

上傳時間： 2014-12-07

上傳用戶：qb1993225
LCD12864驅(qū)動開發(fā)于KeilC51 非常實用

LCD12864驅(qū)動開發(fā)于KeilC51 非常實用

標簽： 12864 KeilC LCD 51

上傳時間： 2014-01-08

上傳用戶：hongmo