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硬件設(shè)計

  • STM32硬件設(shè)計注意事項

    STM32硬件設(shè)計注意事項

    標(biāo)簽: STM 32 硬件設(shè)計 注意事項

    上傳時間: 2013-05-16

    上傳用戶:eeworm

  • STM32硬件設(shè)計問答 超清書簽版

    STM32硬件設(shè)計問答 超清書簽版

    標(biāo)簽: STM 32 硬件設(shè)計 問答

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • 嵌入式系統(tǒng)硬件設(shè)計

    嵌入式系統(tǒng)硬件設(shè)計

    標(biāo)簽: 嵌入式系統(tǒng) 硬件設(shè)計

    上傳時間: 2013-06-07

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  • 硬件設(shè)計中一些術(shù)語的簡稱 pdf版

    硬件設(shè)計中一些術(shù)語的簡稱 pdf版

    標(biāo)簽: 硬件設(shè)計 術(shù)語

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • 硬件設(shè)計中一些術(shù)語的簡稱-4頁-0.1M-pdf版.pdf

    專輯類-實用電子技術(shù)專輯-385冊-3.609G 硬件設(shè)計中一些術(shù)語的簡稱-4頁-0.1M-pdf版.pdf

    標(biāo)簽: M-pdf 0.1 硬件設(shè)計

    上傳時間: 2013-06-12

    上傳用戶:myworkpost

  • 嵌入式系統(tǒng)硬件設(shè)計-329頁-17.2M.pdf

    專輯類-單片機專輯-258冊-4.20G 嵌入式系統(tǒng)硬件設(shè)計-329頁-17.2M.pdf

    標(biāo)簽: 17.2 329 嵌入式系統(tǒng)

    上傳時間: 2013-07-22

    上傳用戶:fff4444

  • 硬件設(shè)計.rar

    英文版的硬件設(shè)計資料,是不錯的硬件方面軍學(xué)習(xí)資料.

    標(biāo)簽: 硬件設(shè)計

    上傳時間: 2013-07-05

    上傳用戶:qsbbear

  • USB2.0硬件設(shè)計.rar

    USB2.0硬件設(shè)計.pdf,8.06M,342頁

    標(biāo)簽: USB 2.0 硬件設(shè)計

    上傳時間: 2013-05-20

    上傳用戶:大融融rr

  • 基于FPGA的對象存儲控制器原型的硬件設(shè)計與實現(xiàn).rar

    本文對基于FPGA的對象存儲控制器原型的硬件設(shè)計進(jìn)行了研究。主要內(nèi)容如下: ⑴研究了對象存儲控制器的硬件設(shè)計,使其高效完成對象級接口的智能化管理和復(fù)雜存儲協(xié)議的解析,對對象存儲系統(tǒng)整體性能提升有重要意義。基于SoPC(片上可編程系統(tǒng))技術(shù),在FPGA(現(xiàn)場可編程門陣列)上實現(xiàn)的對象存儲控制器,具有功能配置靈活,調(diào)試方便,成本較低等優(yōu)點。 ⑵采用Cyclone II器件實現(xiàn)的對象存儲控制器的網(wǎng)絡(luò)接口,包含處理器模塊、內(nèi)存模塊、Flash模塊等核心組成部分,提供千兆以太網(wǎng)的網(wǎng)絡(luò)接口和PCI(周邊元件擴展接口)總線的主機接口,還具備電源模塊、時鐘模塊等以保證系統(tǒng)正常運行。在設(shè)計實現(xiàn)PCB(印制電路板)時,從疊層設(shè)計、布局、布線、阻抗匹配等多方面解決高達(dá)100MHz的全局時鐘帶來的信號完整性問題,并基于IBIS模型進(jìn)行了信號完整性分析及仿真。針對各功能模塊提出了相應(yīng)的調(diào)試策略,并完成了部分模塊的調(diào)試工作。 ⑶提出了基于Virtex-4的對象存儲控制器系統(tǒng)設(shè)計方案,Virtex-4內(nèi)嵌PowerPC高性能處理器,可更好地完成對象存儲設(shè)備相關(guān)的控制和管理工作。實現(xiàn)了豐富的接口設(shè)計,包括千兆以太網(wǎng)、光纖通道、SATA(串行高級技術(shù)附件)等網(wǎng)絡(luò)存儲接口以及較PCI性能更優(yōu)異的PCI-X(并連的PCI總線)主機接口;提供多種FPGA配置方式。使用Cadence公司的Capture CIS工具完成了該系統(tǒng)硬件的原理圖繪制,通過了設(shè)計規(guī)則檢查,生成了網(wǎng)表用作下一步設(shè)計工作的交付文件。

    標(biāo)簽: FPGA 對象存儲 原型

    上傳時間: 2013-04-24

    上傳用戶:lijinchuan

  • 基于DSPFPGA的圖像處理電路板硬件設(shè)計.rar

    波前處理機是自適應(yīng)光學(xué)系統(tǒng)中實時信號處理和運算的核心,隨著自適應(yīng)光學(xué)系統(tǒng)得發(fā)展,波前傳感器的采樣頻率越來越高,這就要求波前處理機必須有更強的數(shù)據(jù)處理能力以保證系統(tǒng)的實時性。在整個波前處理機的工作流程中,對CCD傳來的實時圖像數(shù)據(jù)進(jìn)行實時處理是第一步,也是十分重要的一步。如果不能保證圖像處理的實時性,那么后續(xù)的處理過程都無從談起。因此,研制高性能的圖像處理平臺,對波前處理機性能的提高具有十分重要的意義。 論文介紹了本研究課題的背景以及國內(nèi)外圖像處理技術(shù)的應(yīng)用和發(fā)展?fàn)顩r,接著介紹了傳統(tǒng)的專用和通用圖像處理系統(tǒng)的結(jié)構(gòu)、特點和模型,并通過分析DSP芯片以及DSP系統(tǒng)的特點,提出了基于DSP和FPGA芯片的實時圖像處理系統(tǒng)。該系統(tǒng)不同于傳統(tǒng)基于PC機模式的圖像處理系統(tǒng),發(fā)揮了DSP和FPGA兩者的優(yōu)勢,能更好地提高圖像處理系統(tǒng)實時性能,同時也最大可能地降低成本。 論文根據(jù)圖像處理系統(tǒng)的設(shè)計目的、應(yīng)用需求確定了器件的選型。介紹了主要的器件,接著從系統(tǒng)架構(gòu)、邏輯結(jié)構(gòu)、硬件各功能模塊組成等方面詳細(xì)介紹了DSP+FPGA圖像處理系統(tǒng)硬件設(shè)計,并分析了包括各種參數(shù)指標(biāo)選擇、連接方式在內(nèi)的具體設(shè)計方法以及應(yīng)該注意的問題。 論文在闡述傳輸線理論的基礎(chǔ)上,在制作PCB電路板的過程中,針對高速電路設(shè)計中易出現(xiàn)的問題,詳細(xì)分析了高速PCB設(shè)計中的信號完整性問題,包括反射、串?dāng)_等,說明了高速PCB的信號完整性、電源完整性和電磁兼容性問題及其解決方法,進(jìn)行了一定的理論和技術(shù)探討和研究。 論文還介紹了基于FPGA的邏輯設(shè)計,包括了圖像采集模塊的工作原理、設(shè)計方案和SDRAM控制器的設(shè)計,介紹了SDRAM的基本操作和工作時序,重點闡述系統(tǒng)中可編程器件內(nèi)部模塊化SDRAM控制器的設(shè)計及仿真結(jié)果。 論文最后描述了硬件系統(tǒng)的測試及調(diào)試流程,并給出了部分的調(diào)試結(jié)果。 該系統(tǒng)主要優(yōu)點有:實時性、高速性。硬件設(shè)計的執(zhí)行速度,在高速DSP和FPGA中實現(xiàn)信號處理算法程序,保證了系統(tǒng)實時性的實現(xiàn);性價比高。自行研究設(shè)計的電路及硬件系統(tǒng)比較好的解決了高速實時圖像處理的需求。

    標(biāo)簽: DSPFPGA 圖像處理 電路板

    上傳時間: 2013-05-30

    上傳用戶:fxf126@126.com

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