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穩(wěn)壓電路

  • 基于N溝道MOS管H橋驅動電路設計與制作

    基于N溝道MOS管H橋驅動電路設計與制作

    標簽: MOS N溝道 H橋驅動 電路設計

    上傳時間: 2014-08-01

    上傳用戶:1109003457

  • 微電腦型數學演算式隔離傳送器

    特點: 精確度0.1%滿刻度 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設計 尺寸小,穩定性高

    標簽: 微電腦 數學演算 隔離傳送器

    上傳時間: 2014-12-23

    上傳用戶:ydd3625

  • 用ADC0832設計的兩路電壓表

    用ADC0832設計的兩路電壓表1 源代碼

    標簽: 0832 ADC 電壓表

    上傳時間: 2014-01-05

    上傳用戶:momofiona

  • 多路模擬信號采集器

    這是多路模擬信號采集器,歡迎大家下載觀看

    標簽: 多路 模擬信號 采集器

    上傳時間: 2013-12-09

    上傳用戶:wfl_yy

  • 多路復用器、模擬開關設計指南

    多路復用器、模擬開關設計指南

    標簽: 多路復用器 模擬開關 設計指南

    上傳時間: 2013-11-22

    上傳用戶:guojin_0704

  • 采用歸零法的N進制計數器原理

    計數器是一種重要的時序邏輯電路,廣泛應用于各類數字系統中。介紹以集成計數器74LS161和74LS160為基礎,用歸零法設計N進制計數器的原理與步驟。用此方法設計了3種36進制計數器,并用Multisim10軟件進行仿真。計算機仿真結果表明設計的計數器實現了36進制計數的功能。基于集成計數器的N進制計數器設計方法簡單、可行,運用Multisim 10進行電子電路設計和仿真具有省時、低成本、高效率的優越性。

    標簽: 歸零法 N進制計數器原

    上傳時間: 2013-10-11

    上傳用戶:gtzj

  • p-n結的隧道擊穿模型研究

    在理論模型的基礎上探討了電子勢壘的形狀以及勢壘形狀隨外加電壓的變化, 并進行定量計算, 得出隧穿電壓隨雜質摻雜濃度的變化規律。所得結論與硅、鍺p-n 結實驗數據相吻合, 證明了所建立的理論模型在定量 研究p-n 結的隧道擊穿中的合理性與實用性。該理論模型對研究一般材料或器件的隧道擊穿具有重要的借鑒意義。

    標簽: p-n 隧道 擊穿 模型研究

    上傳時間: 2013-10-31

    上傳用戶:summery

  • 振蕩電路的設計-實用電子路

    振蕩電路的設計-實用電子路

    標簽: 振蕩電路 電子

    上傳時間: 2013-11-02

    上傳用戶:moerwang

  • 20路單個依次流水燈電路圖設計

    通過NE555的巧妙使用,構成的以NE555和CD40017為一體的二十路流水燈

    標簽: 流水燈 電路圖設計

    上傳時間: 2013-10-26

    上傳用戶:lalaruby

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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