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CDMA技術(shù)是當(dāng)前無線電通信，尤其是移動(dòng)通信的主要技術(shù)，不論是在中國(guó)已經(jīng)建立的IS-95規(guī)范的中國(guó)聯(lián)通CDMA網(wǎng)、各大移動(dòng)通信運(yùn)營(yíng)商正準(zhǔn)備實(shí)驗(yàn)及建立第三代(3G)系統(tǒng)還是大設(shè)備研發(fā)商已經(jīng)在開發(fā)的三代以后(也稱為4G)更寬帶寬的移動(dòng)通信系統(tǒng)，CDMA都是主要的選擇。CDMA概念可以簡(jiǎn)單地解釋為基于擴(kuò)頻通信的調(diào)制和多址接入方案。其反向鏈路有接入信道和反向業(yè)務(wù)信道組成。接入信道用于短信令消息交換、能提供呼叫來源、尋呼響應(yīng)、指令和注冊(cè)。 本設(shè)計(jì)選取CDMA通信系統(tǒng)中的接入信道部分進(jìn)行仿真與分析。首先，通過學(xué)習(xí)相應(yīng)的理論知識(shí)，熟悉接入信道實(shí)現(xiàn)的過程，對(duì)每一步的原理有了較深的理解，同時(shí)，也對(duì)MATALB軟件進(jìn)行熟悉和了解，對(duì)MATLAB軟件中的SIMULINK部分及其內(nèi)部的CDMA模塊用法和參數(shù)設(shè)置進(jìn)行熟悉，然后運(yùn)用MATLAB軟件對(duì)接入信道部分進(jìn)行設(shè)計(jì)，并逐步地對(duì)各個(gè)模塊進(jìn)行分析、仿真與驗(yàn)證。目的是通過畢業(yè)設(shè)計(jì)工作熟悉現(xiàn)代無線通信系統(tǒng)的基本構(gòu)成與基本工作原理，重點(diǎn)掌握卷積編碼、塊交織和碼擴(kuò)展等相關(guān)編碼技術(shù)，并能將這些技術(shù)應(yīng)用實(shí)際系統(tǒng)設(shè)計(jì)，提高自己對(duì)CDMA通信系統(tǒng)知識(shí)的認(rèn)識(shí)。 關(guān)鍵字：CRC;卷積編碼;塊重復(fù);交織;長(zhǎng)碼;沃爾什;PN序列
標(biāo)簽： CDMA 通信系統(tǒng) 接入信道 仿真
上傳時(shí)間： 2013-11-02
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S7-200.仿真軟件(非官方)
上傳時(shí)間： 2013-10-27
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GX Simulator6-C中文版仿真軟件
上傳時(shí)間： 2013-10-30
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溫濕度傳感器 sht11 仿真程序 sbit out =P3^0; //加熱口 //sbit input =P1^1;//檢測(cè)口 //sbit speek =P2^0;//報(bào)警 sbit clo =P3^7;//時(shí)鐘 sbit ST =P3^5;//開始 sbit EOC =P3^6;//成功信號(hào) sbit gwei =P3^4;//個(gè)位 sbit swei =P3^3;//十位 sbit bwei =P3^2;//百位 sbit qwei =P3^1;//千位 sbit speak =P0^0;//報(bào)警音 sbit bjled =P0^1;//報(bào)警燈 sbit zcled =P0^2;//正常LED int count; uchar xianzhi;//取轉(zhuǎn)換結(jié)果 uchar seth;//高時(shí)間 uchar setl;//低時(shí)間 uchar seth_mi;//高時(shí)間 uchar setl_mi;//低時(shí)間 bit hlbz;//高低標(biāo)志 bit clbz; bit spbz; ///定時(shí)中斷程序/// void t0 (void) interrupt 1 using 0 { TH0=(65536-200)/256;//5ms*200=1000ms=1s TL0=(65536-200)%256; clo=!clo;//產(chǎn)生時(shí)鐘 if(count>5000) { if(hlbz) { if(seth_mi==0){seth_mi=seth;hlbz=0;out=0;} else seth_mi--; } if(!hlbz) { if(setl_mi==0){setl_mi=setl;hlbz=1;out=1;} else setl_mi--; } count=0; } else count++; } ///////////// ///////延時(shí)/////// delay(int i) { while(--i); } ///////顯示處理/////// xianshi() { int abcd=0; int i; for (i=0;i<5;i++) { abcd=xianzhi; gwei=1; swei=1; bwei=1; qwei=1; P1=dispcode[abcd/1000]; qwei=0; delay(70); qwei=1; abcd=abcd%1000; P1=dispcode[abcd/100]; bwei=0; delay(70); bwei=1; abcd=abcd%100; P1=dispcode[abcd/10]; swei=0; delay(70); swei=1; abcd=abcd%10; P1=dispcode[abcd]; gwei=0; delay(70); gwei=1; } } doing() { if(xianzhi>100) {bjled=0;speak=1;zcled=1;} else {bjled=1;speak=0;zcled=0;} } void main(void) { seth=60;//h60秒 setl=90;//l90秒 seth_mi=60;//h60秒 setl_mi=90;//l90秒 TMOD=0X01;//定時(shí)0 16位工作模式 TH0=(65536-200)/256; TL0=(65536-200)%256; TR0=1; //開始計(jì)時(shí) ET0=1; //開定時(shí)0中斷 EA=1; //開全中斷 while(1) { ST=0; _nop_(); ST=1; _nop_(); ST=0; // EOC=0; xianshi(); while(!EOC) { xianshi(); } xianzhi=P2; xianshi(); doing(); } }
上傳時(shí)間： 2013-10-16
上傳用戶：黃蛋的蛋黃
西門子s7-200仿真軟件漢化版
上傳時(shí)間： 2013-11-05
上傳用戶：lingfei
proteuse仿真軟件
標(biāo)簽： EDA_Proteus_HA_proteuse 仿真軟件
上傳時(shí)間： 2013-10-16
上傳用戶：x4587
摘要：?jiǎn)纹瑱C(jī)學(xué)習(xí)包括理論與實(shí)踐學(xué)習(xí)， 而實(shí)踐學(xué)習(xí)所占比例相對(duì)較多、 硬件投入大 ，在實(shí)踐學(xué)習(xí)中需要大量的實(shí)驗(yàn)儀器和設(shè)備 在具體的工程實(shí)踐中 如果因?yàn)榉桨赣姓`而進(jìn)行相應(yīng)的開發(fā)設(shè)計(jì) 會(huì)浪費(fèi)較多的時(shí)間和經(jīng)費(fèi) 一般的單位或個(gè)人由于沒有較多的經(jīng)費(fèi)投入導(dǎo)致實(shí)踐學(xué)習(xí)環(huán)節(jié)比較薄弱 提出一種新的思路 較為全面地闡述采用軟件仿真實(shí)驗(yàn)的方法。
標(biāo)簽： Proteus Keil 單片機(jī) 虛擬仿真平臺(tái)
上傳時(shí)間： 2014-01-06
上傳用戶：逗逗666
ALTERA公司：用ModelSimSE進(jìn)行功能仿真和時(shí)序仿真的方法(ALTERA篇)之學(xué)習(xí)筆記
標(biāo)簽： ModelSimSE 時(shí)序仿真
上傳時(shí)間： 2013-12-24
上傳用戶：ch3ch2oh
IP核生成文件：（Xilinx/Altera 同） IP核生成器生成 ip 后有兩個(gè)文件對(duì)我們比較有用，假設(shè)生成了一個(gè) asyn_fifo 的核，則asyn_fifo.veo 給出了例化該核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是該核的行為模型，主要調(diào)用了 xilinx 行為模型庫的模塊，仿真時(shí)該文件也要加入工程。（在 ISE中點(diǎn)中該核，在對(duì)應(yīng)的 processes 窗口中運(yùn)行“ View Verilog Functional Model ”即可查看該 .v 文件）。如下圖所示。
上傳時(shí)間： 2013-11-02
上傳用戶：誰偷了我的麥兜
很不容易找到，免費(fèi)給大家提供下載了。PMA，仿真各種規(guī)約，在沒有實(shí)際裝置的情況下軟件仿真以調(diào)試規(guī)約程序。
上傳時(shí)間： 2013-11-06
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