本設計的基本要求是以復雜可編程邏輯器件CPLD為基礎，通過在EDA系統軟件ispDesignExpert System 環境下進行數字系統設計，熟練掌握該環境下的功能仿真，時間仿真，管腳鎖定和芯片下載。 本系統基本上比較全面的模擬了計數式數字頻率計，廣泛應用于工業、民用等各個領域，具有一定的開發價值。
標簽： CPLD 可編程邏輯器件
上傳時間： 2015-01-11
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嵌入式可編程器件CPLD的典型實例 壓縮包，共計43個源碼文件。 使用ALTERA的 Muxplus 軟件即可編輯仿真 相關軟件可在教育網ftp下載[天網查詢，有很多站點提供]
標簽： CPLD 嵌入式 可編程器件 典型
上傳時間： 2015-01-14
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