矩陣中的每一個元素稱為像元、像素或圖像元素。而g(i, j)代表(i, j)點的灰度值，即亮度值。 由于g (i, j)代表該點圖像的光強度（亮度），而光是能量的一種形式，故g (i, j)必須大于零，且為有限值，即： 0＜=g (i, j)＜2n。 用g (i, j)的數值來表示(i, j)位置點上灰度級值的大小，即只反映了黑白灰度的關系。 數字化采樣一般是按正方形點陣取樣的，
上傳時間： 2013-12-22
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在信息信號處理過程中，如對信號的過濾、檢測、預測等，都要使用濾波器，數字濾波器是數字信號處理（DSP，DigitalSignalProcessing）中使用最廣泛的一種器件。常用的濾波器有無限長單位脈沖響應（ⅡR）濾波器和有限長單位脈沖響應（FIR）濾波器兩種[1]，其中，FIR濾波器能提供理想的線性相位響應，在整個頻帶上獲得常數群時延從而得到零失真輸出信號，同時它可以采用十分簡單的算法實現，這兩個優點使FIR濾波器成為明智的設計工程師的首選，在采用VHDL或VerilogHDL等硬件描述語言設計數字濾波器時，由于程序的編寫往往不能達到良好優化而使濾波器性能表現一般。而采用調試好的IPCore需要向Altera公司購買。筆者采用了一種基于DSPBuilder的FPGA設計方法，使FIR濾波器設計較為簡單易行，并能滿足設計要求。
上傳時間： 2014-01-21
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交流電橋的電路結構中，由電阻、電抗元件或 它們的組合構成四臂，并用檢流計、耳機或其它儀器作為檢驗電橋是否平衡的“示零器”．利用交流電橋的平衡條件進行測量，這就是它的基本原理．
上傳時間： 2014-01-22
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輸入信號五個基于瞬時信息的特征：零中心歸一化瞬時幅度功率譜密度的最大值,零中心歸一化瞬時幅度絕對值的標準偏差，零中心非弱信號段瞬時相位非線性分量絕對值標準偏差，零中心非弱信號段瞬時相位非線性分量標準偏差，零中心歸一化的非弱信號段瞬時頻率絕對值的標準偏差，得到識別出的信號類別，本例為2PSK, 4PSK, GMSK, OQPSK, pi/4DQSK中的一個，還可以看Art網絡的擴展性。
上傳時間： 2015-09-20
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基于小波零樹特性的視覺感知度模型的優化方案, 給出了兩種水印算法: 一種算法嵌入的是高斯序列水印, 通過相關檢測實現盲檢測 另一種算法嵌入的是二值圖像水印, 水印的提取是非盲提取。這兩種算法在所有重要小波系數( 包括最低頻系數) 中嵌入水印, 以達到最大化水印嵌入量的目的, 并結合感知度模型在水印的透明性和魯棒性之間實現了較好的平衡, 對于常見的圖像處理操作, 特別是對于JPEG 和小波壓縮均有較好的魯棒性。
上傳時間： 2015-09-27
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DS-CDMA中匹配濾波器誤碼率分析，只是一直為零，感覺沒有錯阿。
上傳時間： 2013-12-19
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本程序中得到的收端OFDM信號的頻譜波形，是與其發端信號的排步有關的。在發端的 ％ 載波安排上，128個載波有前后各32個載波是null載波(如果這前后各32各載波是帶外頻段， ％ 那么理論上它們都應該是零！)，中間的64個載波是數據載波。這樣的排步很明顯就是一個 ％ 兩邊低，中間高的頻譜形式。所以，收端也應該是這個輪廓。
上傳時間： 2015-11-02
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:杭抵賴的簽密方案在一些應用中有重要的價值.已有的方案如認證加密方案和簽密方案在解決簽名者事 后抵賴的問題時，必須把恢復的消息提供給第三方，從消息的保密方面看，效果并不理想.墓于離散對數問題提出 了安全有效的指定接收者恢復消息的杭抵賴數字簽名體制，其特點是只有指定接收者才可以恢復消息，任何人可 以驗證簽名的合法性，在解決簽名者事后抵賴的問題中克服了已有方案的缺陷，不需要簽名者的合作、不需要向第 三方提供恢復的消息、不需要與第三方執行交互的零知識證明，在保持恢復消息秘密的同時能揭穿簽名者的抵賴 行為.同時把該方案擴充到了指定的一群接收者恢復消息的抗抵賴的多重簽名的情形.
上傳時間： 2015-11-21
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鏈接指針：指出下一個到達進程的進程控制塊首地址。按照進程到達的順序排隊。系統設置一個隊頭和隊尾指針分別指向第一個和最后一個進程。新生成的進程放隊尾。 估計運行時間、到達時間以及進程狀態一第一題中相同。 （2）為每個進程任意確定一個要求運行時間和到達時間。 （3）按照進程到達的先后順序排成一個循環隊列。再設一個隊首指針指向第一個到達進程的首址。 （4）執行處理機調度時，開始選擇隊首的第一個進程運行。另外再設一個當前運行進程指針，指向當前正在運行的進程。 （5）由于本實驗是模擬實驗，所以對被選中進程并不實際啟動運行，而只是執行：估計運行時間減1、輸出當前運行進程的名字。用這兩個操作來模擬進程的一次運行。 （6）進程運行一次后，以后的調度則將當前指針依次下移一個位置，指向下一個進程，即調整當前運行指針指向該進程的鏈接指針所指進程，以指示應運行進程。同時還應判斷該進程的剩余運行時間是否為零。若不為零，則等待下一輪的運行；若該進程的剩余運行時間為零，則將該進程的狀態置為完成態C，并退出循環隊列。 （7）若就緒隊列不為空，則重復上述的步驟（5）和（6），直到所有進程都運行完為止。
上傳時間： 2013-12-19
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利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器（數碼管）之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用VHDL語言實現。這樣設計具有體積小、設計周期短（設計過程中即可實現時序仿真）、調試方便、故障率低、修改升級容易等特點。 本設計采用自頂向下、混合輸入方式（原理圖輸入—頂層文件連接和VHDL語言輸入—各模塊程序設計）實現數字鐘的設計、下載和調試。 一、 功能說明 已完成功能 1. 完成秒／分／時的依次顯示并正確計數； 2. 秒／分／時各段個位滿10正確進位，秒／分能做到滿60向前進位； 3. 定時鬧鐘：實現整點報時，又揚聲器發出報時聲音； 4. 時間設置，也就是手動調時功能：當認為時鐘不準確時，可以分別對分／時鐘進行調整； 5. 利用多余兩位數碼管完成秒表顯示：A、精度達10ms；B、可以清零；C、完成暫停 可以隨時記時、暫停后記錄數據。 待改進功能： 1. 鬧鐘只是整點報時，不能手動設置報時時間，遺憾之一； 2. 秒表不能向秒進位，也就是最多只能記時100ms； 3. 秒表暫停記錄數據后不能在原有基礎上繼續計時，而是復位重新開始。 【注意】秒表為后來添加功能，所以有很多功能不成熟！
上傳時間： 2014-01-02
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