摘要：介紹了基于可編程邏輯器件CPLD和直接數(shù)字頻率合成技術(shù)（DDS）的三相多波形函數(shù)發(fā)生器的基本原理，并在此基礎(chǔ)上給出了基于CPLD的各模塊設(shè)計(jì)方法及其VHDL源程序
標(biāo)簽： CPLD DDS 可編程邏輯器件 三相
上傳時(shí)間： 2015-10-28
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全角和半角字符之間的轉(zhuǎn)換源碼。目前只實(shí)現(xiàn)單個(gè)字符的判斷和轉(zhuǎn)換，對(duì)全無(wú)判斷、轉(zhuǎn)換可在此基礎(chǔ)上完善。
標(biāo)簽： 字符 轉(zhuǎn)換 源碼
上傳時(shí)間： 2013-12-16
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一種由可編程邏輯器件集成的數(shù)字濾波器的設(shè)計(jì)
標(biāo)簽： 可編程邏輯器件 集成 數(shù)字濾波器
上傳時(shí)間： 2015-10-30
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以半連續(xù)隱含馬爾可夫模型HMM 為例,分析了影響Viterbi算法效率的主要原因,討論了提高該算法效率的3種實(shí)用策略,即碼本剪枝、Beam剪枝及降低精度,在保證一定識(shí)別率的前提下,使得搜索處理更加有效,提高了搜索的速度
標(biāo)簽： Viterbi Beam HMM 算法
上傳時(shí)間： 2013-12-26
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Lwip協(xié)議與設(shè)計(jì)實(shí)現(xiàn)[繁] 修改自 簡(jiǎn)體版本 修改常用語(yǔ) 等 以方便繁體網(wǎng)友 [chao chi]
標(biāo)簽： Lwip chao chi 修改
上傳時(shí)間： 2015-11-01
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數(shù)字電路的串?dāng)_分析在數(shù)字電路設(shè)計(jì)領(lǐng)域,串?dāng)_是廣為存在的,如PCB板、器件封裝(Package)、連接器(Connector)和連接電纜(Cable)。而且隨著信號(hào)速率的提高和產(chǎn)品外形尺寸越來(lái)越小，數(shù)字系統(tǒng)總的串?dāng)_也急劇增加。過(guò)大的串?dāng)_會(huì)影響到系統(tǒng)的性能,甚至可能引起電路的誤觸發(fā)，導(dǎo)致系統(tǒng)無(wú)法正常工作
標(biāo)簽： Connector Package Cable PCB
上傳時(shí)間： 2015-11-02
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2個(gè)4位二進(jìn)制數(shù)相加的加法器件，其結(jié)果顯示在七段譯碼器中
標(biāo)簽： 二進(jìn)制數(shù) 加法 器件
上傳時(shí)間： 2015-11-04
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一階直線倒立擺的受力分析，應(yīng)用lagrange方法，用mathmatica編制。
標(biāo)簽： 直線 倒立擺 分
上傳時(shí)間： 2013-12-23
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超音波測(cè)距程式，使用於輪式行動(dòng)平臺(tái)（機(jī)器人）本體，本程式可用於避障、導(dǎo)航
標(biāo)簽： 超音波 程式
上傳時(shí)間： 2015-11-06
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本軟件能根據(jù)軋制工藝條件快速準(zhǔn)確地計(jì)算出軋制力，并已經(jīng)通過(guò)實(shí)際檢測(cè)，與實(shí)際值誤差在10％之內(nèi)，建議教學(xué)軋制力時(shí)采用
標(biāo)簽： 軟件 工藝 計(jì)算
上傳時(shí)間： 2015-11-07
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