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  • 基于FPGA的PCIE1接口設(shè)計與實現(xiàn).rar

    隨著現(xiàn)代計算機技術(shù)、微電子技術(shù)的進一步結(jié)合和發(fā)展,可編程邏輯技術(shù)已成為當前電子設(shè)計領(lǐng)域中最具活力和發(fā)展前途的技術(shù)。通過采用FPGA/EDA技術(shù),對通信卡的PCI接口、E1接口、外部邏輯電路進行集成,并利用目前通用計算機強大的數(shù)字信息處理能力,可大大簡化CTI硬件的設(shè)計,降低制造成本,提高系統(tǒng)可靠性。 據(jù)此,本論文提出了基于FPGA/EDA技術(shù)的PCI-E1接口設(shè)計方法,文中對PCI總線接口、E1接口及兩接口的互連等相關(guān)技術(shù)進行了深入分析,對各功能模塊和系統(tǒng)進行了VHDL建模與仿真。 同時,論文還介紹了基于ALTERACyclone系列FPGA芯片的PCI-E1接口硬件平臺的設(shè)計原理和基于DriverWorks的WDM驅(qū)動程序的設(shè)計方法。 本論文涉及的軟件、硬件系統(tǒng)已經(jīng)開發(fā)、調(diào)試完成。測試結(jié)果表明:1、論文所研究的PCI接口(主/從設(shè)備)在進行配置讀/寫、I/O讀寫、存儲器讀寫及總線的猝發(fā)數(shù)據(jù)傳送等操作中,各項性能符合PCI2.3規(guī)范的要求。 2、論文所研究的E1接口支持成幀和不成幀兩種傳輸方式:在成幀模式下,信息的有效傳送速率為31×64Kbit/s;在不成幀的模式下,信息的有效傳送速率為2.048Mbit/s。E1輸出口各項參數(shù)符合CCITT相關(guān)規(guī)范要求。 3、論文所研究的PCI-E1接口在與現(xiàn)網(wǎng)設(shè)備、模塊的對接測試中,性能穩(wěn)定?;诒菊撐牡漠a(chǎn)品已經(jīng)正式發(fā)布。國內(nèi)部分廠家已對該產(chǎn)品進行了多方面的綜合測試,并計劃將其應(yīng)用到實際的生產(chǎn)和研究中。 本論文對于CTI硬件的設(shè)計是一項嘗試和革新。測試和應(yīng)用證明該方法行之有效,符合設(shè)計目標,具有較廣闊的應(yīng)用前景。

    標簽: PCIE1 FPGA 接口設(shè)計

    上傳時間: 2013-06-02

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