使用cordic實(shí)現(xiàn)動(dòng)態(tài)配置以提高FPGA的整體性能的高效算法具體詳解
一篇關(guān)于使用cordic實(shí)現(xiàn)動(dòng)態(tài)配置以提高FPGA的整體性能的高效算法具體詳解,很實(shí)用哦...
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一篇關(guān)于CORDIC的文章A survey of CORDIC algorithms for FPGA based computers...
采用按時(shí)間抽選的基4原位算法和坐標(biāo)旋轉(zhuǎn)數(shù)字式計(jì)算機(jī)(CORDIC)算法實(shí)現(xiàn)了一個(gè)FFT實(shí)時(shí)譜分析系統(tǒng)。整個(gè)設(shè)計(jì)采用流水線工作方式,保證了系統(tǒng)的速度,避免了瓶勁的出現(xiàn);整個(gè)系統(tǒng)采用FPGA實(shí)現(xiàn),實(shí)驗(yàn)表明...
為了滿(mǎn)足現(xiàn)代高速通信中頻率快速轉(zhuǎn)換的需求,基于坐標(biāo)旋轉(zhuǎn)數(shù)字計(jì)算(CORDIC,Coordinate Rotation Digital Computer)算法完成正交直接數(shù)字頻率合成(ODDFS,Ort...
用verilog寫(xiě)的CORDIC算法實(shí)現(xiàn),很適合做超越函數(shù)的運(yùn)算。通常用于實(shí)現(xiàn)正弦乘法,或者坐標(biāo)變換。...
采用按時(shí)間抽選的基4原位算法和坐標(biāo)旋轉(zhuǎn)數(shù)字式計(jì)算機(jī)(CORDIC)算法實(shí)現(xiàn)了一個(gè)FFT實(shí)時(shí)譜分析系統(tǒng)。...
這是實(shí)現(xiàn)cordic算法的一些源程序,各文件的說(shuō)明可以參見(jiàn)文件內(nèi)部注釋。...
這是一個(gè)數(shù)值計(jì)算算法在FPGA中實(shí)現(xiàn)的東東。包括CORDIC算法的詳細(xì)資料還有float型數(shù)的詳細(xì)論述,可供參考。...
CORDIC算法的硬件實(shí)現(xiàn) 用的verilog語(yǔ)言...
用CORDIC算法實(shí)現(xiàn)的2參數(shù)反正切。結(jié)果的精度與CORDIC的迭代次數(shù)有關(guān),迭代次數(shù)越多,精度越高。本例子中精確到小數(shù)點(diǎn)后4位。要提高迭代次數(shù),還得把增加1QN格式的位數(shù),比如32位long,程序多...