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用單鏈表實現(xiàn)對兩個無序 A,B表進行合并并使的合并后的表按從小到大排序
上傳時間： 2013-11-30
上傳用戶：253189838
教師管理系統(tǒng)是在學(xué)校局域網(wǎng)架設(shè)的B/S結(jié)構(gòu)的辦公平臺。系統(tǒng)有四個模塊：系統(tǒng)設(shè)置，通知通告，領(lǐng)導(dǎo)信箱，文件中心。系統(tǒng)開發(fā)環(huán)境：JAVA，數(shù)據(jù)庫為Mysql,TOMCAT
標簽： 管理系統(tǒng) 局域網(wǎng) 模塊
上傳時間： 2013-12-28
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設(shè)A和B是長度相同的2個字符串。A和B的距離定義為相應(yīng)位置字符距離之和。2個非空格字符的距離是它們的ASCII碼之差的絕對值?？崭衽c空格的距離為0；空格與其它字符的距離為一定值k。 字符串A的擴展是在A中插入若干空格字符所產(chǎn)生的字符串。在字符串A和B的所有長度相同的擴展中，有一對距離最小的擴展，該距離稱為字符串A和B的擴展距離。 對于給定的字符串A和B，試設(shè)計一個算法，計算其擴展距離。
上傳時間： 2014-12-22
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回溯（b a c k t r a c k i n g）是一種系統(tǒng)地搜索問題解答的方法。為了實現(xiàn)回溯，首先需要為問題定義一個解空間（ solution space），這個空間必須至少包含問題的一個解（可能是最優(yōu)的）。在迷宮老鼠問題中，我們可以定義一個包含從入口到出口的所有路徑的解空間；在具有n 個對象的0 / 1背包問題中（見1 . 4節(jié)和2 . 2節(jié)），解空間的一個合理選擇是2n 個長度為n 的0 / 1向量的集合，這個集合表示了將0或1分配給x的所有可能方法。當(dāng)n= 3時，解空間為{ ( 0 , 0 , 0 )，( 0 , 1 , 0 )，( 0 , 0 , 1 )，( 1 , 0 , 0 )，( 0 , 1 , 1 )，( 1 , 0 , 1 )，( 1 , 1 , 0 )，( 1 , 1 , 1 ) }。
標簽： 搜索
上傳時間： 2014-01-17
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LCD DRIVER AF-128 B
上傳時間： 2014-12-22
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fbkldfmlb n/ovk,e vml bhdsrb mor brb n/sZPer b vk,epabho,l rnopazbhlrepofrt,epsho
標簽： rnopazbhlrepofrt fbkldfmlb bhdsrb epabho
上傳時間： 2014-01-25
上傳用戶：ANRAN
If we have two individually sorted vectors "a" and "b" but they are not sorted with respect to each other and we want to merge them into vector "c" such that "c" is also a sorted vector. Then c=mergesorted(a,b) can be used.
標簽： sorted individually respect vectors
上傳時間： 2015-09-23
上傳用戶：comua
* "Copyright (c) 2006 Robert B. Reese ("AUTHOR")" * All rights reserved. * (R. Reese, reese@ece.msstate.edu, Mississippi State University) * IN NO EVENT SHALL THE "AUTHOR" BE LIABLE TO ANY PARTY FOR * DIRECT, INDIRECT, SPECIAL, INCIDENTAL, OR CONSEQUENTIAL DAMAGES ARISING OUT * OF THE USE OF THIS SOFTWARE AND ITS DOCUMENTATION, EVEN IF THE "AUTHOR" * HAS BEEN ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
上傳時間： 2015-09-24
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EIA（ELECTRONIC INDUSTRIES ALLIANCE）標準文檔EIA-CEA-861-B，A DTV Profile for Uncompressed High Speed Digital Interfaces。
標簽： ELECTRONIC INDUSTRIES ALLIANCE EIA-CEA
上傳時間： 2015-09-27
上傳用戶：hphh
基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219數(shù)碼管顯示芯片、4X4矩陣鍵盤、TDA2822功放芯片及揚聲器等實現(xiàn)了《電子線路設(shè)計• 測試• 實驗》課程中多功能數(shù)字鐘實驗所要求的所有功能和其它一些擴展功能。包括：基本功能——以數(shù)字形式顯示時、分、秒的時間，小時計數(shù)器為同步24進制，可手動校時、校分；擴展功能——仿廣播電臺正點報時，任意時刻鬧鐘（選做），自動報整點時數(shù)（選做）；其它擴展功能——顯示年月日（能處理大月小月，可手動任意設(shè)置年月日），秒表（包括開始、暫停和清零）。
標簽： Cyclone Verilog Altera 144C
上傳時間： 2015-09-27
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