基于FPGA和PLL的函數信號發生器時鐘部分的實現
標簽： FPGA PLL 函數信號發生器 時鐘
上傳時間： 2013-08-08
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基于Altium Designer 6.0的FPGA開發
標簽： Designer Altium FPGA 6.0
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FPGA開發板原理圖\r\nFPGA開發板原理圖\r\nFPGA開發板原理圖\r\nFPGA開發板原理圖
標簽： FPGA 開發板原理圖
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本實例是學習FPGA的入門程序 希望大家喜歡
標簽： FPGA 程序 家
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FPGA的基礎篇 對初學的有用
標簽： FPGA
上傳時間： 2013-08-09
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FPGA常用設計資料大全，包括FPGA時序設計，軟件使用，和一些源碼
標簽： FPGA 設計資料
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摘要: 本文介紹了基于FPGA 的出租車計價器系統的功能、設計思想和實現, 該設計采用模塊化自上而下的層次化設計,頂\r\n層設計有5 個模塊,各模塊中子模塊采用VHDL 或圖形法設計。在Max+plusⅡ下實現編譯、仿真等,最后成功下載到FPGA 芯\r\n片中。完成了可預置自動計費、自動計程、計時、空車顯示等多功能計價器。由于FPGA 具有高密度、可編程及有強大的軟件\r\n支持等特點,所以該設計具有功能強、靈活和可靠性高等特點,具有一定的實用價值。
標簽： FPGA 出租車計價器 系統設計
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主要實現FPGA和總線模式下的通信可以實現8051對FPGA的讀寫操作
標簽： FPGA 8051 讀寫操作 總線
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開發 FPGA LVDS的通信文檔,pdf格式。應該對你的設計有幫助
標簽： FPGA LVDS 通信
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SAR-GMTI_Range_Compression_Implementation_in_FPGAs\\r\\n\\r\\n在多FPGA陣列上實現SAR距離脈壓，超長點數脈壓的FPGA實現
標簽： FPGA SAR 陣列 脈壓
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