FiFO級(jí)聯(lián),利用verilog語言實(shí)現(xiàn)Xilinx FiFO18單元的多個(gè)級(jí)聯(lián),增大FiFO深度。
標(biāo)簽: FiFO 級(jí)聯(lián)
上傳時(shí)間: 2017-01-28
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操作系統(tǒng)實(shí)驗(yàn) 頁面置換 FiFO LRU 最優(yōu)頁面調(diào)度算法opT
標(biāo)簽: FiFO LRU opT 頁
上傳時(shí)間: 2013-12-23
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一個(gè)用VHDL源碼編寫的先進(jìn)先出(FiFO)緩沖器模塊.可以進(jìn)行FiFO的仿真驗(yàn)證
標(biāo)簽: FiFO VHDL 源碼 模塊
上傳時(shí)間: 2014-02-28
上傳用戶:lunshaomo
另外一個(gè)用VHDL源碼編寫的FiFO模塊程序,可以比較一下和FiFO有什么區(qū)別.
上傳時(shí)間: 2017-02-05
上傳用戶:xlcky
FiFO vhdl源碼,高可靠性,帶有格雷碼同步,有需要可依進(jìn)行參考!
標(biāo)簽: FiFO vhdl 源碼
上傳時(shí)間: 2014-01-20
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EZ-USB的CY7C68013A實(shí)現(xiàn)Slave FiFO的AutoIN。關(guān)鍵配置見TD_Init函數(shù)。
標(biāo)簽: TD_Init EZ-USB 68013A C68013
上傳時(shí)間: 2014-12-01
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VERILOG Synchronous FiFO. 4 x 16 bit words.
標(biāo)簽: Synchronous VERILOG words FiFO
上傳時(shí)間: 2017-02-18
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USB 2.0 FiFO 工作模式 C語言編程 CY7C68013單片機(jī)
標(biāo)簽: C68013 68013 FiFO USB
上傳時(shí)間: 2017-02-19
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FiFO和計(jì)數(shù)器以及時(shí)鐘控制,用于程控交換機(jī)教學(xué),與DSP和ADDA芯片配合完成程控交換機(jī)功能
標(biāo)簽: FiFO 計(jì)數(shù)器 時(shí)鐘控制
上傳時(shí)間: 2013-11-28
FiFO example vhdl code
標(biāo)簽: example FiFO code vhdl
上傳時(shí)間: 2014-11-11
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