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采用verilog HDl 語言實現整形dct算法，設計合理，算法簡單，是紅色邏輯開發板試驗程序，值得一看。
標簽： verilog HDl dct 語言
上傳時間： 2013-12-23
上傳用戶：aeiouetla
Verilog HDl Synthesis, A Practical Primer 學習Verilog HDl一本很不錯的英文書，比較透徹
標簽： Verilog HDl Synthesis Practical
上傳時間： 2016-01-19
上傳用戶：hongmo
verilog HDl 基礎實驗源碼，比較實用
標簽： verilog HDl 基礎實驗 源碼
上傳用戶：lxm
verilog HDl 接口試驗源代碼，比較實用。
標簽： verilog HDl 接口 源代碼
上傳用戶：qiao8960
verilog HDl綜合實驗源代碼，比較實用
標簽： verilog HDl 實驗 源代碼
上傳用戶：tb_6877751
用Verilog HDl寫的數字時鐘,已經在開發板上驗證過的,絕對原創,使用數碼管進行顯示!
標簽： Verilog HDl 數字時鐘 開發板
上傳時間： 2013-12-03
上傳用戶：lnnn30
占用資源少的verilog HDl uart接口；采用固定波特率115200，可以修改程序中的分頻來修改波特率，模式為1個啟始位，8位數據位，1個停止位；帶1字節緩存；當緩存空時輸出空信號
標簽： verilog 115200 uart HDl
上傳時間： 2013-12-28
上傳用戶：kikye
verilog設計練習進階,針對的讀者是 verilog HDl的初學者。
標簽： verilog HDl 進階 初學者
上傳時間： 2014-01-24
上傳用戶：thinode
this is a verilog HDl language referance book , tell you the basic useage of this language.
標簽： language this referance verilog
上傳時間： 2016-02-06
上傳用戶：日光微瀾
Quick Reference for Verilog HDl
標簽： Reference Verilog Quick HDl
上傳時間： 2016-02-08
上傳用戶：時代電子小智
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