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JTAG

JTAG是聯合測試工作組(JointTestActionGroup)的簡稱,是在名為標準測試訪問端口和邊界掃描結構的IEEE的標準1149.1的常用名稱。此標準用于驗證設計與測試生產出的印刷電路板功能。
  • 黑金CYCLONE4 EP4CE6F17C8 FPGA開發板ALTIUM設計硬件工程(原理圖+PCB

    黑金CYCLONE4 EP4CE6F17C8 FPGA開發板ALTIUM設計硬件工程(原理圖+PCB+AD集成封裝庫),Altium Designer 設計的工程文件,包括完整的原理圖及PCB文件,可以用Altium(AD)軟件打開或修改,可作為你產品設計的參考。集成封裝器件型號列表:Library Component Count : 50Name                Description----------------------------------------------------------------------------------------------------1117-3.3            24LC04B_0           4148                BAV99               CAP NP_Dup2CAP NP_Dup2_1       CAP NP_Dup2_2CP2102_0            C_Dup1              C_Dup1_1C_Dup2              C_Dup3              C_Dup4              C_Dup4_1            Circuit Breaker     Circuit BreakerConnector 15        Receptacle Assembly, 15-Pin, Sim Line ConnectorDS1302_8SO          EC                  EP4CE6F17C8         Cyclone IV Family FPGA, 2V Core, 179 I/O Pins, 2 PLLs, 256-Pin FBGA, Speed Grade 8, Commercial GradeEP4CE6F17C8_1       Cyclone IV Family FPGA, 2V Core, 179 I/O Pins, 2 PLLs, 256-Pin FBGA, Speed Grade 8, Commercial GradeFuse 2              FuseHEX6HY57651620/SO_0     Header 2            Header, 2-PinHeader 9X2          Header, 9-Pin, Dual rowINDUCTOR            JTAG-10_Dup1        KEYB                LED                 LED_Dup1            M25P16-VMN3PB       16 Mb (x1) Automotive Serial NOR Flash Memory, 75 MHz, 2.7 to 3.6 V, 8-pin SO8 Narrow (MN), TubeMHDR2X20            Header, 20-Pin, Dual rowMiniUSBB            OSCPNP                 R                   RESISTOR            RN                  RN_Dup1             R_Dup1              R_Dup2              R_Dup3              R_Dup5R_Dup6              SD                  SPEAKERSRV05-4SW KEY-DPDT         ZTAbattery

    標簽: 黑金 cyclone4 ep4ce6f17c8 fpga

    上傳時間: 2021-12-22

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  • ST-LINK V2下載器(PCB 原理圖等) AD版

    ST-LINK/V2是一款可以在線仿真以及下載STM8以及STM32的開發工具。支持所有帶SWIM接口的STM8系列單片機;支持所有帶JTAG / SWD接口的STM32系列單片機。原理圖:PCB截圖:

    標簽: ST-LINK 下載器 pcb

    上傳時間: 2022-02-18

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  • i.MX6ULL終結者開發板裸機仿真jlink調試

    I.MX6ULL‘終結者’開發板預留了JTAG仿真接口,并給出了開發文檔,可以實現在JLINK仿真器條件下的單步跟蹤、斷點調試等功能,使得開發研究i.MX6ULL處理器的相關技術更加直觀便利。

    標簽: i.MX6ULL jlink 調試 JTAG調試

    上傳時間: 2022-04-29

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  • 華為5G模塊 MH5000-31 PCB設計指導

    華為5G模塊 MH5000-31 PCB設計指導PCB 設計?PCB 堆疊?射頻信號?USB 信號?PCIE信號?RGMII 信號?UART、JTAG、PCM等低速數字信號?ESD 要求?SIM 卡接口?電源設計?GND設計

    標簽: 華為 5g模塊 MH5000-31

    上傳時間: 2022-05-04

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  • Altera(Intel)_MAX10_10M02SCU169開發板資料硬件參考設計+邏輯例程

    Altera(Intel)_MAX10_10M02SCU169開發板資料硬件參考設計+邏輯例程.QM_MAX10_10M02SCU169開發板主要特征參數如下所示:? 主控CPLD:10M02SCU169C8G;? 主控CPLD外部時鐘源頻率:50MHz;? 10M02SCU169C8G芯片內部自帶豐富的Block RAM資源;? 10M02SCU169C8G芯片邏輯單元數為2K LE;? QM_MAX10_10M02SCU169開發板板載Silicon Labs的CP2102芯片來實現USB轉串口功能;? QM_MAX10_10M02SCU169開發板板載MP2359高效率DC/DC提供CPLD芯片工作的3.3V電源;? QM_MAX10_10M02SCU169開發板引出了兩排50p、2.54mm間距的排座,可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等;? QM_MAX10_10M02SCU169開發板引出了芯片的3路按鍵用于測試;? QM_MAX10_10M02SCU169開發板引出了芯片的3路LED用于測試;? QM_MAX10_10M02SCU169開發板引出了芯片的JTAG調試端口,采用雙排10p、2.54mm的排針;

    標簽: altera intel max10

    上傳時間: 2022-05-11

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  • Altera(Intel)_Cyclone10_10CL006開發板資料硬件參考設計+邏輯例程

    Altera(Intel)_Cyclone10_10CL006開發板資料硬件參考設計+邏輯例程。QM_Cyclone10_10CL006開發板主要特征參數如下所示:? 主控FPGA:10CL006YU256C8G;? 主控FPGA外部時鐘源頻率:50MHz;? 10CL006YU256C8G芯片內部自帶豐富的Block RAM資源;? 10CL006YU256C8G芯片邏輯單元數為6K LE;? QM_Cyclone10_10CL006開發板板載MP2359高效率DC/DC提供FPGA芯片工作的3.3V電源;? QM_Cyclone10_10CL006開發板引出了兩排64p、2.54mm間距的排座,可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等;? QM_Cyclone10_10CL006開發板引出了芯片的3路按鍵用于測試;? QM_Cyclone10_10CL006開發板引出了芯片的2路LED用于測試;? QM_Cyclone10_10CL006開發板引出了芯片的JTAG調試端口,采用雙排10p、2.54mm的排針;

    標簽: altera intel cyclone10

    上傳時間: 2022-05-11

    上傳用戶:qingfengchizhu

  • Artix-7 XC7A35T-DDR3開發板資料硬件參考設計

    Artix-7 XC7A35T-DDR3開發板資料硬件參考設計資料QM_ XC7A35T開發板主要特征參數如下所示:? 主控FPGA:XC7A35T-1FTG256C;? 主控FPGA外部時鐘源頻率:50MHz;? XC7A35T-1FTG256C芯片內部自帶豐富的Block RAM資源,達到了1,800kb;? XC7A35T-1FTG256C芯片邏輯單元數為33,280;? QM _XC7A35T板載N25Q064A SPI Flash芯片,8MB(64Mbit)的存儲容量;? QM _XC7A35T板載256MB鎂光的DDR3存儲器,型號為MT41K128M16JT-125:K;? QM _XC7A35T提供核心板芯片工作的3.3V電源,有一路3.3V的LED電源指示燈,板載高性能DC/DC芯片給FPGA 1.0V Core電壓,DDR3 1.5V電壓供電以及VDD_AUX的1.8V電壓;? QM _XC7A35T引出了兩排2x32p、2.54mm間距的排座,可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等;? QM _XC7A35T引出了芯片的2路按鍵用于測試,其中一路用于PROGROM_B信號編程按鈕;? QM _XC7A35T引出了芯片的3路LED燈用于測試,其中一路LED為FPGA_DONE信號指示燈;? QM _XC7A35T引出了芯片的JTAG調試端口,采用單排6p、2.54mm間距的排針;

    標簽: DDR3

    上傳時間: 2022-05-11

    上傳用戶:shjgzh

  • Altera(Intel)_Cyclone_IV_EP4CE15_開發板資料硬件參考設計+邏輯例程

    Altera(Intel)_Cyclone_IV_EP4CE15_開發板資料硬件參考設計+邏輯例程Cyclone IV EP4CE15核心板主要特征參數如下所示:? 主控FPGA:EP4CE15F23C8N;? 主控FPGA外部時鐘源頻率:50MHz;? EP4CE15F23C8N芯片內部自帶豐富的Block RAM資源;? EP4CE15F23C8N芯片邏輯單元數為15K LE;? Cyclone IV EP4CE15板載W25Q064 SPI Flash芯片,8MB字節的存儲容量;? Cyclone IV EP4CE15板載Winbond 32MB的SDRAM,型號為W9825G6KH-6;? Cyclone IV EP4CE15核心板板載MP2315高效率DC/DC芯片提供FPGA芯片工作的3.3V電源;? Cyclone IV EP4CE15核心板引出了兩排64p、2.54mm間距的排座,可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等;? Cyclone IV EP4CE15核心板引出了芯片的3路按鍵用于測試;? Cyclone IV EP4CE15核心板引出了芯片的2路LED用于測試;? Cyclone IV EP4CE15核心板引出了芯片的JTAG調試端口,采用雙排10p、2.54mm的排針;

    標簽: altera intel cyclone

    上傳時間: 2022-05-11

    上傳用戶:zhanglei193

  • 單片機綜合設計實用教程

    單片機綜合設計實用教程 本書通過不同的實際案例, 從不同的側重點介紹了單片機的結構、 中斷系統、 定時 / 計數器、 串口、 系統擴展及實用 I / O ( 輸入 / 輸出) 接口技術等基本原理及實際應用。 通過實例向讀者展示了單片機開發應用軟件(Keil、 Protel 99 SE、 Proteus) 的使用方法和程序下載技術 ( ISP、 JTAG) ,使得讀者在學習實例的同時掌握各個軟件的使用方法。 本書實例按照由淺入深的順序排列, 符合讀者的學習思路, 方便讀者盡快地掌握單片機開發系統的設計方法和流程。本書具有大量的實例設計電路和程序, 特別方便讀者學習單片機, 適合作為單片機原理及應用課程設計教材以及單片機愛好者自學用書, 也可作為單片機應用開發技術人員、 智能儀表開發技術人員及相關專業研究生的設計參考用書。

    標簽: 單片機

    上傳時間: 2022-05-26

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  • 正點原子高速無線調試器用戶資料

    1 產品簡介1.1 產品特點下載速度快,超越 JLINK V8,接近 JLINK V9采用 2.4G 無線通信,自動跳頻支持 1.8V~5V 設備,自動檢測支持 1.8V/3.3V/5V 電源輸出,上位機設置支持目標板取電/給目標板供電支持 MDK/IAR 編譯器,無需驅動,不丟固件支持 Cortex M0/M1/M3/M4/M7 等內核 ARM 芯片支持仿真調試,支持代碼下載、支持虛擬串口提供 20P 標準 JTAG 接口、提供 4P 簡化 SWD 接口支持 XP/WIN7/WIN8/WIN10 等操作系統尺寸小巧,攜帶方便1.2 基本參數產品名稱 ATK-HSWLDBG 高速無線調試器產品型號 ATK-HSWLDBG支持芯片 ARM Cortex M0/M1/M3/M4/M7 全系列通信方式 USB(免驅)仿真接口 JTAG、SWD支持編譯器 MDK、IAR串口速度 10Mbps(max)燒錄速度 10M通信距離 ≥10MTX 端工作電壓 5V(USB 供電)TX 端工作電流 151mARX 端工作電壓 3.3V/5V(USB 或者 JTAG 或者 SWD 供電)RX 端工作電流 132mA@5V工作溫度 -40℃~+85℃尺寸 66.5mm*40mm*17mm1.3 產品實物圖圖 發送端圖 接收端圖 接收端接口輸出電壓示意圖,所有標注 GND 的引腳均為地線1.4 接線示意圖高速無線調試器發送端,接線圖:高速無線調試器接收端,JTAG/SWD 接口供電,接線示意圖:高速無線調試器接收端,USB 接口供電,接線示意圖:1.5 高速無線調試器工作原理示意圖電腦端 高速無線調試器發送端 USB 接口目標 MCU 高速無線調試器接收端 JTAG/SWD 接口目標 MCU 高速無線調試器接收端5V 電源JTAG/SW 接口 USB 接口高速無線調試器JTAG/SW 接口 目標 MCU 高速無線調試器接收端USB 接口 電腦端 高速無線調試器發送端無線模塊無線模塊2、MDK 配置教程注意:低版本 MDK 對高速無線調試器的支持不完善,推薦 MDK5.23及以上版本。MDK5.23~MDK5.26 對高速 DAP 的支持都有 bug,必須打補丁。參考“mdk 補丁”文件夾下的相關文檔解決。SWD 如果接3 線,請查看第 10 章,常見問題 1。要提高速度,參考 4.2 節配置無線參數為大包模式。如果無線通信不穩定,參考常見問題 4。

    標簽: 高速無線調試器

    上傳時間: 2022-06-04

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