采用verilog hdl 語言實現整形dct算法，設計合理，算法簡單，是紅色邏輯開發板試驗程序，值得一看。
標簽： verilog hdl dct 語言
上傳時間： 2013-12-23
上傳用戶：aeiouetla
將Verilog設計轉成VHDL設計的程式
標簽： Verilog VHDL 程式
上傳時間： 2016-01-18
上傳用戶：lifangyuan12
將VHDL設計轉換成Verilog設計的程式
上傳用戶：wkchong
疊代結構的cordic的verilog代碼
標簽： verilog cordic 代碼
上傳時間： 2013-12-28
上傳用戶：wweqas
Verilog HDL Synthesis, A Practical Primer 學習Verilog HDL一本很不錯的英文書，比較透徹
標簽： Verilog HDL Synthesis Practical
上傳時間： 2016-01-19
上傳用戶：hongmo
verilog HDL 基礎實驗源碼，比較實用
標簽： verilog HDL 基礎實驗 源碼
上傳用戶：lxm
verilog HDL 接口試驗源代碼，比較實用。
標簽： verilog HDL 接口 源代碼
上傳用戶：qiao8960
verilog HDL綜合實驗源代碼，比較實用
標簽： verilog HDL 實驗 源代碼
上傳用戶：tb_6877751
用Verilog HDL寫的數字時鐘,已經在開發板上驗證過的,絕對原創,使用數碼管進行顯示!
標簽： Verilog HDL 數字時鐘 開發板
上傳時間： 2013-12-03
上傳用戶：lnnn30
多個verilog語言的例子，適合初學verilog者
標簽： verilog 語言
上傳時間： 2016-01-20
上傳用戶：417313137
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