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Micrium-NXP-<b>ucos-i</b>I-LPC

  • 電子電路百科全書

    該電路集包括了從業(yè)界享有盛名的公司搜集到的大量最新電路,體現了豐富的設計思想。為便于讀者理解和應用這些電路,本書幾乎對每個電路都附有簡要說明。$ C' I" t% P5 l3 V. l0 K, B 本書可供電子技術工作者、高等院校和中等專科學校師生、電子愛好者閱讀和參考。( H& s, \, z6 ~% D: @

    標簽: 電子電路 百科

    上傳時間: 2013-10-19

    上傳用戶:songnanhua

  • USB Anaslyst-I分析儀軟件

    USB Anaslyst-I分析儀軟件 安裝程序

    標簽: Anaslyst-I USB 分析儀 軟件

    上傳時間: 2013-10-09

    上傳用戶:qijian11056

  • USB Anaslyst-I分析儀軟件

    USB Anaslyst-I分析儀軟件 安裝程序

    標簽: Anaslyst-I USB 分析儀 軟件

    上傳時間: 2013-11-17

    上傳用戶:yczrl

  • XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接

    XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接  The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

    標簽: XAPP FPGA Bank 520

    上傳時間: 2013-11-06

    上傳用戶:wentianyou

  • 抑制△I噪聲的PCB設計方法

    抑制△I 噪聲一般需要從多方面著手, 但通過PCB 設計抑制△I 噪聲是有效的措施之一。如何通過PCB 設計抑制△I 噪聲是一個亟待深入研究的問題。在對△I 噪聲的產生、特點、主要危害等研究的基礎上, 討論了輻射干擾機理, 重點結合PCB 和EMC 研究的新進展, 研究了抑制△I 噪聲的PCB 設計方法。對通過PCB 設計抑制△I 噪聲的研究與應用具有指導作用。

    標簽: PCB 設計方法

    上傳時間: 2013-11-18

    上傳用戶:wweqas

  • 差分阻抗

    當你認為你已經掌握了PCB 走線的特征阻抗Z0,緊接著一份數據手冊告訴你去設計一個特定的差分阻抗。令事情變得更困難的是,它說:“……因為兩根走線之間的耦合可以降低有效阻抗,使用50Ω的設計規(guī)則來得到一個大約80Ω的差分阻抗!”這的確讓人感到困惑!這篇文章向你展示什么是差分阻抗。除此之外,還討論了為什么是這樣,并且向你展示如何正確地計算它。 單線:圖1(a)演示了一個典型的單根走線。其特征阻抗是Z0,其上流經的電流為i。沿線任意一點的電壓為V=Z0*i( 根據歐姆定律)。一般情況,線對:圖1(b)演示了一對走線。線1 具有特征阻抗Z11,與上文中Z0 一致,電流i1。線2具有類似的定義。當我們將線2 向線1 靠近時,線2 上的電流開始以比例常數k 耦合到線1 上。類似地,線1 的電流i1 開始以同樣的比例常數耦合到線2 上。每根走線上任意一點的電壓,還是根據歐姆定律,

    標簽: 差分阻抗

    上傳時間: 2013-11-10

    上傳用戶:KSLYZ

  • PCB LAYOUT初學者必看!

    PCB LAYOUT技術大全---初學者必看!  PROTEL相關疑問 1.原理圖常見錯誤: (1)ERC報告管腳沒有接入信號: a. 創(chuàng)建封裝時給管腳定義了I/O屬性; b.創(chuàng)建元件或放置元件時修改了不一致的grid屬性,管腳與線沒有連上; c. 創(chuàng)建元件時pin方向反向,必須非pin name端連線。 (2)元件跑到圖紙界外:沒有在元件庫圖表紙中心創(chuàng)建元件。 (3)創(chuàng)建的工程文件網絡表只能部分調入pcb:生成netlist時沒有選擇為global。 (4)當使用自己創(chuàng)建的多部分組成的元件時,千萬不要使用annotate. 2.PCB中常見錯誤: (1)網絡載入時報告NODE沒有找到: a. 原理圖中的元件使用了pcb庫中沒有的封裝;  b. 原理圖中的元件使用了pcb庫中名稱不一致的封裝; c. 原理圖中的元件使用了pcb庫中pin number不一致的封裝。如三極管:sch中pin number 為e,b,c, 而pcb中為1,2,3。

    標簽: LAYOUT PCB 初學者

    上傳時間: 2013-10-20

    上傳用戶:kbnswdifs

  • Labview:字符串和文件I/O

    Labview:字符串和文件I/O

    標簽: Labview 字符串

    上傳時間: 2013-10-13

    上傳用戶:wmwai1314

  • 高速I/O接口技術

    現代通信技術朝著高速、精確的方向發(fā)展,尤其是高速串行通信,逐漸成為通信技術的主流,在各行各業(yè)扮演著極其重要的角色,文中簡述了高速I/O的相關技術,如SERDES (串行器/解串器)技術、8B /10B編碼、COMMA字符、預加重等,并列舉了具有代表性的Xilinx公司的FPGA產品,展示了Rocket IO技術的實際應用。關鍵詞:高速I/O接口; SERDES;預加重

    標簽: 接口技術

    上傳時間: 2013-11-23

    上傳用戶:子虛烏有

  • 本程序集是Allen I. Holub所寫的《Compiler Design in C》一書的附隨軟件

    本程序集是Allen I. Holub所寫的《Compiler Design in C》一書的附隨軟件,其中有作者自己編寫的詞法分析和語法分析工具LeX,occs和LLama,該軟件包還包括一個顯示C語言分析過程的程序

    標簽: I. Compiler Design Allen

    上傳時間: 2014-01-08

    上傳用戶:siguazgb

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