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QUARTUS-II

  • dds正弦可控發(fā)生計全結(jié)果 用到matlab

    dds正弦可控發(fā)生計全結(jié)果 用到matlab，dsp，Quartus II 6.0軟件

    標(biāo)簽： matlab dds 正弦 發(fā)生

    上傳時間： 2017-01-23

    上傳用戶：chongcongying

  • 此乃VGA驅(qū)動的詳細(xì)源碼

    此乃VGA驅(qū)動的詳細(xì)源碼，并配有PLL。使用Quartus II 開發(fā)。

    標(biāo)簽： VGA 驅(qū)動 源碼

    上傳時間： 2013-12-07

    上傳用戶：koulian

  • 這是一個verilog HDL 語言的例子

    這是一個verilog HDL 語言的例子，在CPLD器件EPM240上實現(xiàn)了 RS232協(xié)議、按鍵處理、LED數(shù)碼管顯示和每秒加1數(shù)碼顯示。使用quartus ii 7.0 以上打開.

    標(biāo)簽： verilog HDL 語言

    上傳時間： 2017-03-06

    上傳用戶：lizhen9880

  • NCO 在信號處理方面有著廣泛的應(yīng)用。而函數(shù)發(fā)生器是NCO 中的關(guān)鍵部分

    NCO 在信號處理方面有著廣泛的應(yīng)用。而函數(shù)發(fā)生器是NCO 中的關(guān)鍵部分，本文基 于FPGA 用狀態(tài)機和流水線方法實現(xiàn)了CORDIC 算法，并取代了傳統(tǒng)的ROM 查找表法。 最后通過Quartus II 軟件給出仿真結(jié)果，驗證了理論的正確性。

    標(biāo)簽： NCO 信號處理 方面 函數(shù)發(fā)生器

    上傳時間： 2017-04-04

    上傳用戶：iswlkje

  • 完整的Nios 2 演示工程

    完整的Nios 2 演示工程，包括Quartus II 工程和NIOS IDE下的c代碼。采用NIOS 2處理器控制LED。已通過實驗測試。

    標(biāo)簽： Nios 工程

    上傳時間： 2017-04-05

    上傳用戶：siguazgb

  • 附錄 光盤說明 本書附贈的光盤包括各章節(jié)實例的設(shè)計工程與源碼

    附錄 光盤說明 本書附贈的光盤包括各章節(jié)實例的設(shè)計工程與源碼，所有工程在下列軟件環(huán)境下運行通過： ? Windows XP SP2 ? MATLAB ? Altera Quartus II ? synplify8.4 ? modelsim_ae6.1 光盤目錄與實例名稱的對應(yīng)關(guān)系如下： cht02文件夾中存放的是書中第2章中的例子，讀者可以將一些簡單例子的代碼 拷貝到MATLAB命令窗口進行運行，也可以把一些復(fù)雜的例子做成一個單獨 的*.m文件然后運行、調(diào)試(要將每行前的“>>”刪除)。 cht04文件夾存放的是書中第4章的例子代碼。每個例子都建立了一個單獨的文件夾， 除了存放與例子相關(guān)的代碼外，還對各個例子建立了Quartus II工程，編制了仿真測試向量，并對例子進行了編譯、綜合、布局布線和時序仿真。 cht05文件夾中存放的是一個完整的正弦波頻率產(chǎn)生的例子，即書中5.4.1節(jié)中的代碼， 讀者可以應(yīng)用這些代碼建立自己的項目，按照書中介紹的方法，獲得完整的項目設(shè)計經(jīng)驗。 注意事項： 光盤中的源代碼為作者編寫，并調(diào)試通過，有興趣的讀者可以在此基礎(chǔ)上進行二次開發(fā)，但請不要用作商業(yè)用途。

    標(biāo)簽： 光盤 工程 源碼

    上傳時間： 2013-12-05

    上傳用戶：zhaiye

  • DE2上SD卡的讀寫代碼

    DE2上SD卡的讀寫代碼，應(yīng)用環(huán)境quartus ii

    標(biāo)簽： DE2 SD卡 讀寫 代碼

    上傳時間： 2017-05-03

    上傳用戶：熊少鋒

  • Abstract七段顯示器在DE2可當(dāng)成Verilog的console

    Abstract七段顯示器在DE2可當(dāng)成Verilog的console，做為16進位的輸出結(jié)果。Introduction使用環(huán)境：Quartus II 7.2 SP1 + DE2(Cyclone II EP2C35F627C6)簡單的使用switch當(dāng)成2進位輸入，并用8位數(shù)的七段顯示器顯示16進位的結(jié)果。

    標(biāo)簽： Abstract Verilog console DE2

    上傳時間： 2017-06-03

    上傳用戶：zhangyigenius

  • 現(xiàn)代DSP技術(shù) 是西安電子科技大學(xué)的課件！有fft

    現(xiàn)代DSP技術(shù) 是西安電子科技大學(xué)的課件！有fft，fir，dspbulder，iir，quartus II 等內(nèi)容，非常的詳細(xì)，值得一看的好的ppt啊。我把好的資料貢獻給大家看看啊1

    標(biāo)簽： DSP fft 電子科技 大學(xué)

    上傳時間： 2017-06-20

    上傳用戶：sqq

  • RS編碼是一種糾錯碼

    RS編碼是一種糾錯碼，本程序?qū)崿F(xiàn)RS（255，223）用FPGA 實現(xiàn)RS編碼，程序在Quartus II中調(diào)試通過。

    標(biāo)簽： RS編碼 糾錯碼

    上傳時間： 2017-07-29

    上傳用戶：dyctj

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