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SDRam-mt

  • 基于EPM1240的SDRAM控制器的設(shè)計(jì)

    通過(guò)設(shè)計(jì)基于CPLD 的SDRAM 控制器接口，可以在STM系列、ARM系列、STC系列等單片機(jī)和DSP等微處理器的外部連接SDRAM，增加系統(tǒng)的存儲(chǔ)空間。

    標(biāo)簽： SDRAM 1240 EPM 控制器

    上傳時(shí)間： 2013-11-14

    上傳用戶(hù)：feifei0302

  • SDRAM內(nèi)存詳解

    雖然目前SDRAM內(nèi)存條價(jià)格已經(jīng)接底線(xiàn)，內(nèi)存開(kāi)始向DDR和Rambus內(nèi)存過(guò)渡。但是由于DDR內(nèi)存是在SDRAM基礎(chǔ)上發(fā)展起來(lái)的，所以詳細(xì)了解SDRAM內(nèi)存的接口和主板設(shè)計(jì)方法對(duì)于設(shè)計(jì)基于DDR內(nèi)存的主板不無(wú)裨益。

    標(biāo)簽： SDRAM 內(nèi)存

    上傳時(shí)間： 2013-11-06

    上傳用戶(hù)：yelong0614

  • 利用FPGA實(shí)現(xiàn)SDRAM控制器的設(shè)計(jì)

    FPGA的應(yīng)用，sdram

    標(biāo)簽： SDRAM FPGA 控制器

    上傳時(shí)間： 2013-12-19

    上傳用戶(hù)：daguogai

  • 基于FPGA的DDR2 SDRAM存儲(chǔ)器用戶(hù)接口設(shè)計(jì)

    使用功能強(qiáng)大的FPGA來(lái)實(shí)現(xiàn)一種DDR2 SDRAM存儲(chǔ)器的用戶(hù)接口。該用戶(hù)接口是基于XILINX公司出產(chǎn)的DDR2 SDRAM的存儲(chǔ)控制器，由于該公司出產(chǎn)的這種存儲(chǔ)控制器具有很高的效率，使用也很廣泛，可知本設(shè)計(jì)具有很大的使用前景。本設(shè)計(jì)通過(guò)采用多路高速率數(shù)據(jù)讀寫(xiě)操作仿真驗(yàn)證，可知其完全可以滿(mǎn)足時(shí)序要求，由綜合結(jié)果可知其使用邏輯資源很少，運(yùn)行速率很高，基本可以滿(mǎn)足所有設(shè)計(jì)需要。

    標(biāo)簽： SDRAM FPGA DDR2 存儲(chǔ)器

    上傳時(shí)間： 2013-10-14

    上傳用戶(hù)：zxh122

  • SDRAM Controller

    SDRAM Controller

    標(biāo)簽： Controller SDRAM

    上傳時(shí)間： 2015-01-01

    上傳用戶(hù)：asdstation

  • SDRAM與DDR布線(xiàn)指南

    SDRAM與DDR布線(xiàn)指南

    標(biāo)簽： SDRAM DDR 布線(xiàn)

    上傳時(shí)間： 2013-11-18

    上傳用戶(hù)：1142895891

  • ref sdr sdram vhdl代碼

    ref-sdr-sdram-vhdl代碼 SDR SDRAM Controller v1.1 readme.txt This readme file for the SDR SDRAM Controller includes information that was not incorporated into the SDR SDRAM Controller White Paper v1.1. The PLL is targeted at APEX(TM) devices. Please regenerate for your chosen architecture. Last updated September, 2002 Copyright ?2002 Altera Corporation. All rights reserved.

    標(biāo)簽： sdram vhdl ref sdr

    上傳時(shí)間： 2013-10-23

    上傳用戶(hù)：半熟1994

  • SDRAM原理及應(yīng)用

    一篇簡(jiǎn)單的SDRAM的介紹文檔

    標(biāo)簽： SDRAM

    上傳時(shí)間： 2013-10-17

    上傳用戶(hù)：cicizoe

  • sdram的verilog的源碼實(shí)現(xiàn)

    sdram的verilog的源碼實(shí)現(xiàn)

    標(biāo)簽： verilog sdram 源碼

    上傳時(shí)間： 2015-01-09

    上傳用戶(hù)：huangld

  • Xilinx Sdram控制器VHDL源代碼

    Xilinx Sdram控制器VHDL源代碼

    標(biāo)簽： Xilinx Sdram VHDL 控制器

    上傳時(shí)間： 2014-01-14

    上傳用戶(hù)：gdgzhym

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