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TestBench

TestBench是一種驗(yàn)證的手段。首先，任何設(shè)計(jì)都是會(huì)有輸入輸出的。但是在軟環(huán)境中沒有激勵(lì)輸入，也不會(huì)對(duì)你設(shè)計(jì)的輸出正確性進(jìn)行評(píng)估。那么此時(shí)便有一種，模擬實(shí)際環(huán)境的輸入激勵(lì)和輸出校驗(yàn)的一種“虛擬平臺(tái)”的產(chǎn)生。在這個(gè)平臺(tái)上你可以對(duì)你的設(shè)計(jì)從軟件層面上進(jìn)行分析和校驗(yàn)，這個(gè)就是TestBench的含義。

timing,原程序及TestBench,供初學(xué)者參考

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標(biāo)簽： TestBench timing 程序初學(xué)者

上傳時(shí)間： 2013-12-22

上傳用戶：chfanjiang
TestBench書寫規(guī)范格式的ppt教程

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標(biāo)簽： TestBench 教程

上傳時(shí)間： 2014-11-24

上傳用戶：evil
vhdl的arm核包含TestBench

vhdl的arm核包含TestBench

標(biāo)簽： TestBench vhdl arm

上傳時(shí)間： 2016-02-01

上傳用戶：磊子226
VHDL計(jì)數(shù)器的TestBench

VHDL計(jì)數(shù)器的TestBench，適合初學(xué)者

標(biāo)簽： TestBench VHDL 計(jì)數(shù)器

上傳時(shí)間： 2016-03-20

上傳用戶：love1314
DAC converter design with Verilog code and TestBench

DAC converter design with Verilog code and TestBench

標(biāo)簽： converter TestBench Verilog design

上傳時(shí)間： 2014-01-23

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I2C bus HDL source and TestBench

I2C bus HDL source and TestBench

標(biāo)簽： TestBench source I2C HDL

上傳時(shí)間： 2013-12-17

上傳用戶：watch100
編寫TestBench的超好教程

編寫TestBench的超好教程，網(wǎng)上這種資料比較少。(Kluwer) Writing TestBenches--Functional Verification of HDL Models.pdf

標(biāo)簽： TestBench 編寫教程

上傳時(shí)間： 2014-01-05

上傳用戶：Miyuki
編寫TestBench的非常號(hào)的參考資料哦。

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標(biāo)簽： TestBench 編寫參考資料

上傳時(shí)間： 2016-05-14

上傳用戶：z754970244
用于AES加密的TestBench。產(chǎn)生激勵(lì)

用于AES加密的TestBench。產(chǎn)生激勵(lì)

標(biāo)簽： TestBench AES 加密激勵(lì)

上傳時(shí)間： 2013-12-24

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簡單的TestBench制作方法

簡單的TestBench制作方法，對(duì)初學(xué)者有點(diǎn)幫助

標(biāo)簽： TestBench

上傳時(shí)間： 2013-12-11

上傳用戶：xymbian

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TestBench

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