Phase–locked loop (PLL) frequency synthesizers are commonlyfound in communication gear today. Th
上傳時間: 2013-04-24
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用VB編寫的簡單的modbus協議雙機通信軟件,使用mscom控件實現串口通信,包括端口配置,收發內容顯示等。-VB prepared using a simple two-plane Modbus
標簽: mmodbus
上傳時間: 2013-08-05
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Integrating A/D converters have two characteristics incommon. First, as the name implies, their
上傳時間: 2013-04-24
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偏移正交相移鍵控(OQPSK:Offset Quadrature Phase Shift Keying)調制技術是一種恒包絡調制技術,具有頻譜利用率高、頻譜特性好等特點,廣泛應用于衛星通信和移動通信領域。 論文以某型偵收設備中OQPSK解調器的全數字化為研究背景,設計并實現了基于FPGA的全數字OQPSK調制解調器,其中調制器主要用于仿真未知信號,作為測試信號源。論文研究了全數字OQPSK調制解調的基本算法,包括成形濾波器、NCO模型、載波恢復、定時恢復等;完成了整個調制解調算法的MATLAB仿真。在此基礎上,采用VHDL硬件描述語言在Xilinx公司ISE7.1開發環境下設計并實現了各個算法模塊,并在硬件平臺上加以實現。通過實際現場測試,實現了對所偵收信號的正確解調。論文還實現了解調器的百兆以太網接口,使得系統可以方便地將解調數據發送給計算機進行后續處理。
上傳時間: 2013-05-19
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光纖水聽器自問世以來,在巨大的軍事價值和民用價值推動下得到了迅速發展,已逐漸從實驗室研究階段走向工程應用。同時隨著光纖水聽器的不斷發展,對水聲信號的檢測技術以及數字處理能力也提出了新的要求。論文在此背景下開展了一系列研究工作,并提出了利用FPGA(Field ProgrammableGate Array,現場可編程門陣列)實現光纖3×3耦合器解調算法的新思路。 目前干涉型光纖水聽器的解調一般采用PGC(Phase Generated Carrier,相位生成載波技術)技術和基于3×3光纖耦合器干涉的解調技術。PGC技術在解調過程中引入了載波信號,它對采樣率,激光器等的要求都較高,因此我們把目光投向3×3耦合器解調技術,文中對其解調原理進行了闡述,對采樣率的確定進行了討論,并對3×3耦合器三路輸出不對稱的情況進行了分析,最后在本文的結論部分提出了基于3×3耦合器解調的改良方案。 目前,光纖信號數字化解調的硬件實現采用DSP(Digital Signal Process,可編程數字信號處理器)信號處理機,與之相比,FPGA解調具有速度快、資源占用少、易于擴展等優勢。本文對FPGA與DSP、ASIC(application-specificintegrated circuit,專用集成電路)實現方案進行了對比,分析了適合利用FPGA實現的算法所應具備的特征;介紹了3×3耦合器解調算法中各個模塊的設計情況;分析了系統的工作情況,硬件的構造及芯片的選擇,最后驗證了利用FPGA可以實現3×3耦合器解調算法。
上傳時間: 2013-07-03
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General Description The LM621 is a bipolar IC designed for commutation of brushless DC motors. The part is compatible with both three- and four-phase motors. It can directly drive the power switching devices used to drive the motor. The LM621 provides an adjustable dead-time circuit to eliminate ``shootthrough'' current spiking in the power switching circuitry. Operation is from a 5V supply, but output swings of up to 40V are accommodated. The part is packaged in an 18-pin, dual-in-line package.
上傳時間: 2013-07-24
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·詳細說明:Goertzel算法是DTMF信號檢測的核心,它利用二極點的IIR濾波器計算離散傅立葉變換值,快速有效的提取輸入信號的頻譜信息。-Goertzel algorithm is the DTMF signal examination core, it uses two extremes the IIR filter computations to be separated Fourier t
上傳時間: 2013-04-24
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·SystemVerilog is a rich set of extensions to the IEEE 1364-2001 Verilog Hardware Description Language (Verilog HDL). These extensions address two major aspects of HDL-based design. First, modeling ver
標簽: nbsp SystemVerilog Design for
上傳時間: 2013-07-14
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·【英文題名】 Research of Speed Regulate System of Three Phase BLDCM Based on DSP 【作者中文名】 劉桂芬; 【導師】 孟慶春; 【學位授予單位】 遼寧工程技術大學; 【學科專業名稱】 控制理論與控制工程 【學位年度】 2007 【論文級別】 碩士 【網絡出版投稿人】 遼寧工程技術大學 【網絡出版投稿時間】 2006-01-02 【
上傳時間: 2013-06-19
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The MAX2870 ultra-wideband phase-locked loop (PLL) and voltagecontrol oscillator (VCO) can operate in both integer-N and fractional-Nmodes, similar to the Analog Devices ADF4350 wideband synthesizer.This application note compares the MAX2870 and ADF4350 registers andloop filter design in detail. Users who already familiar with ADF4350 canuse this application note as a quick design reference.
上傳時間: 2014-12-23
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