用VHDL和VERILOG實現的四人搶答器
標簽： VERILOG VHDL 搶答器
上傳時間： 2015-11-15
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用VERILOG實現了一個數字秒表的設計
標簽： VERILOG 數字秒表
上傳用戶：小眼睛LSL
一個可以綜合的VERILOG 寫的FIFO存儲器 內附文檔說明
標簽： VERILOG FIFO 存儲器 文檔
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8051的VERILOG實現，內附testbench,c語言調試程序
標簽： VERILOG 8051
上傳時間： 2014-01-02
上傳用戶：王楚楚
FIFO的VERILOG實現，內附testbench和文檔說明
標簽： VERILOG FIFO
上傳時間： 2013-12-24
上傳用戶：it男一枚
該工程是基于VERILOG hdl 語言編寫的幀傳輸協議HDLC幀的發送端代碼，會用QUATUSII的人都應該知道如何使用，希望能給你帶來幫助
標簽： VERILOG HDLC hdl 幀
上傳時間： 2014-11-22
上傳用戶：3到15
uart串行口,用VERILOG編寫的.供大家參考
標簽： VERILOG uart 串行口 編寫
上傳時間： 2013-12-15
上傳用戶：417313137
將16進制文件轉換成RAM可讀的文件,VERILOG語言編寫
標簽： VERILOG RAM 進制 文件轉換
上傳時間： 2013-12-02
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基于VERILOG 的電子日歷與電子時鐘程序，可以進行調日期、星期、時間的分鐘與小時，通過幾種模式來顯示日歷與時間。
標簽： VERILOG 電子日歷 電子時鐘 程序
上傳時間： 2014-02-09
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基于VERILOG的數碼管模擬掃描程序，分為兩種顯示方式，一種是數碼管逐個顯示，另一個是所有數碼管一起顯示。
標簽： VERILOG 數碼管 掃描程序 模擬
上傳時間： 2014-01-15
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