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VeriLog-HDL

  • verilog十大基本功

    熟練掌握Verilog HDL的十大基本功

    標簽： verilog

    上傳時間： 2013-05-18

    上傳用戶：familiarsmile

  • Verilog HDL 綜合實用教程

    ·  內(nèi)容提要 本書的鮮明特色在于幫助讀者全面、正確地理解Verilog硬件描述語言的綜合。本書以電路綜合為目標，針對各種語言結(jié)構(gòu)逐一討論了其可綜合性、仿真與綜合時的語義差別以及相關(guān)的各種相關(guān)的各種用法，給出了大量示例，對各種似是而非的用法作了對比，指出了其語義差別和所綜合出的電路在功能上的差異。本書的另一特色在于詳細介紹了設(shè)計模型的優(yōu)化技術(shù)和驗證技術(shù)。本書內(nèi)容全面、深

    標簽： nbsp Verilog HDL 實用教程

    上傳時間： 2013-07-01

    上傳用戶：努力努力再努力

  • 基于Verilog的SRAM讀寫控制

    基于Verilog hdl語言的SRAM讀寫控制

    標簽： Verilog SRAM 讀寫 控制

    上傳時間： 2013-06-07

    上傳用戶：hoperingcong

  • HDL的可綜合設(shè)計簡介

    本文簡單探討了verilog HDL設(shè)計中的可綜合性問題，適合HDL初學(xué)者閱讀   　　用組合邏輯實現(xiàn)的電路和用時序邏輯實現(xiàn)的 　　電路要分配到不同的進程中。 　　不要使用枚舉類型的屬性。 　　Integer應(yīng)加范圍限制。 　　 通常的可綜合代碼應(yīng)該是同步設(shè)計。 　　避免門級描述，除非在關(guān)鍵路徑中。

    標簽： HDL 綜合設(shè)計

    上傳時間： 2013-10-21

    上傳用戶：smallfish

  • Verilog HDL的基本知識--周立功Actel產(chǎn)品線

    概述:數(shù)字通信和自動化控制等領(lǐng)域的高速度發(fā)展和世界范圍的高技術(shù)競爭對數(shù)字系統(tǒng)提出了越來越高的要求，特別是需要設(shè)計具有實時信號處理能力的專用集成電路，要求把包括多個CPU內(nèi)核在內(nèi)的整個電子系統(tǒng)綜合到一個芯片(SOC)上。集成電路制造工藝的發(fā)展；知識產(chǎn)權(quán)核(IP)的重復(fù)利用；硬件描述語言(HDL)的大規(guī)模使用；

    標簽： Verilog Actel HDL 基本知識

    上傳時間： 2013-10-28

    上傳用戶：pol123

  • Verilog入門教程

    verilog hdl 入門教程，還算好吧····

    標簽： Verilog 入門教程

    上傳時間： 2013-11-02

    上傳用戶：丶灬夏天

  • 《Verilog+HDL+程序設(shè)計教程》及配套源碼

    verilog

    標簽： Verilog HDL 程序設(shè)計 教程

    上傳時間： 2013-12-23

    上傳用戶：頂?shù)弥?/p>

  • HDL入門教程

    　　Verilog HDL入門教程

    標簽： HDL 入門教程

    上傳時間： 2013-10-19

    上傳用戶：哈哈hah

  • Verilog基本電路設(shè)計指導(dǎo)書

    本文列舉了大量的基本電路的Verilog HDL 代碼，使初學(xué)者能夠迅速熟悉基本的HDL 建模；同時也列舉了一些常用電路的代碼，作為設(shè)計者的指導(dǎo)。

    標簽： Verilog 基本電路 設(shè)計指導(dǎo)

    上傳時間： 2013-11-02

    上傳用戶：linyao

  • Verilog入門教程

    verilog hdl 入門教程，還算好吧····

    標簽： Verilog 入門教程

    上傳時間： 2013-10-10

    上傳用戶：Wwill

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