SOME background ON DESIGN PATTERNS The term “design patterns” sounds a bit formal to the uninitiated and can be somewhat off-putting when you first encounter it. But, in fact, design patterns are just convenient ways of reusing object-oriented code between projects and between programmers. The idea behind design patterns is simple-- write down and catalog common interactions between objects that programmers have frequently found useful.
標簽： background uninitiate PATTERNS patterns
上傳時間： 2013-12-22
上傳用戶：shizhanincc
The book presents a historical background of past and present guided missile systems and the evolution of modern weapons,discusses the generalized missile equations of motion, aerodynamic forces and coefficients, the important subject of the various types of tactical guidance laws and/or techniques, weapon delivery systems and techniques,strategic missiles and cruise missile theory and design.
標簽： background historical and presents
上傳時間： 2017-08-14
上傳用戶：jennyzai
to subtract background
標簽： background subtract to
上傳時間： 2014-11-28
上傳用戶：225588
This m-file implements the frame difference algorithm for background subtraction.
標簽： subtraction implements difference background
上傳時間： 2013-12-26
上傳用戶：123456wh
在國內Protel軟件一直大受歡迎，從DOS時代的Protel3.3(Autotrax 1.61)到現在具有EDA Client/Server （客戶/服務器）即C/S“框架”體系結構的Protel98，它始終是PCB設計和制造領域的大眾化工具軟件，成為電子設計工作者們的首選。 在規范化的設計管理中，設計文件圖樣必須遵守相應的國家標準，如《電子產品圖樣繪制規則》、《設計文件管理制圖》和《印制板制圖》等，而由于Protel軟件都是英文版，因此無法直接打印出符合國家標準的圖紙，要將圖紙規范化常用的方式是套打，即先將符合國家標準的表和漢字等打在紙上，再將該紙放入打印機，用Protel軟件將印制板圖打印其上，形成符合標準的文件，但這種做法效率很低，而且圖形常會打偏，有時甚至會打反，經筆者試驗，找到了一種簡便的方法，使印制板圖轉換為AUTOCAD格式，再在AUTOCAD里一次性打印出符合標準的圖紙。
上傳時間： 2013-10-12
上傳用戶：Wwill
本文論述了狀態機的verilog編碼風格,以及不同編碼風格的優缺點，Steve Golson's 1994 paper, "State Machine Design Techniques for Verilog and VHDL" [1], is agreat paper on state machine design using Verilog, VHDL and Synopsys tools. Steve's paper alsooffers in-depth background concerning the origin of specific state machine types.This paper, "State Machine Coding Styles for Synthesis," details additional insights into statemachine design including coding style approaches and a few additional tricks.
標簽： Synthesis Machine Coding Styles
上傳時間： 2013-10-15
上傳用戶：dancnc
本文詳細討論了VHDL語句對PLD設計的影響和設計經驗，經典文章，值得仔細閱讀消化。,PLD Programming Using VHDL
標簽： Programming Using VHDL PLD
上傳時間： 2013-11-17
上傳用戶：teddysha
本文簡單討論并總結了VHDL、Verilog，System verilog 這三中語言的各自特點和區別As the number of enhancements to variousHardware Description Languages (HDLs) hasincreased over the past year, so too has the complexityof determining which language is best fora particular design. Many designers and organizationsare contemplating whether they shouldswitch from one HDL to another.
標簽： Verilog verilog System VHDL
上傳時間： 2013-10-16
上傳用戶：牛布牛
本文討論了如何設計有效的testbench，適合剛接觸testbench不久的用戶閱讀提高 （xilinx公司編寫）
標簽： Testbenches Efficient Writing
上傳時間： 2013-10-18
上傳用戶：xiaodu1124
這篇文章討論了不同HDL代碼的編寫方式，對綜合結果的影響。閱讀本文對深入了解綜合工具和提高HDL的編寫水平有不少幫助，原文時針對Synopsys的綜合軟件論述的，但對所有綜合軟件，都有普遍的借鑒意義
標簽： Synthesis Coding Styles Guide
上傳時間： 2014-12-23
上傳用戶：huql11633
