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dsp-MATLAB

  • Synplify DSP 3.60

    DSP軟件內(nèi)核開發(fā)工具Synplify DSP IT.SOHU.COM 2004-05-13 00:24 轉(zhuǎn)自...【日經(jīng)BP社報道】美國Synplicity公司日前上市了封裝于FPGA中的DSP軟件內(nèi)核

    標(biāo)簽： Synplify 3.60 DSP

    上傳時間： 2013-04-24

    上傳用戶：維子哥哥

  • Matlab-ccs3.10

    TI公司DSP開發(fā)必備軟件，CCS3.1支持OMAP、TMS320C2000、TMS320C5000、TMS320C6000、TMS470，大家可以下載試一試

    標(biāo)簽： Matlab-ccs 3.10

    上傳時間： 2013-04-24

    上傳用戶：hgy9473

  • SVPWM算法的DSP源碼已通過硬件驗證

    SVPWM算法的DSP源碼，實現(xiàn)逆變輸出與電網(wǎng)電壓同頻同相，并能跟蹤市電幅值變化

    標(biāo)簽： SVPWM DSP 算法 源碼

    上傳時間： 2013-07-20

    上傳用戶：yd19890720

  • 基于FPGA和DSP的中頻信號檢測系統(tǒng)

    基于FPGA和DSP的中頻信號檢測系統(tǒng)的研究與設(shè)計

    標(biāo)簽： FPGA DSP 中頻信號 檢測系統(tǒng)

    上傳時間： 2013-06-17

    上傳用戶：qiuqing

  • dsp

    數(shù)據(jù)統(tǒng)計分析教程，對于統(tǒng)計分析手法做了詳細(xì)介紹，結(jié)合數(shù)據(jù)分析軟件dsp實際操作對實驗數(shù)據(jù)分析流程作分析

    標(biāo)簽： dsp

    上傳時間： 2013-06-04

    上傳用戶：love1314

  • 基于Matlab的模糊PID控制器的設(shè)計和仿真

    本文以誤差和誤差變化率為輸入，利用模糊推理的方法實現(xiàn)了對PID參數(shù)的在線自動整定，并且在MATLAB環(huán)境下對該控制器進行了設(shè)計和仿真。從仿真結(jié)果可以看出，參數(shù)自整定模糊PID控制器控制效果優(yōu)于

    標(biāo)簽： Matlab PID 模糊 控制器

    上傳時間： 2013-04-24

    上傳用戶：wanghui2438

  • 《DSP集成開發(fā)環(huán)境－CCS及DSP/BIOS的原理與應(yīng)用》

    ·《DSP集成開發(fā)環(huán)境－CCS及DSP/BIOS的原理與應(yīng)用》目錄名         對應(yīng)的例子volume1       §2.1小節(jié)中有關(guān)CCS的基本操作的例子maxminmath    §2.2小節(jié)中有關(guān)工程的高級管理的例子d

    標(biāo)簽： DSP BIOS CCS 集成開發(fā)環(huán)境

    上傳時間： 2013-04-24

    上傳用戶：tyler

  • 基于DSP的在線式UPS智能監(jiān)測系統(tǒng)

    ·摘要：  基于DSP的在線式UPS智能監(jiān)測系統(tǒng),采用TMS320LF2407A實現(xiàn).其ADC模塊采集UPS現(xiàn)場電壓、電流、負(fù)載等信息.EV捕獲單元捕獲市電,逆變器的頻率.SCI負(fù)責(zé)PC機與UPS現(xiàn)場的數(shù)據(jù)通訊,傳送UPS運行情況及參數(shù).帶觸摸屏的NS320240A實現(xiàn)UPS現(xiàn)場實時監(jiān)測.并用EEPROM保存記錄,由蜂鳴器對異常報警.  

    標(biāo)簽： DSP UPS 智能監(jiān)測

    上傳時間： 2013-07-01

    上傳用戶：VRMMO

  • Matlab下的EEG處理程序庫

    ·詳細(xì)說明：Matlab下的EEG處理程序庫,例程豐富,講解清晰,醫(yī)學(xué)圖像圖形處理必備文件列表:   eeg_toolbox  ...........\brainstormresults2freesurfer.m  ...........\ColorMapsMake.m  ...........\ColorMapsShow.m  ..........

    標(biāo)簽： Matlab EEG 處理程序

    上傳時間： 2013-07-20

    上傳用戶：13681659100

  • 基于DSP+FPGA結(jié)構(gòu)圖像處理系統(tǒng)設(shè)計與實現(xiàn)

    · 摘要：  為了實現(xiàn)視頻圖像的實時處理,采用基于DSP+FPGA的線性流水陣列結(jié)構(gòu),用現(xiàn)場可編程門陣列FPGA對采集的視頻數(shù)字圖像做預(yù)處理,并結(jié)合大規(guī)模可編程邏輯陣列CPLD進行邏輯控制,實現(xiàn)了視頻圖像的采集和目標(biāo)提取的視頻數(shù)字圖像處理系統(tǒng).介紹了該視頻圖像處理系統(tǒng)的硬件組成、工作原理和各種視頻跟蹤算法的應(yīng)用.該系統(tǒng)與計算機聯(lián)結(jié),配以適當(dāng)?shù)膱D像處理軟件和開發(fā)系統(tǒng),即可形成一個通

    標(biāo)簽： FPGA DSP 圖像處理 系統(tǒng)設(shè)計

    上傳時間： 2013-06-17

    上傳用戶：dancnc

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