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ip核

ip核就是知識產權核或知識產權模塊的意思,在EDA技術開發中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產業的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。IP主要分為軟IP、固IP和硬IP。軟IP是用Verilog/VHDL等硬件描述語言描述的功能塊,但是并不涉及用什么具體電路元件實現這些功能。固IP是完成了綜合的功能塊。硬IP提供設計的最終階段產品——掩膜。[1]
  • Arria V系列 FPGA芯片白皮書(英文)

      Arria V系列 FPGA芯片基本描述   (1)28nm FPGA,在成本、功耗和性能上達到均衡;   (2)包括低功耗6G和10G串行收發器;   (3)總功耗比6G Arria II FPGA低40%;   (4)豐富的硬核IP模塊,提高了集成度   (5)目前市場上支持10.3125Gbps收發器技術、功耗最低的中端FPGA。

    標簽: Arria FPGA V系列 芯片

    上傳時間: 2013-10-21

    上傳用戶:lht618

  • 基于FPGA的MIMO-OFDM基帶系統發射機的設計

    介紹了多入多出-正交頻分復用(MIMO-OFDM)系統,并分析了其發射機的實現原理。充分利用Altera公司Stratix系列現場可編程門陣列(FPGA)芯片和IP(知識產權)核,提出了一種切實可行的MIMO-OFDM基帶系統發射機的FPGA實現方法。重點論述了適合于FPGA實現的對角空時分層編碼(D-BLAST)的方法和實現原理以及各個主要模塊的工作原理。并給出了其在ModelSim環境下的仿真結果。結果表明,本設計具有設計簡單、快速、高效和實時性好等特點。

    標簽: MIMO-OFDM FPGA 基帶系統 發射機

    上傳時間: 2013-11-01

    上傳用戶:wpt

  • 基于NiosII軟核處理器的步進電機接口設計

        NiosII軟核處理器是Altera公司開發,基于FPGA操作平臺使用的一款高速處理器,為了適應高速運動圖像采集,提出了一種基于NiosII軟核處理的步進電機接口設計,使用verilog HDL語言完成該接口設計,最后通過QuartusII軟件,給出了實驗仿真結果。

    標簽: NiosII 軟核處理器 步進電機 接口設計

    上傳時間: 2015-01-02

    上傳用戶:妄想演繹師

  • wp379 AXI4即插即用IP

    In the past decade, the size and complexity of manyFPGA designs exceeds the time and resourcesavailable to most design teams, making the use andreuse of Intellectual Property (IP) imperative.However, integrating numerous IP blocks acquiredfrom both internal and external sources can be adaunting challenge that often extends, rather thanshortens, design time. As today's designs integrateincreasing amounts of functionality, it is vital thatdesigners have access to proven, up-to-date IP fromreliable sources.

    標簽: AXI4 379 wp 即插即用

    上傳時間: 2013-11-11

    上傳用戶:csgcd001

  • 充分利用IP以及拓撲規劃提高PCB設計效率

    本文探討的重點是PCB設計人員利用IP,并進一步采用拓撲規劃和布線工具來支持IP,快速完成整個PCB設計。從圖1可以看出,設計工程師的職責是通過布局少量必要元件、并在這些元件之間規劃關鍵互連路徑來獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設計人員,由他們完成剩余的設計。 圖1:設計工程師獲取IP,PCB設計人員進一步采用拓撲規劃和布線工具支持IP,快速完成整個PCB設計。現在無需再通過設計工程師和PCB設計人員之間的交互和反復過程來獲取正確的設計意圖,設計工程師已經獲取這些信息,并且結果相當精確,這對PCB設計人員來說幫助很大。在很多設計中,設計工程師和PCB設計人員要進行交互式布局和布線,這會消耗雙方許多寶貴的時間。從以往的經歷來看交互操作是必要的,但很耗時間,且效率低下。設計工程師提供的最初規劃可能只是一個手工繪圖,沒有適當比例的元件、總線寬度或引腳輸出提示。隨著PCB設計人員參與到設計中來,雖然采用拓撲規劃技術的工程師可以獲取某些元件的布局和互連,不過,這個設計可能還需要布局其它元件、獲取其它IO及總線結構和所有互連才能完成。PCB設計人員需要采用拓撲規劃,并與經過布局的和尚未布局的元件進行交互,這樣做可以形成最佳的布局和交互規劃,從而提高PCB設計效率。隨著關鍵區域和高密區域布局完成及拓撲規劃被獲取,布局可能先于最終拓撲規劃完成。因此,一些拓撲路徑可能必須與現有布局一起工作。雖然它們的優先級較低,但仍需要進行連接。因而一部分規劃圍繞布局后的元件產生了。此外,這一級規劃可能需要更多細節來為其它信號提供必要的優先級。

    標簽: PCB 利用IP 拓撲規劃

    上傳時間: 2014-01-14

    上傳用戶:lz4v4

  • UG157 LogiCORE IP Initiator/Ta

    UG157 - LogiCORE™ IP Initiator/Target v3.1 for PCI™ 入門指南

    標簽: Initiator LogiCORE 157 UG

    上傳時間: 2013-10-13

    上傳用戶:heheh

  • 基于核密度估計和馬爾科夫隨機場的運動目標檢測

     針對目標和背景具有空間連續性的特點,提出一種基于核密度估計和馬爾科夫隨機場的運動目標檢測方法。首先利用核密度估計計算像素點屬于背景的概率密度,在特征向量中加入顏色空間運動矢量分量來提高對背景擾動和光照變化的魯棒性;然后構造馬爾科夫隨機場,提出一種馬爾科夫隨機場能量函數代價項的構造方法,通過最小化其能量函數得到目標分割結果。實驗結果證明,該運動目標檢測算法對背景擾動和光照變化具有更好的魯棒性,錯誤檢測率更低。

    標簽: 核密度估計 隨機場 運動目標檢測

    上傳時間: 2014-01-20

    上傳用戶:solmonfu

  • 訪問TCP/IP協議棧的vxd例子

    訪問TCP/IP協議棧的vxd例子

    標簽: TCP vxd IP 訪問

    上傳時間: 2015-01-03

    上傳用戶:chenjjer

  • 記錄IP/TCP/UDP/ICMP網絡包日志

    記錄IP/TCP/UDP/ICMP網絡包日志

    標簽: ICMP TCP UDP IP

    上傳時間: 2014-12-02

    上傳用戶:cx111111

  • OICQ黑客工具。可以查看對方IP地址

    OICQ黑客工具。可以查看對方IP地址,發匿名信,炸對方等

    標簽: OICQ 黑客 地址

    上傳時間: 2015-01-03

    上傳用戶:壞天使kk

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